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dsp＋fpga 文章進(jìn)入dsp＋fpga技術(shù)社區(qū)

中國國際醫(yī)療電子技術(shù)大會(huì)隆重登場

　　權(quán)威的市場分析、領(lǐng)先的技術(shù)方案、關(guān)鍵元器件展示與講解，2011年4月19日，眾多精彩內(nèi)容伴隨著第四屆中國國際醫(yī)療電子大會(huì)(CMET2011)一同亮相深圳。深圳醫(yī)療器械行業(yè)協(xié)會(huì)會(huì)長陶篤純、藍(lán)韻集團(tuán)產(chǎn)品市場部總監(jiān)劉明宇、中國科學(xué)院深圳先進(jìn)技術(shù)研究院鄭海榮博士分別從深圳醫(yī)療器械產(chǎn)業(yè)發(fā)展概況、醫(yī)改兩年帶來的機(jī)遇與挑戰(zhàn)、多學(xué)科交叉驅(qū)動(dòng)醫(yī)療儀器創(chuàng)新關(guān)鍵等角度出發(fā)，
關(guān)鍵字： TI FPGA 醫(yī)療超聲

基于DSP與改進(jìn)邊緣檢測(cè)算法的煤矸石自動(dòng)分選系統(tǒng)

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
關(guān)鍵字：煤矸石 DSP 邊緣檢測(cè)算法煤矸石自動(dòng)分選系統(tǒng)

基于Xilinx FPGA的片上系統(tǒng)無線保密通信終端設(shè)計(jì)

0引言利用軟件實(shí)施加密算法已經(jīng)成為實(shí)時(shí)安全通信系統(tǒng)的重要瓶頸。標(biāo)準(zhǔn)的商品化CPU和DSP無法跟上數(shù)據(jù)...
關(guān)鍵字： FPGA 片上系統(tǒng) 無線保密通信終端

基于FPGA+DSP的高速中頻采樣信號(hào)處理平臺(tái)的實(shí)現(xiàn)

基于FPGA+DSP的高速中頻采樣信號(hào)處理平臺(tái)的實(shí)現(xiàn),摘要：高速中頻采樣信號(hào)處理平臺(tái)在實(shí)際應(yīng)用中有很大的前景，提出采用FPGA+DSP的處理結(jié)構(gòu)，結(jié)合高性能A／D和D／A處理芯片，設(shè)計(jì)了一個(gè)通用處理平臺(tái)，并對(duì)其主要性能進(jìn)行了測(cè)試。實(shí)驗(yàn)與實(shí)際應(yīng)用表明，該系統(tǒng)具有很強(qiáng)的
關(guān)鍵字：信號(hào)處理平臺(tái) 實(shí)現(xiàn) 采樣中頻 FPGA DSP 高速基于

FPGA在數(shù)字式心率計(jì)中的電路組成及工作原理

本心率計(jì)在數(shù)字式心率計(jì)的基礎(chǔ)上，采用FPGA和VHDL語言實(shí)現(xiàn)，減少了元器件使用數(shù)量，提高了測(cè)量精度和可靠性。該電路能夠?qū)崟r(shí)采集并測(cè)量人體心跳的瞬時(shí)和平均心跳速率，判斷并顯示心率狀態(tài)（即心跳是否正常、是否過快或過慢、是否有心率不齊現(xiàn)象）。如果心率過快或過慢或者有心率不齊現(xiàn)象，那么將用不同顏色發(fā)光管進(jìn)行閃爍報(bào)警顯示。
關(guān)鍵字： FPGA 數(shù)字式電路工作原理

基于POWER PC+FPGA架構(gòu)的飛行試驗(yàn)振動(dòng)數(shù)據(jù)實(shí)時(shí)分析

摘要：飛行試驗(yàn)振動(dòng)信號(hào)具有采樣率高、數(shù)據(jù)量大、處理復(fù)雜的特點(diǎn)，在現(xiàn)有條件下，通過遙測(cè)鏈路很難將大量的振動(dòng)數(shù)據(jù)實(shí)時(shí)傳輸至地面監(jiān)控系統(tǒng)。針對(duì)試飛測(cè)試的需要，結(jié)合某型號(hào)的試飛關(guān)鍵技術(shù)攻關(guān)研究，突破試飛振動(dòng)數(shù)
關(guān)鍵字： POWER FPGA PC 架構(gòu)

基于現(xiàn)代DSP技術(shù)的QPSK調(diào)制器的設(shè)計(jì)

基于現(xiàn)代DSP技術(shù)的QPSK調(diào)制器的設(shè)計(jì),摘要：為了提高DSP系統(tǒng)的開發(fā)效率，引入了現(xiàn)代DSP技術(shù)，并由此設(shè)計(jì)了QPSK調(diào)制器。依據(jù)QPSK調(diào)制的基本原理，利用MATLAB／Simulink DSP Builder和Quartusll搭建模型，在模塊的形成方式上，采用DSP Builder中的模塊代替
關(guān)鍵字：調(diào)制器設(shè)計(jì) QPSK 技術(shù) 現(xiàn)代 DSP 基于

基于Cyclone III FPGA的DDR2接口設(shè)計(jì)分析

DDR SDRAM是Double Data Rate SDRAM的縮寫，即雙倍速率同步動(dòng)態(tài)隨機(jī)存儲(chǔ)器。DDR內(nèi)存是在SDRAM內(nèi)存基礎(chǔ)上發(fā)展而來的，能夠在時(shí)鐘的上升沿和下降沿各傳輸一次數(shù)據(jù)，可以在與SDRAM相同的總線時(shí)鐘頻率下達(dá)到更高的數(shù)據(jù)傳輸率。雖然DDR2和DDR一樣,都采用相同采樣方式進(jìn)行數(shù)據(jù)傳輸，但DDR2擁有兩倍于DDR的預(yù)讀取系統(tǒng)命令數(shù)據(jù)的能力。
關(guān)鍵字： Cyclone FPGA DDR2 III

高性能FPGA中的高速SERDES接口

引言　串行接口常用于芯片至芯片和電路板至電路板之間的數(shù)據(jù)傳輸。隨著系統(tǒng)的帶寬不斷增加至多吉比特范圍，并行接口已經(jīng)被高速串行鏈接，或SERDES （串化器/ 解串器）所取代。起初， SERDES是獨(dú)立的ASSP或ASIC器
關(guān)鍵字： SERDES FPGA 性能接口

基于Xilinx FPGA的片上系統(tǒng)無線保密通信終端

本設(shè)計(jì)使用硬件描述語言VHDL在FPGA數(shù)字邏輯層面上實(shí)現(xiàn)AES加解密，為了系統(tǒng)的擴(kuò)展性和構(gòu)建良好的人機(jī)交互，設(shè)計(jì)通過PS/2鍵盤輸入加密密鑰，并將其顯示在LCD上。在軟核MicroBlaze上，通過SPI總線讀寫FIFO和RAM控制射頻芯片CC2420，使系統(tǒng)具有信道選擇、地址識(shí)別、自動(dòng)CRC校驗(yàn)功能，使系統(tǒng)更加安全、通信誤碼率更低。
關(guān)鍵字：保密通信終端無線系統(tǒng) Xilinx FPGA 基于

基于FPGA數(shù)據(jù)流控制動(dòng)態(tài)可重構(gòu)的實(shí)現(xiàn)

摘要基于FPGA基本數(shù)據(jù)流的下載控制方式，利用遺傳算法，通過單片機(jī)控制數(shù)據(jù)流的方式對(duì)FPGA進(jìn)行編程配置，實(shí)現(xiàn)自身重構(gòu)，使系統(tǒng)具有自適應(yīng)、自組織和自修復(fù)的特性。
關(guān)鍵詞 FPGA；遺傳算法；動(dòng)態(tài)重構(gòu)；單片機(jī)
關(guān)鍵字： FPGA 數(shù)據(jù)流動(dòng)態(tài)可重構(gòu)

基于DSP的軌道移頻信號(hào)解調(diào)實(shí)現(xiàn)

基于DSP的軌道移頻信號(hào)解調(diào)實(shí)現(xiàn),摘要提出了以雙路TMS320F2812為核心，接收解調(diào)ZPW-2000A的FSK信號(hào)。前端通過信號(hào)調(diào)理，利用DSP內(nèi)部的AD對(duì)FSK信號(hào)采樣。經(jīng)過FFT變換解調(diào)出栽頻頻率、Z—FFT解調(diào)低頻頻率，以及通過DSP的SPI口。對(duì)兩路解調(diào)出的信
關(guān)鍵字：解調(diào) 實(shí)現(xiàn) 信號(hào) 軌道 DSP 基于

基于DSP的混沌數(shù)字圖像加密與硬件實(shí)現(xiàn)

基于DSP的混沌數(shù)字圖像加密與硬件實(shí)現(xiàn),摘要介紹了在DSP基礎(chǔ)上，實(shí)現(xiàn)數(shù)字圖像的混沌加密及硬件實(shí)現(xiàn)方法。根據(jù)離散化和數(shù)字化處理技術(shù)，對(duì)三維Lorenz混沌系統(tǒng)作離散化處理，用C語言和DSP技術(shù)產(chǎn)生三維Lorenz混沌迭代序列，分別對(duì)數(shù)字圖像的紅、綠、藍(lán)三基色
關(guān)鍵字：加密硬件實(shí)現(xiàn) 圖像數(shù)字 DSP 混沌基于

基于DSP的混沌數(shù)字圖像加密與硬件設(shè)計(jì)

摘要介紹了在DSP基礎(chǔ)上，實(shí)現(xiàn)數(shù)字圖像的混沌加密及硬件實(shí)現(xiàn)方法。根據(jù)離散化和數(shù)字化處理技術(shù)，對(duì)三維Lore...
關(guān)鍵字： Lorenz系統(tǒng) 圖像加密 DSP 混沌加密硬件實(shí)現(xiàn)

異步FIFO在FPGA與DSP通信中的運(yùn)用

摘要利用異步FIFO實(shí)現(xiàn)FPGA與DSP進(jìn)行數(shù)據(jù)通信的方案。FPGA在寫時(shí)鐘的控制下將數(shù)據(jù)寫入FIFO，再與DSP進(jìn)行握手后，DSP通過EMIFA接口將數(shù)據(jù)讀入。文中給出了異步FIFO的實(shí)現(xiàn)代碼和FPGA與DSP的硬件連接電路。經(jīng)驗(yàn)證，利用
關(guān)鍵字：通信運(yùn)用 DSP FPGA FIFO 異步

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利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計(jì)的方法
一種基于DSP和USB的指紋識(shí)別系統(tǒng)設(shè)計(jì)
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基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計(jì)與實(shí)現(xiàn)

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基于FPGA的數(shù)字存儲(chǔ)示波器設(shè)計(jì)與實(shí)現(xiàn)
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