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          FPGA實現(xiàn)UART和MCU一體化設(shè)計

          • 摘要:現(xiàn)代數(shù)字電子系統(tǒng)設(shè)計正在朝著新的方向發(fā)展,即利用FPGA技術(shù)進行系境設(shè)計。介紹了一種利用FPGA來實現(xiàn)通用串行異步收發(fā)器(UA-RT)和控制通信的MCU的數(shù)字系統(tǒng),底層設(shè)計模塊采用VHDL硬件描述語言實現(xiàn),并進行了仿
          • 關(guān)鍵字: FPGA  UART  MCU    

          基于FPGA的8PSK軟解調(diào)的研究與實現(xiàn)

          • 摘 要:先分析了8PSK 的軟解調(diào)原理,針對最優(yōu)的對數(shù)似然比(LLR)運算復雜度較高的特點,選用了相對簡化的最大值(MAX)算法作為可編程邏輯門陣列(FGPA)硬件平臺實現(xiàn)方案。隨后,通過QUARTUS II 仿真平臺對8P
          • 關(guān)鍵字: FPGA  8PSK  軟解調(diào)    

          基于FPGA的激光筆輔助教學系統(tǒng)設(shè)計與實現(xiàn)

          • 摘要:為了實現(xiàn)激光筆與大屏幕的互動,基于常用的OV9650攝像頭模塊和315 MHz無線收發(fā)模塊,采用了一種FPGA架構(gòu)實現(xiàn)激光筆與大屏幕互動的設(shè)計方案。OV9650攝像頭模塊的采集信號由FPGA進行緩存和處理,由它計算出激光點
          • 關(guān)鍵字: FPGA  激光筆  輔助  教學系統(tǒng)    

          基于Matlab/DSP Builder任意波形信號發(fā)生器的兩種設(shè)計

          • 基于Matlab/DSP Builder任意波形信號發(fā)生器的兩種設(shè)計,根據(jù)傳統(tǒng)型任意波形信號發(fā)生器和基于DDS任意波形信號發(fā)生器的設(shè)計原理,采用Matlab/DSP Builder的建模方法,在DSP Builder平臺上完成兩種原理的系統(tǒng)建模和仿真,并用SignalCompiler工具對模型進行編譯,產(chǎn)生QuartusⅡ能夠識別的VHDL源程序,并通過FPGA芯片EP2C8Q208C來實現(xiàn),最后用SignalTapⅡ進行硬件測試。經(jīng)系統(tǒng)仿真和硬件測試,證明兩種設(shè)計方法的正確性。比較傳統(tǒng)的硬件描述語言建模
          • 關(guān)鍵字: 波形  信號發(fā)生器  設(shè)計  任意  Builder  Matlab  DSP  基于  

          一種高效靈活數(shù)字上變頻FPGA設(shè)計

          • 摘要:數(shù)字上變頻器是軟件無線電的核心部件之一,其基本功能是增加基帶信號采樣率并把其搬移到載波頻率上。...
          • 關(guān)鍵字: 數(shù)字上變頻  FPGA  altera  

          在選用FPGA進行設(shè)計時降低功耗的方法

          • 如今,各種規(guī)范和標準都對系統(tǒng)的整體功耗提出了越來越嚴格的要求,以至于系統(tǒng)設(shè)計師面臨越來越艱巨的挑戰(zhàn)。...
          • 關(guān)鍵字: FPGA  降低功耗  

          新出現(xiàn)的SoC FPGA上的策略考慮

          • 集成了FPGA架構(gòu)、硬核CPU子系統(tǒng)以及其他硬核IP的半導體器件SoCFPGA已經(jīng)發(fā)展到了一個“關(guān)鍵點”,它在今...
          • 關(guān)鍵字: SoC  FPGA  硬核  IP  嵌入式系統(tǒng)  Altera  

          多通道頻率檢測技術(shù)的FPGA實現(xiàn)

          • 摘要:多通道頻率檢測是當前數(shù)字接收機的一種常用的頻率測量方案,該方法可以較好地解決頻率截獲概率與頻率分辨力的矛盾,并在復雜的電磁環(huán)境中具有處理多個同時到達信號的能力。文中給出了基于FPGA來實現(xiàn)多信道頻率
          • 關(guān)鍵字: FPGA  多通道  頻率  檢測技術(shù)    

          基于FPGA的煙支檢測系統(tǒng)的設(shè)計

          • 摘要:為了實現(xiàn)煙支剔除的自動化程度,減少人為干預量和提高剔除精度,文中給出了采用FPGA硬件編程方法將數(shù)據(jù)采集部件采集到的煙支數(shù)據(jù)經(jīng)A/D轉(zhuǎn)換后送入FPGA,然后根據(jù)一定的判決算法輸出控制信號,以用于控制剔除閥
          • 關(guān)鍵字: FPGA  檢測系統(tǒng)    

          采用DSP的實時震動信號分析處理系統(tǒng)設(shè)計原理

          • 震動信號分析作為戰(zhàn)場傳感偵察系統(tǒng)的一個重要組成部分,主要探測地面運動目標的震動信號,對其信號實時分析和處理,并給出相應的識別信號,以判別震動目標類型、數(shù)量等信息。為了得到良好的震動信號,并能初步分析處
          • 關(guān)鍵字: 處理  理系  設(shè)計  原理  分析  信號  DSP  實時  震動  采用  

          基于FPGA的Picoblaze核實現(xiàn)Modbus通信協(xié)議

          • 摘要:給出了一種在Xinlinx的Spartan-3E評估板上實現(xiàn)Modbus通信協(xié)議的方法。該方法以PC為上位機,并在評估板上嵌入Picoblaze軟核作為下位機來實現(xiàn)Modbus通信協(xié)議的功能。文中同時介紹了使用Xilinx ISE和Picoblaze軟核
          • 關(guān)鍵字: 通信  協(xié)議  Modbus  實現(xiàn)  FPGA  Picoblaze  基于  

          TMS320C54X DSP實現(xiàn)UART的技術(shù)

          • TMS320C54X DSP實現(xiàn)UART的技術(shù),TMS320C54x DSP的外設(shè)沒有集成UJART串口,可以通過兩種途徑來實現(xiàn)TMS320C54X的LJART串口通信功能。一是通過軟件的方法。二是采用外部接口芯片組,完成RS232信號的接收和發(fā)送,并以DSP容易快速訪問的方式與DSP接口。1
          • 關(guān)鍵字: 技術(shù)  UART  實現(xiàn)  DSP  TMS320C54X  

          基于DSP數(shù)字信號處理器的墻體裂縫測圖像的處理

          • 基于DSP數(shù)字信號處理器的墻體裂縫測圖像的處理,摘要:為了對建筑物中的墻體裂縫進行高精度和高清晰度地測量、計算和處理。文中給出了使用DSP數(shù)字信號處理器來對墻體裂縫圖像進行預處理的具體方法及相關(guān)算法,同時給出了相應的仿真結(jié)果。
            關(guān)鍵字:墻體裂縫監(jiān)測;圖
          • 關(guān)鍵字: 裂縫  圖像  處理  墻體  信號處理器  DSP  數(shù)字  基于  

          基于FPGA和LAN91C111的嵌入式以太網(wǎng)接口設(shè)計

          • 基于FPGA和LAN91C111的嵌入式以太網(wǎng)接口設(shè)計,摘要:介紹了SMSC公司生產(chǎn)的嵌入式以太網(wǎng)控制器LAN91C111的主要特點及工作原理,并從系統(tǒng)方案、硬件設(shè)計、軟件設(shè)計等方面,詳細介紹了基于ALTERA公司的NIOS II軟核處理器芯片LAN91C111芯片來實現(xiàn)以太網(wǎng)互聯(lián)通信的原理
          • 關(guān)鍵字: 接口  設(shè)計  以太網(wǎng)  嵌入式  FPGA  LAN91C111  基于  

          Altera為FPGA提供首款集成100G EFEC解決方案

          • Altera公司今天宣布,開始提供業(yè)界第一款集成增強前向糾錯(EFEC)IP內(nèi)核,該內(nèi)核針對高性能StratixIV和Stratix...
          • 關(guān)鍵字: FPGA  100G  EFEC  
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