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內(nèi)嵌ARM核的FPGA芯片EPXA10及其在圖像驅(qū)動和處理方面的應(yīng)用
- 內(nèi)嵌ARM核的FPGA芯片EPXA10及其在圖像驅(qū)動和處理方面的應(yīng)用 北京航空航天大學(xué)自動化科學(xué)與電氣工程學(xué)院(100083) 尹 娜 江 潔 張廣軍 摘 要：介紹了內(nèi)嵌 ARM核的FPGA芯片EPXA10的主要功能特點(diǎn)、內(nèi)部結(jié)構(gòu)及工作方式，通過其在圖像驅(qū)動和處理方面的應(yīng)用，體現(xiàn)了EPXA10邏輯控制實(shí)現(xiàn)簡單、對大量數(shù)據(jù)做簡單處理速度快以及軟件編程靈活的特點(diǎn)。 關(guān)鍵詞：ARM FPGA EPXA10 圖像驅(qū)動 圖像處理 隨著亞微米技術(shù)的發(fā)展，F(xiàn)PGA芯片密度不斷增加，并以強(qiáng)大的
- 關(guān)鍵字： ARM EPXA10 FPGA 圖像處理 圖像驅(qū)動
中斷在TMS320C54x系列DSP中的應(yīng)用
- 中斷在TMS320C54x系列DSP中的應(yīng)用 南京東南大學(xué)信息處理與應(yīng)用工程研究中心(210096) 朱繼紅 于東海 鄒采榮 摘 要：詳細(xì)分析了TMS320C54x系列DSP的中斷機(jī)制，以及在擴(kuò)展地址模式下中斷控制所具有的一些特點(diǎn)，并給出了DSP/BIOS下中斷的管理。 關(guān)鍵詞：中斷 中斷向量表 TMS320C54x DSP/BIOS DSP 中斷是嵌入式芯片的靈魂，這是因?yàn)槎鄶?shù)嵌入式系統(tǒng)對實(shí)時(shí)性都有很高的要求，即對出現(xiàn)事件的響應(yīng)要極為迅速。中斷與軟件查詢方式相比有著更高的執(zhí)行
- 關(guān)鍵字： DSP DSP/BIOS TMS320C54x 中斷 中斷向量表
高速數(shù)字串行加法器及其應(yīng)用
- 高速數(shù)字串行加法器及其應(yīng)用 深圳南山區(qū)科技園中興通訊IC開發(fā)一部(518057) 鐘信潮上海盛立亞光網(wǎng)絡(luò)系統(tǒng)有限公司 薛小剛深圳南山區(qū)科技園中興通訊3G開發(fā)(518057) 王 誠 摘 要：與傳統(tǒng)加法器相比，數(shù)字串行加法器具有工作頻率高、占用資源少、設(shè)計(jì)靈活等優(yōu)點(diǎn)。介紹了數(shù)字串行加法器的原理，說明了該加法器在FPGA上的實(shí)現(xiàn)要點(diǎn)及其在匹配濾波器設(shè)計(jì)中的應(yīng)用。 關(guān)鍵詞：加法器 位并行 數(shù)字串行 FPGA 匹配濾波器 與傳統(tǒng)DSP相比，定制DSP具有速度更高、設(shè)計(jì)靈活、易于更改
- 關(guān)鍵字： FPGA 加法器 匹配濾波器 數(shù)字串行 位并行
基于DSP CCS 2.2實(shí)現(xiàn)指紋識別預(yù)處理系統(tǒng)
- 基于DSP CCS 2.2實(shí)現(xiàn)指紋識別預(yù)處理系統(tǒng) 趙慧民1, 朱 立2(1. 佛山科學(xué)技術(shù)學(xué)院 機(jī)電學(xué)院,廣東 佛山 528000;2. 佛山科學(xué)技術(shù)學(xué)院 信息中心,廣東 佛山 528000) 摘 要：介紹了采用TI公司的高速DSP芯片TMS320VC5402的指紋識別系統(tǒng)的預(yù)處理算法和編程實(shí)現(xiàn)。算法實(shí)現(xiàn)采用的DSP集成開發(fā)環(huán)境(IDE)為CCS 2.2。通過采用極值濾波、平滑濾波、拉普拉斯銳化、二值化等對指紋圖像進(jìn)行預(yù)處理,取得了良好的試驗(yàn)結(jié)果。 關(guān)鍵詞：指紋識別 DSP
- 關(guān)鍵字： 2.2 CCS DSP TMS320VC5402 指紋識別
基于DSP的精密半導(dǎo)體激光驅(qū)動電源系統(tǒng)
- 引言 目前，半導(dǎo)體激光(LD)已廣泛應(yīng)用于通信、信息檢測、醫(yī)療和精密加工與軍事等許多領(lǐng)域。激光電源是激光裝置的重要組成部分，其性能的好壞直接影響到整個(gè)激光器裝置的技術(shù)指標(biāo)。本設(shè)計(jì)采用受DSP控制的恒流源來為半導(dǎo)體激光器提供電流，在電路中，利用負(fù)反饋原理，控制復(fù)合功率調(diào)整管輸出電流，以達(dá)到穩(wěn)定輸出電流的目的。該系統(tǒng)采用電路設(shè)計(jì)和程序控制算法設(shè)計(jì)相結(jié)合的方法，從多方面對半導(dǎo)體激光器的工作狀態(tài)進(jìn)行實(shí)時(shí)檢測和控制，使系統(tǒng)的性能得到很大的改善和提高，有效解決了半導(dǎo)體激光器工作的準(zhǔn)確、穩(wěn)定和可靠性
- 關(guān)鍵字： DSP 單片機(jī) 電源 激光 精密半導(dǎo)體 嵌入式系統(tǒng) 模擬IC 電源
利用Virtex-5 FPGA實(shí)現(xiàn)更高的性能
- 在FPGA系統(tǒng)設(shè)計(jì)中，要達(dá)到性能最大化需要平衡具有混合性能效率的元器件，包括邏輯構(gòu)造(fabric)、片上存儲器、DSP和I/O帶寬。在本文中，我將向你解釋怎樣能在追求更高系統(tǒng)級性能的過程中受益于Xilinx® 的Virtex™-5 FPGA構(gòu)建模塊，特別是新的ExpressFabric™技術(shù)。以針對邏輯和算術(shù)功能的量化預(yù)期性能改進(jìn)為例，我將探究ExpressFabric架構(gòu)的主要功能。基于實(shí)際客戶設(shè)計(jì)的基準(zhǔn)將說明Virtex-5ExpressFabric技術(shù)性能平均比前一
- 關(guān)鍵字： FPGA Virtex-5 單片機(jī) 嵌入式系統(tǒng)
利用Xilinx Platform Studio工具套件，快速、便捷地生成 BSP
- 具有嵌入式處理器的 平臺 FPGA 為您提供前所未有的靈活性、集成度和高性能。目前，在單個(gè)可編程邏輯設(shè)備中開發(fā)極其復(fù)雜且高度定制化的嵌入式系統(tǒng)已成為可能。 隨著芯片性能的不斷增加，如何使設(shè)計(jì)方法始終高效、多產(chǎn)，成為人們面臨的主要挑戰(zhàn)。嵌入式系統(tǒng)開發(fā)的關(guān)鍵活動之一是開發(fā)板支持包 (BSP)。利用 BSP，可以使嵌入式軟件應(yīng)用程序成功地初始化，并與連接到處理器的硬件資源進(jìn)行通信。典型的 BSP 組件包括引導(dǎo)代碼、設(shè)備驅(qū)動程序代碼和
- 關(guān)鍵字： FPGA PowerPC 處理器的Virtex 單片機(jī) 嵌入式系統(tǒng)
SYNPLICITY CERTIFY軟件全面支持XILINX VIRTEX-5 FPGA簡化ASIC原型驗(yàn)證過程
- Synplicity宣布其Certify® ASIC RTL 原型設(shè)計(jì)軟件增強(qiáng)了對 Xilinx Virtex™-5 系列的 65 納米 FPGA 的支持。Certify 軟件是業(yè)界首款支持多個(gè) FPGA 進(jìn)行 ASIC 原型設(shè)計(jì)的產(chǎn)品。Certify 工具將多芯片分組技術(shù)與業(yè)界一流的 FPGA 綜合技術(shù)
- 關(guān)鍵字： ASIC原型驗(yàn)證 CERTIFY軟件 FPGA SYNPLICITY VIRTEX-5 XILINX 單片機(jī) 嵌入式系統(tǒng)
Synplicity的DSP綜合平臺于2006年得到大幅發(fā)展
- Synplicity宣布其ESL 平臺，即Synplify DSP 綜合解決方案的采用率（銷售量）在 2006 年翻了一番有余，尤其在工業(yè)、軍事/航空領(lǐng)域大受歡迎。Synplicity 認(rèn)為DSP 綜合平臺快速發(fā)展的主要原因在于：公司擁有獨(dú)特的真正 DSP 綜合技術(shù)，Synplify® DSP 綜合優(yōu)化引擎得到了不斷發(fā)展和支持更多工業(yè)與軍事/航空領(lǐng)域中常用功能的IP。Synplicity
- 關(guān)鍵字： DSP Synplicity 單片機(jī) 發(fā)展 嵌入式系統(tǒng) 綜合平臺
利用Virtex-5 FPGA實(shí)現(xiàn)更高性能的方法
- 在FPGA系統(tǒng)設(shè)計(jì)中，要達(dá)到性能最大化需要平衡具有混合性能效率的元器件，包括邏輯構(gòu)造(fabric)、片上存儲器、DSP和I/O帶寬。在本文中，我將向你解釋怎樣能在追求更高系統(tǒng)級性能的過程中受益于Xilinx? 的Virtex?-5 FPGA構(gòu)建模塊，特別是新的ExpressFabric?技術(shù)。以針對邏輯和算術(shù)功能的量化預(yù)期性能改進(jìn)為例，我將探究ExpressFabric架構(gòu)的主要功能?；趯?shí)際客戶設(shè)計(jì)的基準(zhǔn)將說明Virtex-5ExpressFabric技術(shù)性能平均比前一代Virtex-4 FPGA要高
- 關(guān)鍵字： FPGA Virtex-5 單片機(jī) 邏輯構(gòu)造 嵌入式系統(tǒng)
可重構(gòu)計(jì)算技術(shù)將漸入民用領(lǐng)域
- 可重構(gòu)計(jì)算（Reconfigurable Computing） 技術(shù)是指在軟件的控制下，利用系統(tǒng)中的可重用資源（如FPGA等可重構(gòu)邏輯器件），根據(jù)應(yīng)用的需要重新構(gòu)造一個(gè)新的計(jì)算平臺，達(dá)到接近專用硬件設(shè)計(jì)的高性能。它避免了微處理器計(jì)算模式因?yàn)槿≈浮⒆g碼等步驟導(dǎo)致的性能損失，同時(shí)也消除了專用集成電路（ASIC）計(jì)算模式因?yàn)榍捌谠O(shè)計(jì)制造的復(fù)雜過程帶來的高代價(jià)和不可重用等缺陷。 從某種意義上來說，可重構(gòu)計(jì)算技術(shù)并不是什么新技術(shù)，
- 關(guān)鍵字： FPGA 可重構(gòu)計(jì)算 嵌入式
FPGA實(shí)現(xiàn)的FIR算法在汽車動態(tài)稱重儀中的應(yīng)用
- 引言 車輛在動態(tài)稱重時(shí)，作用在平臺上的力除真實(shí)軸重外，還有許多因素產(chǎn)生的干擾力，如：車速、車輛自身諧振、路面激勵(lì)、輪胎驅(qū)動力等，給動態(tài)稱重實(shí)現(xiàn)高精度測量造成很大困難。若在消除干擾的過程中采用模擬方法濾波，參數(shù)則不能過大，否則將產(chǎn)生過大的延遲導(dǎo)致不能實(shí)現(xiàn)實(shí)時(shí)處理，從而造成濾波后的信號仍然含有相當(dāng)一部分的噪聲。所以必須采用數(shù)字濾波消除干擾。 FIR濾波的原理及實(shí)現(xiàn) 本文采用FIR數(shù)字濾波，其原理如公式1所示。 Y(n)= (1) 其中h(k)為系統(tǒng)濾波參數(shù)，x(n)為采集的信號，
- 關(guān)鍵字： FIR算法 FPGA 動態(tài)稱重儀 汽車電子 汽車電子
低功耗FPGA設(shè)計(jì)技術(shù)
- 一、前言 隨著系統(tǒng)功率預(yù)算的不斷緊縮，迫切需要新型低功率元器件。對通信基礎(chǔ)設(shè)施而言，電路板冷卻、機(jī)箱體積小型化以及系統(tǒng)可靠性在系統(tǒng)設(shè)計(jì)中都起著重要的作用。對e-應(yīng)用，電池壽命、熱耗散和小體積尺寸是主要的設(shè)計(jì)難點(diǎn)。選用智能器件，輔以正確的設(shè)計(jì)技巧增加了符合功率預(yù)算的可能性。盡管可編程邏輯器件（PLD）有很好的性能，然而卻以犧牲功耗為代價(jià)。Actel公司的抗熔斷型FPGA提供低功耗且高性能應(yīng)用的理想解決方案。本文涵蓋Actel eX系列以及SX/SX-A系列器件，詳細(xì)描述了器件的結(jié)構(gòu)特點(diǎn)與設(shè)計(jì)技巧。
- 關(guān)鍵字： FPGA 低功耗
賽靈思推出系統(tǒng)性能最高、編譯時(shí)間最快的ISE WEBPACK 9.1i設(shè)計(jì)套件
- 可免費(fèi)下載并同時(shí)支持Windows和Linux平臺的設(shè)計(jì)套件，能降低平均10%的動態(tài)功耗并提供擴(kuò)展的FPGA器件支持 2007年1月30日，北京 - 全球領(lǐng)先的可編程邏輯解決方案提供商賽靈思公司(Xilinx, Inc.) (NASDAQ:XLNX) 日前宣布推出最新版本、可免費(fèi)下載的邏輯設(shè)計(jì)套件——集成軟件環(huán)境 (ISE™) WebPACK™ 9.1i，目前用戶可立即下載使用。這一新版本包含了使用廣泛的賽靈思 ISE Foundatio
- 關(guān)鍵字： FPGA Linux Windows
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