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          拆解安捷倫電源/測量單元(SMU)

          • Dave Jones在5年時間里,上傳了超過600個電子類的視頻。在每周二,Jones會拆解一個不錯的設備(當然,有時候沒有那么好),Jones并不是簡單地把盒子破壞、打開,他會用他豐富的電子設計知識來說明這個設備是怎么設計
          • 關鍵字: 拆解    FPGA    CPLD    Xilinx    安捷倫  

          基于DSP的頻率特性分析儀設計

          • 頻率特性分析儀可以對被測網(wǎng)絡的頻率特性進行快速的動態(tài)測量,得出被測網(wǎng)絡傳輸特性,并將測量結果以數(shù)據(jù)或圖形的形式實時顯示。傳統(tǒng)的掃頻儀大多結構復雜、體積龐大、價格昂貴且操作復雜。因此,具有低成本、數(shù)字化
          • 關鍵字: 直接數(shù)字頻率合成  數(shù)字信號處理器  FPGA  頻率特性測試  

          基于數(shù)字電位計的X射線探測器偏壓調(diào)節(jié)

          • 針對某X射線探測器輸出信號增益需不斷調(diào)節(jié)以滿足后續(xù)信號采集電路的輸入范圍,其偏置電壓需要精細調(diào)節(jié),文章采用數(shù)字電位計和FPGA設計了X射線探測器偏置電壓調(diào)節(jié)系統(tǒng)。闡述了所選數(shù)字電位計的參數(shù)、特點及內(nèi)部結構,在此基礎上給出了系統(tǒng)的設計方案。文章中FPGA采用SPI通信方式對數(shù)字電位計進行配置實現(xiàn)電阻100KΩ共256檔的調(diào)節(jié),最終給出實際測試結果,驗證了采用數(shù)字電位計實現(xiàn)偏壓調(diào)節(jié)的靈活性。
          • 關鍵字: X射線探測器  反向偏壓調(diào)節(jié)  數(shù)字電位計  SPI  FPGA  

          基于FPGA軟核的參數(shù)可變的壓力測試系統(tǒng)設計

          • 在爆炸場壓力測試中,沖擊波超壓峰值隨著彈藥的當量和到爆心距離的變化十分顯著。傳統(tǒng)測試系統(tǒng)的測試參數(shù)難以更改,靈活性差,往往需要重新設計電路以滿足不同測試要求。為了提高測試系統(tǒng)的靈活性及電路復用性,設計了基于可配置FPGA軟核的測試系統(tǒng)。通過調(diào)用并修改可移植軟核,以實現(xiàn)系統(tǒng)的快速設計,通過靈活設置測試參數(shù)完成不同測試任務。對系統(tǒng)準確性進行了驗證,應用到靜爆試驗中,有效獲得了壓力數(shù)據(jù)。
          • 關鍵字: FPGA  軟核  沖擊波  存儲測試  

          以FPGA為基礎的SoC驗證平臺 自動化電路仿真?zhèn)慑e功能

          • 隨著系統(tǒng)芯片(SoC)設計的體積與復雜度持續(xù)升高,驗證作業(yè)變成了瓶頸:占了整個SoC研發(fā)過程中70% 的時間。因此,任何能夠降低驗證成本并能更早實現(xiàn)驗證sign-off的方法都是眾人的注目焦點。臺灣工業(yè)技術研究院 (工研院
          • 關鍵字: FPGA  SoC  基礎  電路仿真    

          基于DSP及FPGA的水下目標定位系統(tǒng)數(shù)字信號處理模塊設計

          • 隨著水下武器和水下航行器等水下目標的快速發(fā)展,對其進行定位和跟蹤從而檢驗其性能的試驗具有非常重要的意義,這也是水下目標試驗場的重要工作內(nèi)容。水下試驗場的定位系統(tǒng)根據(jù)被測目標是否加裝合作聲信標,可以分為
          • 關鍵字: FPGA  DSP  水下目標定位  數(shù)字信號處理    

          采用PCM編碼原理及FPGA編程技術實現(xiàn)PCM數(shù)字基群接口傳輸

          • 采用PCM編碼原理及FPGA編程技術實現(xiàn)PCM數(shù)字基群接口傳輸?shù)退贁?shù)據(jù)的接入
            一、概述----高速傳輸系統(tǒng)中低速設備的接入有廣泛的應用范圍。在環(huán)境監(jiān)控等監(jiān)控網(wǎng)絡中,被監(jiān)控設備往往提供RS-232/RS-485/V.10/V.35的通信接口
          • 關鍵字: PCM  FPGA  編碼  編程    

          基于FPGA+DSP雷達導引頭信號處理中FPGA設計的關鍵技術

          • 1 引言隨著同防工業(yè)對精確制導武器要求的不斷提高,武器系統(tǒng)總體設計方案的日趨復雜,以及電子元器件水平的飛速發(fā)展。導引頭信號處理器的功能越來越復雜,硬件規(guī)模越來越大.處理速度也越來越高.而且產(chǎn)品的更新速度
          • 關鍵字: FPGA  DSP  雷達導引頭  關鍵技術    

          FPGA與DDR3 SDRAM的接口設計

          • DDR3 SDRAM內(nèi)存的總線速率達到600 Mbps to 1.6 Gbps (300 to 800 MHz),1.5V的低功耗工作電壓,采用90nm制程達到2Gbits的高密度。這個架構毫無疑問更快、更大,每比特的功耗也更低,但是如何實現(xiàn)FPGA和DDR3 SDRAM DI
          • 關鍵字: SDRAM  FPGA  DDR3  接口設計    

          基于FPGA 的DDR SDRAM控制器在高速數(shù)據(jù)采集系統(tǒng)中應用

          • 實現(xiàn)數(shù)據(jù)的高速大容量存儲是數(shù)據(jù)采集系統(tǒng)中的一項關鍵技術。本設計采用Altera 公司Cyclone系列的FPGA 完成了對DDR SDRAM 的控制,以狀態(tài)機來描述對DDR SDRAM 的各種時序操作,設計了DDR SDRAM 的數(shù)據(jù)與命令接口。用控
          • 關鍵字: SDRAM  FPGA  DDR  控制器    

          基于FPGA的雙備份多路數(shù)據(jù)采集存儲系統(tǒng)的設計與實現(xiàn)

          • 隨著信息技術的發(fā)展以及數(shù)字集成電路速度的提高,實時處理大量數(shù)據(jù)已經(jīng)成為現(xiàn)實,但在一些特殊條件下,無法實時傳輸數(shù)據(jù),必須使用存儲測試方法。該方法是在不影響被測對象或在允許的范圍下,將微型存儲測試系統(tǒng)置入
          • 關鍵字: FPGA  備份  多路數(shù)據(jù)采集  存儲系統(tǒng)    

          基于Xilinx FPGA的部分動態(tài)可重構技術的信號解調(diào)系統(tǒng)

          • 隨著現(xiàn)代通信技術的迅速發(fā)展,信號的調(diào)制方式向多樣化發(fā)展,解淵技術也隨之不斷向前發(fā)展。為了對高速大帶寬的信號進行實時解調(diào),現(xiàn)在很多的解調(diào)關鍵算法都是在高速硬件上用可編程邏輯器件(FPGA)實觀,利用FPGA強大的
          • 關鍵字: Xilinx  FPGA  部分動態(tài)可重構  信號解調(diào)系統(tǒng)    

          基于FPGA與有限狀態(tài)機的高精度測角系統(tǒng)的設計與實現(xiàn)

          • 激光跟蹤測量系統(tǒng)(Laser Tracker System)是工業(yè)測量系統(tǒng)中常用的一種高精度的測量儀器,是近十年發(fā)展起來的新型大尺寸空間測量儀器,不僅對靜止目標可以測量,而且對運動目標也可以進行跟蹤測量。它集合了激光測距技
          • 關鍵字: FPGA  有限狀態(tài)機  高精度  測角系統(tǒng)    

          FPGA最小系統(tǒng)電路分析:高速SDRAM存儲器接口電路設計

          • 高速SDRAM存儲器接口電路設計SDRAM可作為軟嵌入式系統(tǒng)的(NIOS II)的程序運行空間,或者作為大量數(shù)據(jù)的緩沖區(qū)。SDRAM是通用的存儲設備,只要容量和數(shù)據(jù)位寬相同,不同公司生產(chǎn)的芯片都是兼容的。一般比較常用的SDRAM
          • 關鍵字: SDRAM  FPGA  最小系統(tǒng)  電路分析    

          京微雅格重磅之作―新版FPGA/CAP設計套件Primace5.0

          • 簡介作為國內(nèi)唯一一家具有完全自主知識產(chǎn)權的FPGA與可配置應用平臺CAP(Configurable Application Platform)產(chǎn)品供應商,京微雅格一直在快節(jié)奏的改進與產(chǎn)品配套的軟件開發(fā)環(huán)境。最近,新一代FPGA/CAP設計套件Primace5
          • 關鍵字: 京微雅格  FPGA  CAP設計套件  Primace5.0  
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