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零基礎(chǔ)學FPGA（十一）一步一腳印之基于FIFO的串口發(fā)送機設(shè)計全流程及常見錯誤詳解
- 記得在上幾篇博客中，有幾名網(wǎng)友提出要加進去錯誤分析這一部分，那我們就從今天這篇文章開始加進去我在消化這段代碼的過程中遇到的迷惑，與大家分享。 今天要寫的是一段基于FIFO的串口發(fā)送機設(shè)計，之前也寫過串口發(fā)送的電路，這次寫的與上次的有幾分類似。這段代碼也是我看過別人寫過的之后，消化一下再根據(jù)自己的理解寫出來的，下面是我寫這段代碼的全部流程和思路，希望對剛開始接觸的朋友來說有一點點的幫助，也希望有經(jīng)驗的朋友給予寶貴的建議。 首先來解釋一下FIFO的含義，F(xiàn)IFO就是First Input Fi
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美高森美發(fā)布領(lǐng)先的FPGA新產(chǎn)品概覽
- 1. 超安全SmartFusion2? SoC FPGA和 IGLOO2? FPGA 美高森美的超安全SmartFusion2? SoC FPGA和 IGLOO2? FPGA器件，無論在器件、設(shè)計和系統(tǒng)層次上的安全特性都比其他領(lǐng)先FPGA制造商更先進。新的數(shù)據(jù)安全特性現(xiàn)已成為美高森美主流SmartFusion2 SoC FPGA和 IGLOO2 FPGA器件的一部分，可讓開發(fā)人員充分利用器件本身所具有的同級別器件中的最低功耗,高可靠性和最佳安全技術(shù)，以期構(gòu)建高度差
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國際大廠找Mobile RAM貨源 敲開與臺廠合作大門
- 存儲器廠持續(xù)在eMCP(eMMC結(jié)合MCP封裝)領(lǐng)域擴大進擊，繼東芝(Toshiba)與南亞科洽談策略聯(lián)盟，新帝(SanDisk)亦傳出首度來臺尋找移動式存儲器Mobile RAM合作伙伴，考慮與南亞科簽定長約或包下產(chǎn)能，顯示國際存儲器大廠亟欲尋找Mobile RAM貨源，并敲開與臺廠合作大門。 半導體業(yè)者透露，在三星電子和SK海力士主導下，智能型手機內(nèi)建存儲器規(guī)格從eMMC轉(zhuǎn)為eMCP，原本NAND Flash芯片外加關(guān)鍵零組件Mobile RAM芯片，2015年東芝??新帝陣營將展開大反撲。
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NAND Flash價格續(xù)滑 難擺脫供給過剩困境
- 由于MLC(Multi-Level Cell)NAND Flash供應量持續(xù)增加，造成價格連續(xù)兩個月下滑，業(yè)界預期若三星電子(Samsung Electronics)等業(yè)者提高TLC(Triple-Level Cell)NAND Flash生產(chǎn)比重，后續(xù)MLC產(chǎn)品價格下滑情況恐將更明顯。 根據(jù)韓媒DigitalTimes報導，由于USB、硬碟與記憶卡市場進入淡季，加上庫存堆積，導致NAND Flash價格走滑，市場供給過剩情況恐持續(xù)到農(nóng)歷春節(jié)。業(yè)界認為目前NAND Flash下滑走勢雖大部分是受
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FPGA時序約束的6種方法
- 對自己的設(shè)計的實現(xiàn)方式越了解，對自己的設(shè)計的時序要求越了解，對目標器件的資源分布和結(jié)構(gòu)越了解，對EDA工具執(zhí)行約束的效果越了解，那么對設(shè)計的時序約束目標就會越清晰，相應地，設(shè)計的時序收斂過程就會更可控。 下文總結(jié)了幾種進行時序約束的方法。按照從易到難的順序排列如下： 0.核心頻率約束 這是最基本的，所以標號為0. 1.核心頻率約束+時序例外約束 時序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay.但這還不是最完整的時序約束
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從硬件角度討論FPGA開發(fā)框架
- FPGA采用了邏輯單元陣列概念，內(nèi)部包括可配置邏輯模塊、輸出輸入模塊和內(nèi)部連線三個部分。每一塊FPGA芯片都是由有限多個帶有可編程連接的預定義源組成來實現(xiàn)一種可重構(gòu)數(shù)字電路。 長久以來新型FPGA的功能和性能已經(jīng)為它們贏得系統(tǒng)中的核心位置，成為許多產(chǎn)品的主要數(shù)據(jù)處理引擎。 鑒于FPGA在如此多應用中的重要地位，采取正式且注重方法的開發(fā)流程來處理FPGA設(shè)計比以往更加重要。該流程旨在避免開發(fā)周期后期因發(fā)現(xiàn)設(shè)計缺陷而不得不進行費時費錢的設(shè)計修改，而且該缺陷還可能對項目進度計劃、成本和質(zhì)量造成災
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【從零開始走進FPGA】美好開始——我流啊流啊流
- 按照基于Windows的語言(C、C++、C#)等編程語言的初學入門教程，第一個歷程應該是“Hello World!”的例程。但由于硬件上的驅(qū)動難易程度，此例程將在在后續(xù)章程中推出。硬件工程師學習開發(fā)板的第一個例程：流水燈，一切美好的開始。 本章將會在設(shè)計代碼的同時，講解Quartus II 軟件的使用，后續(xù)章節(jié)中只講軟件的思想，以及解決方案，不再做過多的累贅描述。 一、Step By Step 建立第一個工程 (1)建立第一個工程，F(xiàn)ile-New-New
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基于FPGA的跨時鐘域信號處理——MCU
- 說到異步時鐘域的信號處理，想必是一個FPGA設(shè)計中很關(guān)鍵的技術(shù)，也是令很多工程師對FPGA望而卻步的原因。但是異步信號的處理真的有那么神秘嗎?那么就讓特權(quán)同學和你一起慢慢解開這些所謂的難點問題，不過請注意，今后的這些關(guān)于異步信號處理的文章里將會重點從工程實踐的角度出發(fā)，以一些特權(quán)同學遇到過的典型案例的設(shè)計為依托，從代碼的角度來剖析一些特權(quán)同學認為經(jīng)典的跨時鐘域信號處理的方式。這些文章都是即興而寫，可能不會做太多的分類或者歸納，也有一些特例，希望網(wǎng)友自己把握。 另外，關(guān)于異步時鐘域的話題，推薦大家
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跨越鴻溝：同步世界中的異步信號
- 只有最初級的邏輯電路才使用單一的時鐘。大多數(shù)與數(shù)據(jù)傳輸相關(guān)的應用都有與生俱來的挑戰(zhàn)，即跨越多個時鐘域的數(shù)據(jù)移動，例如磁盤控制器、CDROM/DVD 控制器、調(diào)制解調(diào)器、網(wǎng)卡以及網(wǎng)絡處理器等。當信號從一個時鐘域傳送到另一個時鐘域時，出現(xiàn)在新時鐘域的信號是異步信號。 在現(xiàn)代 IC、ASIC 以及 FPGA 設(shè)計中，許多軟件程序可以幫助工程師建立幾百萬門的電路，但這些程序都無法解決信號同步問題。設(shè)計者需要了解可靠的設(shè)計技巧，以減少電路在跨時鐘域通信時的故障風險。 基礎(chǔ) 從事多時鐘設(shè)計的第一
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零基礎(chǔ)學FPGA（十）初入江湖之i2c通信
- 相信學過單片機的同學對I2C總線都不陌生吧，今天我們來學習怎么用verilog語言來實現(xiàn)它，并在FPGA學習版上顯示。 i2c總線在近年來微電子通信控制領(lǐng)域廣泛采用的一種新型的總線標準，他是同步通信的一種特殊方式，具有接口少，控制簡單，器件封裝形式小，通信速率高等優(yōu)點。在主從通信中，可以有多個i2c總線器件同時接到i2c總線上，所有與i2c兼容的器件都有標準的接口，通過地址來識別通信對象，使他們可以經(jīng)由i2c總線互相直接通信。 i2c總線由兩條線控制，一條時鐘線SCL，一條數(shù)據(jù)線SDA，這
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智能醫(yī)療成風口 IC設(shè)計企業(yè)如何站位？
- 市場研究機構(gòu)ICInsights最新報告稱，中國IC設(shè)計企業(yè)在2014年全球前五十無晶圓廠IC供應商排行榜上占據(jù)9個席位。這9家廠商包括海思、展訊、大唐微、南瑞智芯、華大、中興、瑞芯微、銳迪科、全志。而2009年只有1家企業(yè)入圍，這表明中國無晶圓廠IC產(chǎn)業(yè)確實成長顯著。 然而，上述9家入圍企業(yè)中，有5家都聚焦于目前最熱門的智能手機市場。當然，這些年智能手機終端產(chǎn)業(yè)確實增長迅速，也為中國IC設(shè)計提供了發(fā)展空間和機遇。但我國擁有的是全球最大的信息消費市場，每年進口集成電路產(chǎn)品超過2000億美元，對I
- 關(guān)鍵字： 海思 展訊 FPGA
FPGA時序約束的6種方法
- 對自己的設(shè)計的實現(xiàn)方式越了解，對自己的設(shè)計的時序要求越了解，對目標器件的資源分布和結(jié)構(gòu)越了解，對EDA工具執(zhí)行約束的效果越了解，那么對設(shè)計的時序約束目標就會越清晰，相應地，設(shè)計的時序收斂過程就會更可控。 下文總結(jié)了幾種進行時序約束的方法。按照從易到難的順序排列如下： 0.核心頻率約束 這是最基本的，所以標號為0. 1.核心頻率約束+時序例外約束 時序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay.但這還不是最完整的時序約束
- 關(guān)鍵字： FPGA 時序約束
零基礎(chǔ)學FPGA（九）牛刀小試——串行口通信電路設(shè)計
- 以前在學單片機的時候，覺得串口通信其實很簡單，只要一個指令數(shù)據(jù)就能輕易的接收或者發(fā)送。前幾天試著用FPGA實現(xiàn)，發(fā)現(xiàn)里面的學問還不少，并沒有想象的那么簡單。當然代碼肯定是參考別人的，不過我還是認真研究了整段代碼的，下面的程序就是我在看懂了別人代碼后自己敲的，花了也不少時間，理解的也差不多，下面我就在這里給那些和我一樣的初學者介紹一下吧，解釋的不對的地方還望各位大神指正，大家好一起學習~ 1、頂層模塊 寫程序都一樣，不能多有的程序都寫在一個模塊里，那樣看起來很麻煩，出了錯誤也不好維護，對于一
- 關(guān)鍵字： FPGA 狀態(tài)機
【從零開始走進FPGA】路在何方——Verilog快速入門
- 一、關(guān)于HDL 1. HDL簡介 HDL ： Hardware Discription Language 硬件描述語言，即描述FPGA/CPLD內(nèi)部邏輯門的工作狀態(tài)，來實現(xiàn)一定電路。 隨著EDA技術(shù)的發(fā)展，使用硬件語言設(shè)計PLD/FPGA成為一種趨勢。目前硬件描述語言有VHDL、Verilog、Superlog、System C、Cynlib C++、C Level等。 各種語言有各種優(yōu)勢，根據(jù)業(yè)界應用而定。 2. VHDL和Verilog區(qū)別 在業(yè)界，VHDL和Veri
- 關(guān)鍵字： FPGA Verilog
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