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嵌入式系統(tǒng)聯(lián)誼會“FPGA在嵌入式系統(tǒng)中的應(yīng)用”主題討論會圓滿結(jié)束
- 隨著微電子技術(shù)和軟件技術(shù)的發(fā)展，嵌入式處理器、專用數(shù)字器件、外設(shè)和DSP算法正在以IP核的方式嵌入到FGPA中，以單芯片可編程FPGA完成整個嵌入式系統(tǒng)設(shè)計已成為現(xiàn)實。國際和國內(nèi)的眾多FPGA公司都具有這樣的芯片產(chǎn)品，并在通信、工業(yè)控制等領(lǐng)域具有廣泛的應(yīng)用。
- 關(guān)鍵字： 嵌入式系統(tǒng) FPGA SoC
基于FPGA的多功能數(shù)字鐘設(shè)計
- 文中簡要介紹了一種基于FPGA的多功能數(shù)字鐘設(shè)計方案。在實現(xiàn)數(shù)字鐘計時、校時和整點報時等基本功能的基礎(chǔ)上增加世界時鐘功能，能夠?qū)⒈本r間快速轉(zhuǎn)換為格林威治標準時。該方案采用VHDL和原理圖相結(jié)合的設(shè)計輸入方式，在QuartusⅡ開發(fā)環(huán)境下完成設(shè)計、編譯和仿真，并在FPGA硬件開發(fā)板上進行測試，實驗證明該設(shè)計方案切實可行，對FPGA的應(yīng)用和數(shù)字鐘的設(shè)計具有一定參考價值。
- 關(guān)鍵字： FPGA 多功能 數(shù)字鐘設(shè)計
基于FPGA的RBF神經(jīng)網(wǎng)絡(luò)的硬件實現(xiàn)
- 介紹了RBF神經(jīng)網(wǎng)絡(luò)，并采用CORDIC算法實現(xiàn)了其隱層非線性高斯函數(shù)的映射。同時，為縮減ROM表的存儲空間并提高查表效率，本設(shè)計還采用了基于STAM算法的非線性存儲。最后，以Altera公司開發(fā)的EDA工具QuarlusⅡ作為編譯、仿真平臺，采用Cyclone系列中的EP1C6Q 240C8器件，實現(xiàn)了RBF神經(jīng)網(wǎng)絡(luò)在FPGA上的實現(xiàn)，并以XOR問題為算例進行硬件仿真，得出仿真結(jié)果與理論值一致。
- 關(guān)鍵字： FPGA RBF 神經(jīng)網(wǎng)絡(luò) 硬件實現(xiàn)
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