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          <label id="pryje"></label>
          


          
	
  	
          
	
          
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          影響FPGA設計周期生產(chǎn)力的最大因素是什么？
          
                                                            
            
                    	
          • 影響FPGA設計周期生產(chǎn)力的最大因素是什么？-提高FPGA設計生產(chǎn)力的工具、技巧和方法，9影響FPGA設計周期生產(chǎn)力的最大因素是什么？
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          • 關(guān)鍵字：
                        FPGA  時序                          
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          FPGA學習的四大誤區(qū)
          
                                                            
            
                    	
          • FPGA學習的四大誤區(qū)-FPGA為什么是可以編程的？恐怕很多菜鳥不知道，他們也不想知道。因為他們覺得這是無關(guān)緊要的。他們潛意識的認為可編程嘛，肯定就是像寫軟件一樣啦。軟件編程的思想根深蒂固，看到Verilog或者VHDL就像看到C語言或者其它軟件編程語言一樣。
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          • 關(guān)鍵字：
                        FPGA  可編程邏輯                          
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          在FPGA開發(fā)中盡量避免全局復位的使用？（2）
          
                                                            
            
                    	
          • 在FPGA開發(fā)中盡量避免全局復位的使用？（2）-在Xilinx 的FPGA器件中，全局的復位/置位信號（Global Set/Reset (GSR)）（可以通過全局復位管腳引入）是幾乎絕對可靠的，因為它是芯片內(nèi)部的信號。
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          • 關(guān)鍵字：
                        FPGA                          
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          如何使用腳本對Xilinx FPGA編程
          
                                                            
            
                    	
          • 如何使用腳本對Xilinx FPGA編程-最近在做一個GUI的項目，想試著用FPGA實現(xiàn)一個簡單的GUI。硬件基本模塊和整個硬件系統(tǒng)已經(jīng)完成設計，但是軟件程序上還處在調(diào)試階段，由于程序比較大，F(xiàn)PGA內(nèi)部的BRAM已經(jīng)完全不夠用了，只能將運行的程序放到DDR DRAM中
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          • 關(guān)鍵字：
                        GUI  FPGA  Xilinx                          
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          FPGA全局時鐘和第二全局時鐘資源的使用方法
          
                                                            
            
                    	
          • FPGA全局時鐘和第二全局時鐘資源的使用方法-目前,大型設計一般推薦使用同步時序電路。同步時序電路基于時鐘觸發(fā)沿設計,對時鐘的周期、占空比、延時和抖動提出了更高的要求。為了滿足同步時序設計的要求,一般在FPGA設計中采用全局時鐘資源驅(qū)動設計的主時鐘,以達到最低的時鐘抖動和延遲。
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          • 關(guān)鍵字：
                        全局時鐘  FPGA  賽靈思                          
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          Verilog設計中的一些避免犯錯的小技巧
          
                                                            
            
                    	
          • Verilog設計中的一些避免犯錯的小技巧-這是一個在設計中常犯的錯誤列表，這些錯誤常使得你的設計不可靠或速度較慢，為了提高你的設計性能和提高速度的可靠性你必須確定你的設計通過所有的這些檢查。
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          • 關(guān)鍵字：
                        FPGA  Verilog                          
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          基于verilog的FPGA編程經(jīng)驗總結(jié)
          
                                                            
            
                    	
          • 基于verilog的FPGA編程經(jīng)驗總結(jié)-用了半個多月的ISE，幾乎全是自學起來的，碰到了很多很多讓人DT好久的小問題，百度也百不到，后來還是都解決了，為了盡量方便以后的剛學ISE的童鞋不再因為一些小問題而糾結(jié)，把這幾天的經(jīng)驗總結(jié)了一下。好了，廢話不多說，上料！
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          • 關(guān)鍵字：
                        verilog  FPGA                          
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          多核處理器會取代FPGA嗎？
          
                                                            
            
                    	
          • 多核處理器會取代FPGA嗎？-有人認為諸如圖形處理器（GPU）和Tilera處理器等多核處理器在某些應用中正逐步替代現(xiàn)場可編程門陳列（FPGA）。理由是這些多核處理器的處理性能要高很多，例如，由于GPU起初主要負責圖形繪制，因此，其尤其善于處理單精度（SP）及（某種情況下）雙精度（DP）浮點（FP）運算。
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          • 關(guān)鍵字：
                        FPGA  GPU  Tilera                          
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          7 50T 入門級FPGA評估套件上手評測
          
                                                            
            
                    	
          • 7 50T 入門級FPGA評估套件上手評測-FPGA即現(xiàn)場可編程門陣列，屬于可編程邏輯器件的一種。隨著工藝的進步和EDA設計工具的不斷發(fā)展，F(xiàn)PGA的門檻（學習成本和價格成本）也越來越低，目前已經(jīng)成為實現(xiàn)數(shù)字系統(tǒng)的主流平臺之一。
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          • 關(guān)鍵字：
                        FPGA  可編程邏輯  Xilinx                          
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          FPGA的快速入門經(jīng)驗談（part1）
          
                                                            
            
                    	
          • FPGA的快速入門經(jīng)驗談（part1）-有很多年輕人，被割裂了歷史，被荒廢了未來，迷茫， 迷茫到幾乎絕望，不過，他們還年輕，青春尚存，還有創(chuàng)造力，還有奮斗的資本，其中不乏不甘心被拋棄，被覆蓋之人。
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          • 關(guān)鍵字：
                        FPGA  單片機                          
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          FPGA開發(fā)技巧之同步復位與異步復位的理解
          
                                                            
            
                    	
          • FPGA開發(fā)技巧之同步復位與異步復位的理解-前兩天和師兄討論了一下design rule其中提到了同步異步復位的比較這個常見問題，據(jù)說也是IC公司經(jīng)常問到的一面試題。
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          • 關(guān)鍵字：
                        FPGA  同步復位  異步復位                          
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          詳細圖解在NetFPGA上創(chuàng)建一個OpenFlow Switch的網(wǎng)絡
          
                                                            
            
                    	
          • 詳細圖解在NetFPGA上創(chuàng)建一個OpenFlow Switch的網(wǎng)絡-Author: KiKiCompany：Digilent ChinaEmail : Date: 2012.02.14 目的 如 圖所示，我們會創(chuàng)建一個基于OpenFlow Switch的網(wǎng)絡。
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          • 關(guān)鍵字：
                        FPGA  NetFPGA                          
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          用FPGA實現(xiàn)MAC核所要完成的功能
          
                                                            
            
                    	
          • 用FPGA實現(xiàn)MAC核所要完成的功能-MAC發(fā)送模塊可將上層協(xié)議提供的數(shù)據(jù)封裝之后通過MII接口發(fā)送給PHY。
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          • 關(guān)鍵字：
                        FPGA  MAC  MII                          
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          FPGA verilog實現(xiàn)的1602時鐘計數(shù)器
          
                                                            
            
                    	
          • FPGA verilog實現(xiàn)的1602時鐘計數(shù)器-網(wǎng)上很少用人公開這一類代碼，一搜FPGA  1602，都是寫一個靜態(tài)的顯示，在實際應用中，是沒有用的，因此這個簡單的例子，給大家拋磚引玉了！
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          • 關(guān)鍵字：
                        FPGA  1602時鐘計數(shù)器                          
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          如何使用PlanAhead/Adept加速管腳排布
          
                                                            
            
                    	
          • 如何使用PlanAhead/Adept加速管腳排布-在排布FPGA管腳生成ucf文件的過程中，當FPGA管腳較多的時候，手工排布管腳不僅效率低，而且很容易出錯。借助PlanAhead和Adept等工具，可以很方便快速的實現(xiàn)管腳排布。
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          • 關(guān)鍵字：
                        PlanAhead  Adept  FPGA                          
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