fpga soc 文章進(jìn)入fpga soc技術(shù)社區(qū)

使用SoC FPGA進(jìn)行工業(yè)設(shè)計(jì)和電機(jī)控制

　　在工業(yè)系統(tǒng)中選擇器件需要考慮多個(gè)因素，其中包括：性能、工程變更的成本、上市時(shí)間、人員的技能、重用現(xiàn)有IP/程序庫的可能性、現(xiàn)場升級的成本，以及低功耗和低成本?！　」I(yè)市場的近期發(fā)展推動(dòng)了對具有高集成度、高性能、低功耗FPGA器件的需求。設(shè)計(jì)人員更喜歡網(wǎng)絡(luò)通信而不是點(diǎn)對點(diǎn)通信，這意味著可能需要額外的控制器用于通信，進(jìn)而間接增加了BOM成本、電路板尺寸和相關(guān)NRE(一次性工程費(fèi)用)成本?！　】傮w擁有成本用于分析和估計(jì)購置的壽命周期成本，它是所有與設(shè)計(jì)相關(guān)的直接和間接成本的擴(kuò)展集，包括工程技術(shù)成本、安裝和維
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基于FPGA的m序列信號發(fā)生器設(shè)計(jì)

　　m序列是一種偽隨機(jī)序列(PN碼)，廣泛用于數(shù)據(jù)白噪化、去白噪化、數(shù)據(jù)傳輸加密、解密等通信、控制領(lǐng)域?；贔PGA與Verilog硬件描述語言設(shè)計(jì)井實(shí)現(xiàn)了一種數(shù)據(jù)率按步進(jìn)可調(diào)、低數(shù)據(jù)誤碼率、反饋多項(xiàng)式為　　　　的m序列信號發(fā)生器。系統(tǒng)時(shí)鐘為20MHz，m序列信號發(fā)生器輸出的數(shù)據(jù)率為20～100 kbps，通過2個(gè)按鍵實(shí)現(xiàn)20 kbps步進(jìn)可調(diào)與系統(tǒng)復(fù)位，輸出誤碼率小于1%. 　　m序列是最長線性反饋移位寄存器序列的簡稱，它是由帶線性反饋的移位寄存器產(chǎn)生的周期最長的一種偽隨機(jī)
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反熔絲FPGA在密碼芯片設(shè)計(jì)中的運(yùn)用

　　詳細(xì)介紹了反熔絲FPGA在提高密碼芯片速度和對密碼算法進(jìn)行保護(hù)方面的應(yīng)用，并給出了密碼算法芯片中部分模塊的實(shí)現(xiàn)方法。　　1引言　　隨著計(jì)算機(jī)和通信的發(fā)展，信息傳輸過程中信息安全的重要性越來越受到人們的重視。在信息傳輸過程中，人們普遍采用將待傳輸?shù)男畔⒓用苓M(jìn)行傳輸，然后在收端進(jìn)行解密還原信息。對信息的加解密通常采用兩種方法：軟件加解密和硬件加解密。軟件加解密實(shí)現(xiàn)簡單，但須對密碼算法進(jìn)行多重保護(hù)存放且加解密速度較慢，而硬件加解密可加快加解密運(yùn)行速度。在當(dāng)今信息網(wǎng)絡(luò)化的環(huán)境下，對加密的速度要求將越來
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FLASH和反熔絲類型的FPGA你了解多少

　　由于航天應(yīng)用對可靠性提出了更高的要求，這是與一般的FPGA開發(fā)最大的不同。當(dāng)高能粒子撞擊可編程邏輯器件時(shí)，撞擊的能量會(huì)改變器件中的可配置的SRAM單元的配置數(shù)據(jù)，使系統(tǒng)運(yùn)行到無法預(yù)知的狀態(tài)，從而引起整個(gè)系統(tǒng)失效。這在航天設(shè)備中是必須要避免的。以FLASH和反熔絲技術(shù)為基礎(chǔ)的FPGA與以SRAM為基礎(chǔ)的FPGA相比，在抗單粒子事件方面具有很大的優(yōu)勢，可靠性高。　　ACTEL公司是可編程邏輯解決方案供應(yīng)商。它提供了多種服務(wù)，包括基于反熔絲和閃存技術(shù)的FPGA、高性能IP核、軟件開發(fā)工具和設(shè)計(jì)服務(wù)，定位
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Maxim Integrated推出面向Arduino平臺(tái)的Pmod?適配器，有效加速開發(fā)進(jìn)程

　　Maxim Integrated Products推出Pmod - Arduino適配器(MAXREFDES72#)，加速各種量產(chǎn)傳感器的原型開發(fā)。MAXREFDES72#可將任何連有Pmod的電路板方便地接入Arduino兼容微控制器平臺(tái)。該款適配器采用Maxim業(yè)內(nèi)領(lǐng)先的器件，能夠快速實(shí)現(xiàn)物聯(lián)網(wǎng)設(shè)計(jì)，并與更多的數(shù)字處理器和應(yīng)用方便對接。　　長期以來，Pmod模塊始終是將專業(yè)級外設(shè)整合到工程原型開發(fā)(尤其是FPGA平臺(tái))的保障。MAXREFDES72#實(shí)現(xiàn)了Pmod與Arduino兼容平臺(tái)之間的
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高度集成化SOC的需求漸長帶動(dòng)物聯(lián)網(wǎng)應(yīng)用升級

　　可穿戴設(shè)備是“功耗”說了算的移動(dòng)終端設(shè)備，而穿戴式OEM廠商也越來越追求效能更佳的整機(jī)產(chǎn)品，并開始導(dǎo)入兼具低功耗與高效能的MCU產(chǎn)品，這一需求直接推升高端MCU商機(jī)快速擴(kuò)大。全球各大MCU廠商正通過不斷更迭新品和解決方案的方式爭相競技。　　在產(chǎn)品形態(tài)上，可穿戴設(shè)備也分為智能手環(huán)、智能手表和智能眼鏡三類產(chǎn)品，并依據(jù)成本/功能劃分成“低、中、高”等不同級別，且不同級別的整機(jī)產(chǎn)品對MCU的要求也不盡相同。　　“智能手環(huán)需要功耗更低的MCU來
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Altera 2014年度技術(shù)巡展展示第10代最新產(chǎn)品和突破性技術(shù)

　　Altera®公司今天宣布，從2014年9月到11月，將在亞太地區(qū)中國、臺(tái)灣、韓國、新加坡、馬來西亞和印度的14個(gè)城市舉辦Altera 2014年度技術(shù)巡展——免費(fèi)的系列技術(shù)研討會(huì)。研討會(huì)將展示Altera最新的FPGA、SoC以及突破性技術(shù)。關(guān)于此次系列研討的詳細(xì)信息，或者需要注冊參加此次活動(dòng)，請?jiān)L問http://www.altera.com.cn/techroadshow2014。　　本年度技術(shù)巡展關(guān)注的主題是“Silicon Convergence
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后摩爾定律時(shí)代SoC該如何設(shè)計(jì)？

當(dāng)下SoC設(shè)計(jì)需要關(guān)注優(yōu)化芯片的初始設(shè)計(jì)，而不是寄希望于未來工藝節(jié)點(diǎn)縮小來滿足成本、性能和功耗目標(biāo)要求，而采用網(wǎng)絡(luò)芯片(NoC)互連IP可以同時(shí)提高產(chǎn)品質(zhì)量和生產(chǎn)率。
關(guān)鍵字：摩爾定律 SoC

Altera與百度展開合作在云數(shù)據(jù)中心使用FPGA加速

　　Altera公司與百度——中國最大的在線搜索引擎，在深度學(xué)習(xí)應(yīng)用中使用FPGA和卷積神經(jīng)網(wǎng)絡(luò)(CNN)算法上展開合作，這將對開發(fā)更準(zhǔn)確、更快的在線搜索功能起到關(guān)鍵作用。Altera將在2014年9月22號紐約舉行的華爾街大會(huì)高性能計(jì)算(HPC)上演示與百度展開的合作工作。　　Altera-百度展臺(tái)(#215B展位)展示了使用FPGA加速CNN能夠非常快速的實(shí)現(xiàn)圖像分類。對于圖像分類和識別任務(wù)等關(guān)鍵搜索功能，CNN被認(rèn)為是目前最新而且一直以來非常準(zhǔn)確的技術(shù)。百度采用了Alte
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英蓓特科技推出功能完善的SoC FPGA開發(fā)套件Lark Board

　　英蓓特科技日前宣布推出基于Altera Cyclone® V SoC的高性能開發(fā)板Lark Board。Lark Board專為大容量數(shù)據(jù)應(yīng)用的開發(fā)而設(shè)計(jì)，適用于汽車、醫(yī)療設(shè)備、視頻監(jiān)控和工業(yè)控制等領(lǐng)域。　　Altera大中華銷售總監(jiān)Jeff Li表示：“Lark Board的問世使開發(fā)人員能夠更加高效地利用Cyclone V SoC在架構(gòu)、密度和性能上的優(yōu)勢，這為他們進(jìn)行嵌入式系統(tǒng)設(shè)計(jì)開發(fā)提供了一個(gè)功能完整且強(qiáng)大的開發(fā)平臺(tái)。” 　　Lark Board采用5CS
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一種基于HD-SDI技術(shù)的高清圖像處理系統(tǒng)設(shè)計(jì)

　　摘要：隨著圖像處理技術(shù)及傳感器技術(shù)的不斷發(fā)展，高清數(shù)字圖像取代模擬圖像成為一種趨勢。設(shè)計(jì)了一種基于HD-SDI技術(shù)的高清圖像處理系統(tǒng)，可通過FPGA+DSP架構(gòu)對1080P全高清圖像進(jìn)行采集和字符疊加，并實(shí)時(shí)進(jìn)行目標(biāo)提取和偏差量計(jì)算。疊加視頻可通過DVI數(shù)字接口或模擬接口實(shí)時(shí)顯示。利用圖像高分辨率特性，系統(tǒng)可實(shí)現(xiàn)運(yùn)動(dòng)目標(biāo)精確跟蹤。　　引言　　隨著數(shù)字視頻的迅速發(fā)展，高清數(shù)字圖像代替模擬圖像成為必然趨勢。光電系統(tǒng)采用全高清圖像技術(shù)，不僅能大大提高顯示效果，而且能顯著提高系統(tǒng)的跟蹤精度。因此，高清
關(guān)鍵字： HD-SDI DSP FPGA

基于FPGA的高速訪問USB設(shè)備設(shè)計(jì)

　　摘要：針對FPGA訪問USB設(shè)備存在傳輸速率低、資源消耗大、開發(fā)復(fù)雜的缺點(diǎn)，提出了一種將ARM處理器與FPGA相結(jié)合實(shí)現(xiàn)高速訪問USB設(shè)備的方案。該方案利用ARM處理器的USB Host讀取USB設(shè)備數(shù)據(jù)井緩存于高速內(nèi)存，采用乒乓機(jī)制通過SRAM接口將數(shù)據(jù)傳給FPGA。經(jīng)測試，數(shù)據(jù)傳輸速率可以達(dá)到48 Mbps。該方案具有開發(fā)難度小，資源占用率低和傳輸速率高的特點(diǎn)，適合于FPGA高速讀取大量外部數(shù)據(jù)。　　引言　　目前FPGA通過USB接口獲取USB設(shè)備中數(shù)據(jù)的方案大致分為兩大類，一類為在FPG
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萊迪斯和賽普拉斯聯(lián)手推出新開發(fā)套件簡化USB 3.0視頻橋接器的設(shè)計(jì)

　　萊迪斯半導(dǎo)體公司和賽普拉斯半導(dǎo)體公司日前宣布，在Intel開發(fā)者大會(huì)(IDF)上推出一款具有完整參考設(shè)計(jì)的低成本開發(fā)套件，用于USB 3.0視頻橋接器的開發(fā)。全新萊迪斯USB 3.0視頻橋接器開發(fā)套件簡化了USB 3.0音頻和高清視頻的集成，可用于諸多應(yīng)用領(lǐng)域。該套件采用了萊迪斯的ECP3™ FPGA系列和賽普拉斯的EZ-USB® FX3™ USB 3.0外設(shè)控制器。　　USB 3.0的5 Gbps帶寬可順利傳輸高清視頻，而無需會(huì)降低圖像質(zhì)量的壓縮過程。萊迪斯USB
關(guān)鍵字：萊迪斯 USB 3.0 FPGA

Pico示波器在故障診斷中的應(yīng)用

　　當(dāng)今，工程師面臨著越來越嚴(yán)苛和復(fù)雜的測試任務(wù)。有時(shí)候設(shè)備在實(shí)驗(yàn)中能夠正常工作，但是在實(shí)際現(xiàn)場應(yīng)用時(shí)，就會(huì)出現(xiàn)這樣那樣的問題，從而導(dǎo)致設(shè)備無法正常運(yùn)行。一旦出現(xiàn)問題，一方面會(huì)引起客戶的不滿，一方面可能會(huì)造成生產(chǎn)損失，昂貴的維修費(fèi)用，甚至帶來安全隱患。每當(dāng)這個(gè)時(shí)候，客戶總是希望現(xiàn)場應(yīng)用工程師能夠快速準(zhǔn)確的進(jìn)行故障定位并維修以便于他們恢復(fù)生產(chǎn)，這就給故障診斷工程師帶來了巨大的挑戰(zhàn)。　　現(xiàn)場診斷時(shí)，工程師往往需要隨身攜帶一套小巧輕便、但功能強(qiáng)大的分析工具，捕捉波形異常，例如定時(shí)錯(cuò)誤、串?dāng)_、瞬態(tài)、電源質(zhì)量
關(guān)鍵字：示波器 PicoScope FPGA

ADAS方案轉(zhuǎn)向R-Car平臺(tái)，強(qiáng)化主動(dòng)式安全機(jī)制

　　自去年世強(qiáng)基于瑞薩圖像識別SoC SH7766的360度環(huán)視ADAS方案在市場廣受好評后——“此方案已經(jīng)在國內(nèi)一個(gè)領(lǐng)先的大巴車上得到批量使用。”世強(qiáng)高級市場經(jīng)理胡越強(qiáng)表示。術(shù)業(yè)有專攻，在今年的慕尼黑上海電子展上，世強(qiáng)基于瑞薩車載SoC——R-Car系列的新成員R-Car V2H的全新先進(jìn)駕駛輔助系統(tǒng)(ADAS)解決方案再度成為業(yè)內(nèi)人士關(guān)注的焦點(diǎn)。　　最尖端的車載SoC——R-Car H2 　　&quo
關(guān)鍵字： ADAS SoC R-Car