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基于FPGA的NCO設(shè)計(jì)方案
- 隨著數(shù)字通信技術(shù)的飛速發(fā)展，軟件無(wú)線電的應(yīng)用愈加的廣泛， 而影響軟件無(wú)線電性能的關(guān)鍵器件數(shù)控振蕩器NCO(Numerical CONtrolled Oscillator) 的設(shè)計(jì)至關(guān)重要直接數(shù)字頻率合成(DDS)技術(shù)是一種從相位概念出發(fā)直接合
- 關(guān)鍵字： FPGA NCO 設(shè)計(jì)方案
多節(jié)點(diǎn)大容量FPGA系統(tǒng)的遠(yuǎn)程升級(jí)方法
- 引言 多節(jié)點(diǎn)系統(tǒng)，在目前的很多電子系統(tǒng)應(yīng)用場(chǎng)合都可以看到。這種多節(jié)點(diǎn)系統(tǒng)由于具有結(jié)構(gòu)可擴(kuò)展性、功能配置的靈活性以及便于查找故障節(jié)點(diǎn)等良好的可維護(hù)性得到了越來(lái)越廣泛的應(yīng)用。通常，多節(jié)點(diǎn)系統(tǒng)各個(gè)節(jié)點(diǎn)的主
- 關(guān)鍵字： FPGA 節(jié)點(diǎn) 大容量 方法
裝入CPLD/FPGA的步進(jìn)電機(jī)運(yùn)動(dòng)控制器與驅(qū)動(dòng)器
- 本設(shè)計(jì)實(shí)例進(jìn)一步拓展了以前將步進(jìn)電機(jī)驅(qū)動(dòng)器集成到CPLD中的設(shè)計(jì)（參考文獻(xiàn)1）。本實(shí)例不僅集成了驅(qū)動(dòng)器，而且還集成了一個(gè)簡(jiǎn)單的單軸步進(jìn)電機(jī)運(yùn)動(dòng)控制器。根據(jù)CPLD大小，可以將多個(gè)運(yùn)動(dòng)控制器設(shè)計(jì)到單一設(shè)備中。例如
- 關(guān)鍵字： 控制器 驅(qū)動(dòng)器 運(yùn)動(dòng) 電機(jī) CPLD/FPGA 步進(jìn) 裝入
業(yè)界領(lǐng)袖Jeff Waters加入Altera
- Altera公司(NASDAQ: ALTR)今天宣布，在產(chǎn)品開(kāi)發(fā)、市場(chǎng)和全球部門(mén)管理方面引領(lǐng)業(yè)界20年的商業(yè)領(lǐng)袖Jeff Waters加入公司，成為資深副總裁兼軍事、工業(yè)和計(jì)算部門(mén)的總經(jīng)理。Waters及其團(tuán)隊(duì)負(fù)責(zé)這些領(lǐng)域的系統(tǒng)解決方案開(kāi)發(fā)和市場(chǎng)。他直接向Altera總裁、CEO兼董事會(huì)主席John Daane負(fù)責(zé)。
- 關(guān)鍵字： Altera SOC
2012年EDA產(chǎn)業(yè)趨勢(shì)預(yù)測(cè)
- 幾個(gè)星期前，我邀請(qǐng)部份EDA、IP和半導(dǎo)體公司的資深專家們預(yù)測(cè)2012年的產(chǎn)業(yè)趨勢(shì)和技術(shù)走向。我一共收到了來(lái)自11家公司的24項(xiàng)預(yù)測(cè)，在此，我對(duì)所有參與此次預(yù)測(cè)的技術(shù)專家和公關(guān)人員致上謝意。這些回收的預(yù)測(cè)結(jié)果可大概分類為：相關(guān)產(chǎn)業(yè)發(fā)展趨勢(shì);工具;ESL;IP和實(shí)體工具等幾大項(xiàng)。 以下，筆者歸納整理了部份來(lái)自業(yè)界對(duì)于2012年的EDA產(chǎn)業(yè)趨勢(shì)預(yù)測(cè)： ‘DIY’的EDA流程將在2012年起飛 當(dāng)Verific自2001年起開(kāi)始提供(System)Verilog和V
- 關(guān)鍵字： EDA SoC
利用FPGA解決TMS320C54K與SDRAM的接口問(wèn)題
- 在DSP應(yīng)用系統(tǒng)中，需要大量外擴(kuò)存儲(chǔ)器的情況經(jīng)常遇到。例如，在數(shù)碼相機(jī)和攝像機(jī)中，為了將現(xiàn)場(chǎng)拍攝的諸多圖...
- 關(guān)鍵字： FPGA TMS320C54K SDRAM
基于AXI總線的MicroBlaze雙核SoPC系統(tǒng)設(shè)計(jì)
- 目的是利用嵌入在Xilinx FPGA中的MicroBlaze核實(shí)現(xiàn)基于AXI總線的雙核嵌入式系統(tǒng)設(shè)計(jì)以及共享實(shí)現(xiàn)LED燈的時(shí)控。對(duì)于共享實(shí)現(xiàn)LED燈時(shí)控的方法是通過(guò)在兩個(gè)低速總線之間加入一個(gè)axi2axi_connector實(shí)現(xiàn)axilite總線上的slave共享。對(duì)于實(shí)現(xiàn)雙核之間的通信主要方法是利用mailbox和mutex完成核間通信。硬件平臺(tái)采用的是Xilinx FPGA Spartan -6 Atlys板，軟件平臺(tái)是Xilinx EDK，主要使用的是XPS(硬件設(shè)計(jì))和SDK(軟件設(shè)計(jì))，開(kāi)發(fā)出
- 關(guān)鍵字： Xilinx FPGA AXI 201201
基于FPGA技術(shù)的智能導(dǎo)盲犬方案設(shè)計(jì)
- 基于FPGA技術(shù)的智能導(dǎo)盲犬方案設(shè)計(jì),眾所周知眼晴是“心靈之窗”，而對(duì)于突然失去或從未擁有過(guò)“心靈之窗”的盲人來(lái)說(shuō)，生活上的困難與心理上的痛苦是可想而知的。他們的衣食住行存在諸多不便，而在出行與人際交往中遇到的困難更加
- 關(guān)鍵字： 方案設(shè)計(jì) 智能 技術(shù) FPGA 基于
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