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基于FPGA的超聲診斷儀動(dòng)態(tài)濾波器的設(shè)計(jì)
- 采用FPGA的模擬動(dòng)態(tài)濾波器，在結(jié)構(gòu)上簡(jiǎn)易，性能上穩(wěn)定，測(cè)試和設(shè)計(jì)都十分的方便。FPGA的使用，能根據(jù)具體要求很方便的改變控制信號(hào)，同時(shí)實(shí)現(xiàn)超聲診斷儀中多個(gè)模塊并行工作，也為以后的更多模擬部分?jǐn)?shù)字化提供了基礎(chǔ)。
- 關(guān)鍵字： FPGA 超聲診斷儀 動(dòng)態(tài) 濾波器
臺(tái)積電與GLOBALFOUNDRIES將面臨首次對(duì)決
- 2011年1月1日，東芝實(shí)施了系統(tǒng)LSI業(yè)務(wù)重組。其關(guān)鍵措施是，將部分40nm工藝SoC(System On A Chip)及32/28nm工藝以后的SoC生產(chǎn)，委托給包括韓國(guó)三星電子(Samsung Electronics)在內(nèi)的數(shù)家芯片代工(Foundry)企業(yè)。一直在生產(chǎn)微處理器“Cell”及圖形LSI“RSX”等系統(tǒng)LSI產(chǎn)品的長(zhǎng)崎工廠，生產(chǎn)設(shè)備將轉(zhuǎn)讓給索尼。此意味著東芝將撤出Cell的自行生產(chǎn)業(yè)務(wù)?！?/li>
- 關(guān)鍵字： 臺(tái)積電 SoC
基于FPGA+ DSP的實(shí)時(shí)圖像處理系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)
- 基于FPGA+ DSP的實(shí)時(shí)圖像處理系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn),摘 要: 針對(duì)圖像處理系統(tǒng)計(jì)算量大、實(shí)時(shí)性高和體積小的要求， 研制了一種以DSP為主處理器FPGA 為輔處理器的高性能實(shí)時(shí)圖像處理系統(tǒng)。利用這兩種芯片的各自特點(diǎn)， 將算法分成兩部分分別交由FPGA 和DSP處理， 大大提高
- 關(guān)鍵字： FPGA，DSP
基于FPGA的8085A CPU結(jié)構(gòu)分析與實(shí)現(xiàn)
- 1 引 言
微型計(jì)算機(jī)原理幾乎是所有理工科類(lèi)大學(xué)生的必修課目之一， 其重要性不言而喻。然而大多數(shù)教學(xué)側(cè)重于應(yīng)用方面， 對(duì)計(jì)算機(jī)的結(jié)構(gòu)及工作原理涉之不深， 因?yàn)闊o(wú)法做一個(gè)CPU 來(lái)演示。這樣學(xué)生不能真正了解 - 關(guān)鍵字： 8085A FPGA CPU 結(jié)構(gòu)分析
基于邏輯分析內(nèi)核的FPGA電路內(nèi)調(diào)試技術(shù)
- 隨著FPGA融入越來(lái)越多的能力，對(duì)有效調(diào)試工具的需求將變得至關(guān)重要。對(duì)內(nèi)部可視能力的事前周密計(jì)劃將能使研制組采用正確的調(diào)試戰(zhàn)略，以更快完成他們的設(shè)計(jì)任務(wù)。
“我知道我的設(shè)計(jì)中存在一個(gè)問(wèn)題，但我沒(méi)有很 - 關(guān)鍵字： FPGA 邏輯分析 電路 調(diào)試技術(shù)
Cadence為復(fù)雜的FPGA/ASIC設(shè)計(jì)提高驗(yàn)證效率
- 全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司,今天宣布在幫助ASIC與FPGA設(shè)計(jì)者們提高驗(yàn)證效率方面取得最新重大進(jìn)展。加上對(duì)最新Accellera Universal Verification Methodology (UVM) 1.0業(yè)界標(biāo)準(zhǔn)的全面支持，600多種新功能擴(kuò)展了指標(biāo)驅(qū)動(dòng)型驗(yàn)證(MDV)的范圍，幫助工程師實(shí)現(xiàn)更快、更全面的驗(yàn)證閉合與硅實(shí)現(xiàn)。
- 關(guān)鍵字： Cadence FPGA
高階累積量調(diào)制識(shí)別改進(jìn)算法的FPGA實(shí)現(xiàn)
- 摘要：基于高階累積量的數(shù)字調(diào)制信號(hào)識(shí)別算法在低信噪比環(huán)境下識(shí)別率較低。針對(duì)這一問(wèn)題，提出了高階累積量的改進(jìn)算法，通過(guò)調(diào)整特征參數(shù)的判別順序先識(shí)別出MASK信號(hào)的方式，取得了較好的效果。討論了該算法的FPGA設(shè)
- 關(guān)鍵字： FPGA 高階累積量 調(diào)制識(shí)別 改進(jìn)算法
利用LabVIEW和CompactRIO開(kāi)發(fā)慣性檢管器
- 挑戰(zhàn):尋找石油或者天然氣管道的參考位置，并確?？臻g誤差小于1米解決方案:通過(guò)使用LabVIE...
- 關(guān)鍵字： FPGA LabVIEW CompactRIO 慣性檢管器
采用WDM的精確定時(shí)器及其在冗余技術(shù)中的應(yīng)用
- 采用WDM的精確定時(shí)器及其在冗余技術(shù)中的應(yīng)用,提出一種設(shè)備冗余的系統(tǒng)設(shè)計(jì)方法， 為系統(tǒng)的故障檢測(cè)和切換技術(shù)提供了一種解決方案。利用此方法設(shè)計(jì)了雙冗余CAN 總線(xiàn)板卡以及在Window s XP 系統(tǒng)下的WDM 驅(qū)動(dòng)。該模塊工作穩(wěn)定， 數(shù)據(jù)傳輸可靠， 冗余切換切實(shí)可行。并可依據(jù)實(shí)際使用要求在線(xiàn)修改定時(shí)查詢(xún)時(shí)間。這種冗余實(shí)現(xiàn)方法在提高設(shè)備可靠性方面具有一定的實(shí)用價(jià)值。
- 關(guān)鍵字： FPGA
原昶科技量產(chǎn)世界第一顆USB 3.0影音傳輸SoC芯片
- 由智原科技百分之百轉(zhuǎn)投資的原昶科技 (Evolution Technology Corporation) 于近日正式量產(chǎn)世界第一顆 USB 3.0 影音傳輸 SoC 芯片 (Audio/Video over USB 3.0 SoC chip) ET12U32X，該系列芯片于 2010 年 9 月的 USB-IF Workshop 插拔測(cè)試中通過(guò) USB-IF 協(xié)會(huì)所有測(cè)試項(xiàng)目，正式取得 USB-IF 的 USB 3.0 Device Logo 認(rèn)證。 著眼于 USB 3.0 高速傳輸、高電力供應(yīng)
- 關(guān)鍵字： 原昶科技 SoC
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