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利用SoC單片機的多功能數(shù)據(jù)采集卡
- 摘 要：本文介紹了一種SoC單片機控制的多功能數(shù)據(jù)采集卡，在輸入通道中增加程控濾波、程控增益放大器和多級陷波電路，采集卡的功能選擇和參數(shù)改變均由SoC單片機軟件控制。本文給出了關鍵部分的電路圖、元件參數(shù)和實測數(shù)據(jù)。關鍵詞：SoC 單片機；程控放大；程控陷波 引言目前大多數(shù)的數(shù)據(jù)采集卡并不能適應工業(yè)控制現(xiàn)場或像野外那樣存在多種噪聲干擾的使用環(huán)境，特別是對50Hz工頻干擾及其諧波干擾無法起到抑制作用。在這種情況下，采集到的數(shù)據(jù)往往有很多錯誤或者采集卡無法正常工作。本數(shù)據(jù)采
- 關鍵字： SoC 單片機 程控放大 程控陷波 SoC ASIC
DSP和FPGA在圖像傳輸系統(tǒng)中的應用和實現(xiàn)
- 摘 要：本文重點介紹基于DSP和FPGA、采用中頻數(shù)字化方法，以及QPSK擴頻調制技術來實現(xiàn)圖像的無線傳輸。對擴頻通信系統(tǒng)的同步問題提出了一種實現(xiàn)方法，并給出了部分實驗結果。關鍵詞：圖像傳輸；擴頻通信；同步；FPGA；DSP 視頻通信是目前計算機和通信領域的一個熱點。而無線擴頻與有線相比,有其固有的優(yōu)越性，如聯(lián)網(wǎng)方便、費用低廉等。所以開發(fā)無線擴頻實時圖像傳輸系統(tǒng)有很高的實用價值。 系統(tǒng)設計在短距離通信中，通?？梢栽谑瞻l(fā)端加入奇偶校驗、累加和校驗等出錯重發(fā)的防噪聲措施
- 關鍵字： DSP FPGA 擴頻通信 同步 圖像傳輸
基于C*SoC200的32位稅控機專用系統(tǒng)芯片設計
- 摘 要：本文首先介紹了一個32位嵌入式稅控機專用系統(tǒng)芯片C3118的功能、結構和特點，然后分析了一個自動化程度很高的SoC設計平臺——C*SoC200，對該平臺的主要結構和功能進行了分析。關鍵詞：IP；SoC；平臺；仿真 引言2003年7月，中國國家質量監(jiān)督檢驗檢疫總局發(fā)布了由稅控機國家標準制定委員會制定的稅控收款機國家標準。并將陸續(xù)出臺一系列的管理法規(guī)。為了滿足國家標準的要求，各稅控機生產(chǎn)廠家都在積極使用32位MCU開發(fā)符合新規(guī)范的稅控機。而32位的嵌入式稅控機專用
- 關鍵字： IP SoC 仿真 平臺 SoC ASIC
可重定位的基于事務的系統(tǒng)級驗證
- 功能驗證已經(jīng)成為開發(fā)SoC的主要問題。隨著一些復雜SoC的規(guī)模超過兩千萬門，以及對開發(fā)和集成嵌入式軟件的需求持續(xù)增加，軟件模擬器已經(jīng)力所不及。在設計過程需要幾百萬個時鐘周期來充分測試和驗證軟件功能的情況下，軟件仿真器的性能下降到1-5Hz。按照這種速率，軟件調試需要幾年的時間。如果設計項目組不能夠投入這么多的時間，則意味著SoC芯片制造出來之后，在加電后的幾秒內(nèi)就會出現(xiàn)錯誤。基于事務的驗證允許代表單個或者多個時鐘周期的大量數(shù)據(jù)不經(jīng)多次調用而直接進入模擬器，極大地提高了模擬性能。到目前為止，驗證環(huán)境都是基于
- 關鍵字： SoC
合理選擇SoC架構
- 找到價格、性能和功耗的最佳結合點實際上就確保贏得了SoC設計，但說起來容易做起來難。在實際可用的雙芯核架構、可編程加速器和數(shù)百萬門FPGA出現(xiàn)以前，一種80:20法則用起來很奏效：如果計算負荷的80%為數(shù)據(jù)處理，那么選擇RISC架構，在RISC中實施信號處理。而當今面臨太多的架構選擇，差別甚微，用單一處理器架構來解決優(yōu)化問題已不可能。一種較為成功的方法是通過將計算資源與特性集匹配來實現(xiàn)。將一種復雜系統(tǒng)映射到硅中，在相當程度上依賴于設計是在現(xiàn)有SoC上實現(xiàn)還是從頭做起。對于前一種情況，系統(tǒng)設計師應從了解四個
- 關鍵字： TI SoC ASIC
可配置系統(tǒng)級驗證環(huán)境加速SoC開發(fā)
- 利用嵌入式硅IP可以縮短SoC設計所需的開發(fā)時間，這已成為眾所公認的事實。但要從完工后的整個系統(tǒng)角度出發(fā)，整合及驗證來自多家廠商的元件，需要相當?shù)臅r間和努力，然而它們卻常被忽略。這會對嵌入式軟件開發(fā)人員造成額外負擔，因為他們需要SoC的外圍和接口以及處理器的精確模型，才能在設計投片之前，針對正在開發(fā)的SoC，迅速完成應用固件的測試及除錯。如果SoC平臺以可配置處理器和外圍IP為基礎，這些IP又來自多家供貨商，這種情形就更加重要，因為設計人員必須確認在特定配置下，每個元件的功能不會影響到其它元件的工作。除此
- 關鍵字： ARC SoC ASIC
256級灰度LED點陣屏顯示原理及基于FPGA的電路設計
- 摘 要：本文提出了一種LED點陣屏實現(xiàn)256級灰度顯示的新方法。詳細分析了其工作原理。并依據(jù)其原理，設計出了基于FPGA 的控制電路。關鍵詞：256級灰度；LED點陣屏；FPGA；電路設計 引言256級灰度LED點陣屏在很多領域越來越顯示出其廣闊的應用前景，本文提出一種新的控制方式，即逐位分時控制方式。隨著大規(guī)?？删幊踢壿嬈骷某霈F(xiàn)，由純硬件完成的高速、復雜控制成為可能。 逐位分時點亮工作原理所謂逐位分時點亮，即從一個字節(jié)數(shù)據(jù)中依次提取出一位數(shù)據(jù)，分8次點亮對應的像
- 關鍵字： 256級灰度 FPGA LED點陣屏 電路設計 發(fā)光二極管 LED
基于AD9430的數(shù)據(jù)采集系統(tǒng)設計
- 摘 要：本文介紹了高速ADC AD9430的功能，詳細說明了使用高速FPGA來控制AD9430構成高速(140MSPS)、高精度(12位)數(shù)據(jù)采集系統(tǒng)的設計方法，并給出了具體實現(xiàn)的系統(tǒng)框圖和測試結果。關鍵詞：數(shù)據(jù)采集；FPGA；AD9430引言結合實際任務的要求，本文提出了一種基于AD9430的高速數(shù)據(jù)采集系統(tǒng)，主要用于采集雷達回波。在這個系統(tǒng)中，選用高速邏輯器件控制A/D轉換和FIFO存儲，同時通過FPDP(Front Panel Data Port)總線將采集的數(shù)據(jù)發(fā)送出去。由
- 關鍵字： AD9430 FPGA 數(shù)據(jù)采集
基于FPGA的非對稱同步FIFO設計
- 摘 要：本文在分析了非對稱同步FIFO的結構特點及其設計難點的基礎上，采用VHDL描述語言，并結合FPGA，實現(xiàn)了一種非對稱同步FIFO的設計。關鍵詞：非對稱同步FIFO；VHDL；FPGA；DLL；BlockRAM引言FIFO是一種常用于數(shù)據(jù)緩存的電路器件，可應用于包括高速數(shù)據(jù)采集、多處理器接口和通信中的高速緩沖等各種領域。然而在某些應用，例如在某數(shù)據(jù)采集和處理系統(tǒng)中，需要通過同步FIFO來連接8位A/D和16位數(shù)據(jù)總線的MCU，但是由于目前同步FIFO器件的輸入與輸
- 關鍵字： BlockRAM DLL FPGA VHDL 非對稱同步FIFO 存儲器
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