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基于FPGA的圖像實時處理系統(tǒng)設計
- 由于現(xiàn)場實時測量的需要，機器視覺技術越來越多地借助硬件來完成，如DSP芯片、專用圖像信號處理卡等。但是，DSP做圖像處理也面臨著由于數(shù)據(jù)存儲與處理量大，導致處理速度較慢，系統(tǒng)實時性較差的問題。本文將FPGA的IP核內(nèi)置緩存模塊和乒乓讀寫結構相結合，實現(xiàn)了圖像數(shù)據(jù)的緩存與提取，節(jié)省了存儲芯片所占用的片上空間，并且利用圖像預處理重復率高，但算法相對簡單的特點和FPGA數(shù)據(jù)并行處理，結合流水線的結構，大大縮短了圖像預處理的時間，解決了圖像處理實時性差的問題。 1系統(tǒng)架構和流程簡介 本系統(tǒng)采用了F
- 關鍵字： FPGA DSP
基于FPGA 的太陽能并網(wǎng)逆變器的研究
- 系統(tǒng)概述 新能源發(fā)電成為21世紀解決能源危機的必經(jīng)出路，光伏發(fā)電、風電、核電等新能源發(fā)電是目前新能源發(fā)電研究的幾大方向。這幾種新能源各有各的特點，我們選擇了最靠近我們的光伏發(fā)電作為研究出發(fā)點。 目前光伏發(fā)電并網(wǎng)技術的研究愈加深入成熟，而關于光伏發(fā)電技術的具體應用環(huán)節(jié)還是有著許多發(fā)揮余地。光伏發(fā)電的優(yōu)點是清潔安全、分布相對較為均勻、可持續(xù)利用。同時光伏發(fā)電也存在自己的問題，其中一個很重要的問題是光伏發(fā)電需要做的是收集輻射到地表的太陽能，這個環(huán)節(jié)需要占用大量的空間，這個問題使光伏發(fā)電的應用有著
- 關鍵字： FPGA 逆變器
ARM吳雄昂：物聯(lián)網(wǎng)需要開放的生態(tài)系統(tǒng)
- 在物聯(lián)網(wǎng)、智能硬件、可穿戴設備概念盛行的當下，產(chǎn)業(yè)鏈上游的半導體界也在風口挺進新技術的生態(tài)布局。 6月初，Intel宣布以167億美元重金收購可編輯邏輯芯片公司Altera，增強其數(shù)據(jù)中心和物聯(lián)網(wǎng)業(yè)務; 5月28日，Avago Technologies以370億美元收購wifi芯片供應商Broadcom，亦有意進軍物聯(lián)網(wǎng)和可穿戴設備。 不難發(fā)現(xiàn)，在物聯(lián)網(wǎng)和服務器領域，各種布局正拉開序幕。去年，ARM宣布推出mbed物聯(lián)網(wǎng)設備平臺，同年，英特爾也推出了英特爾物聯(lián)網(wǎng)平臺，兩者的目的都是為用戶提
- 關鍵字： ARM 物聯(lián)網(wǎng)
混合信號IC──復雜電源管理組件的設計挑戰(zhàn)及解決方案
- 隨著系統(tǒng)內(nèi)電源數(shù)量的增多，為了確保其安全、經(jīng)濟、持續(xù)和正常的工作，對電源軌進行監(jiān)測和控制變得非常重要，特別是在使用微處理器時。確定電壓軌是否處于工作范圍內(nèi)，以及該電壓相對于其它電壓軌是否按照正確的時序上電或斷電，這些對于系統(tǒng)執(zhí)行的可靠性和安全性來說都是至關重要的。例如FPGA，在向組件提供5V I/O(輸入/輸出)電壓之前，必須先施加3.3V的核心電壓，并持續(xù)至少20ms，以避免組件上電時受到損壞。對于系統(tǒng)的可靠性來說，滿足這樣的時序要求就像要保證組件在規(guī)定的電源電壓和溫度范圍內(nèi)工作一樣至關重要。
- 關鍵字： FPGA DSP
混合信號FPGA實現(xiàn)真正單芯片SOC
- 要實現(xiàn)能夠將所有重要功能集成在單一器件的設計理由很簡單，因為這樣就能將材料成本、部件庫存及電路板面積減至最低。另外，相較于多芯片解決方案，單芯片方案的功耗也較低，同時也有助于提高對知識產(chǎn)權的保護。如果一項設計功能的精髓能夠深植于單一芯片上，將會大大增加第三方取得這項設計的困難度。 單芯片系統(tǒng)對嵌入式系統(tǒng)設計師來說，往往會隨著其面對的不同的系統(tǒng)設計而各有不同。例如，在龐大的娛樂或通信消費產(chǎn)品市場中，SoC意味著一顆具有數(shù)百萬邏輯門的集成電路(IC)，其中包含許多大型定制邏輯模塊，并有將芯片的數(shù)字處
- 關鍵字： FPGA SOC
Mentor Graphics 宣布推出旨在提升測試平臺效率的 EZ-VIP 包
- Mentor Graphics公司今天宣布即時推出 EZ-VIP 效率包。該效率包面向使用 Questa® Verification IP (QVIP) 的 ASIC 和 FPGA 驗證團隊，可將創(chuàng)建、實例化、配置和連接 QVIP 測試平臺的時間縮短 5 倍以上，從而顯著提高效率。這就意味著，驗證團隊可以將更多的時間花在 QVIP 上，以驗證他們的設計在功能上是否正確。 EZ-VIP 包由 QVIP 配置軟件、一個 VIP 調(diào)通服務包和一個全新的 EZ-VIP API 組成。其中，QVI
- 關鍵字： Mentor Graphics FPGA
超低功耗STM32L4 MCU詮釋性價比新極限
- 32位MCU已經(jīng)成為市場的主流，特別是部分32位MCU的功耗已經(jīng)降到和8位MCU接近的地步，更加速了對8位MCU的替代步伐。不過，鑒于市場上絕大多數(shù)低功耗32位MCU都是基于ARM Cortex-M0(+)內(nèi)核，所以功耗是降下來了了，但性能上還達不到主流32位的性能。為此意法半導體近日發(fā)布了基于ARM® Cortex®-M4內(nèi)核的低功耗STM32L4系列微控制器，以接近STM32L0系列的功耗水平，提供M4內(nèi)核的高性能，非常適合節(jié)能型消費電子產(chǎn)品、工業(yè)、醫(yī)學和計量產(chǎn)品的需求。 兩
- 關鍵字： ARM STM32L4
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