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          英特爾比亞迪開(kāi)始合作:將與ARM激戰(zhàn)到底

          •   目前英特爾在積極和終端OEM廠商接觸,希望在2013年拉攏更多的廠商推出產(chǎn)品,目標(biāo)是鎖定更大的合作伙伴。另外,英特爾也開(kāi)始和比亞迪合作做參考設(shè)計(jì)方案,這樣可以幫助終端廠商更快把產(chǎn)品推向市場(chǎng)。   英特爾必須加快轉(zhuǎn)型步伐了。   當(dāng)所有人都在談?wù)揚(yáng)C式微,未來(lái)是屬于移動(dòng)的時(shí)候,英特爾僅僅靠重構(gòu)PC顯然已經(jīng)不能趕上時(shí)代的需求,它必須跳入移動(dòng)的浪潮中。   “(在移動(dòng)市場(chǎng))我們是新進(jìn)入者,同時(shí)我們也是一個(gè)有備而來(lái)的挑戰(zhàn)者?!?月12日,英特爾產(chǎn)品架構(gòu)事業(yè)部副總裁陳榮坤接受本報(bào)專
          • 關(guān)鍵字: ARM  手機(jī)芯片  

          基于Xilinx FPGA的部分動(dòng)態(tài)可重構(gòu)技術(shù)的信號(hào)解調(diào)系

          • 隨著現(xiàn)代通信技術(shù)的迅速發(fā)展,信號(hào)的調(diào)制方式向多樣化發(fā)展,解淵技術(shù)也隨之不斷向前發(fā)展。為了對(duì)高速大帶寬的信號(hào)進(jìn)行實(shí)時(shí)解調(diào),現(xiàn)在很多的解調(diào)關(guān)鍵算法都是在高速硬件上用可編程邏輯器件(FPGA)實(shí)觀,利用FPGA強(qiáng)大的
          • 關(guān)鍵字: Xilinx  FPGA  部分動(dòng)態(tài)可重構(gòu)  信號(hào)解調(diào)系統(tǒng)    

          一種34位串行編碼方法的設(shè)計(jì)及其FPGA實(shí)現(xiàn)

          • 新型艦艇或航空系統(tǒng)中所裝電子設(shè)備數(shù)量較多,布局緊湊,易造成系統(tǒng)內(nèi)部電磁干擾,普通數(shù)字信號(hào)不能夠滿足可靠傳輸?shù)囊?,?duì)普通串行碼進(jìn)行調(diào)制后傳輸信息,可使信號(hào)的抗干擾性能大大增加。RS232、RS422、RS485以及A
          • 關(guān)鍵字: FPGA  串行  編碼  方法    

          Altera展示業(yè)界第一款QPI 1.1 FPGA本地代理

          •   Altera公司在業(yè)界首次展示Intel QuickPath互聯(lián)(QPI)協(xié)議1.1支持的FPGA本地代理(Home Agent)。與Intel的Sandy Bridge XEON處理器相連接,這一演示在Pactron Vigor開(kāi)發(fā)平臺(tái)上采用了Altera® Stratix® V FPGA,它被配置為本地代理,并同時(shí)支持高速緩存代理(Caching Agent)和本地代理。這一解決方案非常適合低延時(shí)信號(hào)處理、數(shù)據(jù)包處理和嵌入式應(yīng)用設(shè)計(jì),例如,高頻度交易和大數(shù)據(jù),與傳統(tǒng)CPU配置相比,
          • 關(guān)鍵字: Altera  FPGA  Pactron Vigor  

          Altera展示業(yè)界首款20nm制程的32-Gbps收發(fā)器

          • Altera展出了業(yè)界首款具有32-Gbps收發(fā)器功能的可編程器件,在收發(fā)器技術(shù)上樹(shù)立了另一關(guān)鍵里程碑。此次展示使用了基于TSMC 20SoC工藝技術(shù)的20 nm器件,該成果證實(shí)了20nm硅片的性能,同時(shí)也向500多位Altera早期使用計(jì)劃的客戶提供了積極的進(jìn)度標(biāo)志——這些客戶正期待著在其高性能需求、以帶寬為中心的應(yīng)用開(kāi)發(fā)中使用下一代Altera器件。
          • 關(guān)鍵字: Altera  FPGA  收發(fā)器  

          基于ISE設(shè)計(jì)提供低功耗FPGA解決方案

          • 從Xilinx公司推出FPGA二十多年來(lái),研發(fā)工作大大提高了FPGA的速度和面積效率,縮小了FPGA與ASIC之間的差距,使FPGA成為實(shí)現(xiàn)數(shù)字電路的優(yōu)選平臺(tái)。今天,功耗日益成為FPGA供應(yīng)商及其客戶關(guān)注的問(wèn)題。降低FPGA功耗是降低
          • 關(guān)鍵字: FPGA  ISE  低功耗  方案    

          基于FPGA的雙備份多路數(shù)據(jù)采集存儲(chǔ)系統(tǒng)的設(shè)計(jì)與實(shí)

          • 隨著信息技術(shù)的發(fā)展以及數(shù)字集成電路速度的提高,實(shí)時(shí)處理大量數(shù)據(jù)已經(jīng)成為現(xiàn)實(shí),但在一些特殊條件下,無(wú)法實(shí)時(shí)傳輸數(shù)據(jù),必須使用存儲(chǔ)測(cè)試方法。該方法是在不影響被測(cè)對(duì)象或在允許的范圍下,將微型存儲(chǔ)測(cè)試系統(tǒng)置入
          • 關(guān)鍵字: FPGA  備份  多路數(shù)據(jù)采集  存儲(chǔ)系統(tǒng)    

          ARM單片機(jī),你知多少?

          • 目前大量的中、低端嵌入式應(yīng)用,主要使用8/16位單片機(jī)。在國(guó)內(nèi),由于歷史的原因,主要是以MCS51核為主的許多不同 ...
          • 關(guān)鍵字: ARM  單片機(jī)  ARM核  

          A57處理器即將量產(chǎn) 同等功耗下性能提升三倍

          • 4月5日消息,ARM于去年年底對(duì)外宣布將于2014年推出兩款64位Cortex-A50系列處理器——Cortex-A57和Cortex A53。而近日根據(jù)國(guó)外媒體的報(bào)道,臺(tái)積電首款Cortex-A57處理器已經(jīng)完成“設(shè)計(jì)定案”,下一步便會(huì)大規(guī)模投產(chǎn)。看來(lái)我們用不著等到2014年便可以看到64位ARM處理器的身影了。 ? ? Exynos 5 Octa八核處理器剛剛在Galaxy S4上現(xiàn)身不久,而近日就傳出Cortex-A57即
          • 關(guān)鍵字: ARM  處理器  

          ARM與臺(tái)積電達(dá)成FinFET技術(shù)合作里程碑

          •   ARM 與晶圓代工大廠臺(tái)積電(TSMC)共同宣布,完成首件采用 FinFET 制程技術(shù)生產(chǎn)的 ARM Cortex-A57 處理器產(chǎn)品設(shè)計(jì)定案(tape-out)。Cortex-A57 處理器為能進(jìn)一步提升未來(lái)行動(dòng)與企業(yè)運(yùn)算產(chǎn)品的效能,包括高階電腦、平板電腦與伺服器等具備高度運(yùn)算應(yīng)用的產(chǎn)品,此次合作展現(xiàn)了雙方在臺(tái)積公司FinFET制程技術(shù)上,共同優(yōu)化64位元ARMv8處理器系列產(chǎn)品所締造的全新里程碑。   藉由 ARM Artisan 實(shí)體IP、臺(tái)積電記憶體巨集以及開(kāi)放創(chuàng)新平臺(tái)(Open Innov
          • 關(guān)鍵字: ARM  FinFET  

          名詞解釋:ARM,DSP,FPGA,CPLD,SOPC,SOC區(qū)別與聯(lián)系

          • arm是一種嵌入式芯片,比單片機(jī)功能強(qiáng),可以針對(duì)需要增加外設(shè)。類似于通用cpu,但是不包括桌面計(jì)算機(jī)。DSP主要用來(lái)計(jì)算,計(jì)算功能很強(qiáng)悍,一般嵌入式芯片用來(lái)控制,而DSP用來(lái)計(jì)算,譬如一般手機(jī)有一個(gè)arm芯片,主要用
          • 關(guān)鍵字: SOC  區(qū)別  聯(lián)系  SOPC  CPLD  ARM  DSP  FPGA  名詞解釋  

          FPGA與CPLD的區(qū)別有哪些?

          • 盡管FPGA和CPLD都是可編程ASIC器件,有很多共同特點(diǎn),但由于CPLD和FPGA結(jié)構(gòu)上的差異,具有各自的特點(diǎn):①CPLD更適合完成各種算法和組合邏輯,FPGA更適合于完成時(shí)序邏輯。換句話說(shuō),FPGA更適合于觸發(fā)器豐富的結(jié)構(gòu),而CPLD更適
          • 關(guān)鍵字: FPGA  CPLD    

          JESD204標(biāo)準(zhǔn)解析,為什么我們要重視它?

          • 一種新的轉(zhuǎn)換器接口的使用率正在穩(wěn)步上升,并且有望成為未來(lái)轉(zhuǎn)換器的協(xié)議標(biāo)準(zhǔn)。這種新接口——JESD204——誕 ...
          • 關(guān)鍵字: JESD  數(shù)據(jù)轉(zhuǎn)換  FPGA  

          ARM,DSP,FPGA,CPLD,SOPC,SOC區(qū)別和聯(lián)系

          • ARM,DSP,FPGA,CPLD,SOPC,SOC之間有什么區(qū)別和聯(lián)系?arm是一種嵌入式芯片,比單片機(jī)功能強(qiáng),可以針對(duì)需要增加外設(shè) ...
          • 關(guān)鍵字: ARM  DSP  FPGA  CPLD  SOPC  SOC    

          ARM攜Cadence開(kāi)發(fā)Cortex-A57 64位處理器

          • ARM (LSE:ARM; Nasdaq: ARMH) 和Cadence (NASDAQ: CDNS) 日前宣布合作細(xì)節(jié),揭示其共同開(kāi)發(fā)首款基于臺(tái)積電16納米FinFET制程的ARM?Cortex?-A57處理器,實(shí)現(xiàn)對(duì)16納米性能和功耗縮小的承諾。 測(cè)試芯片是采用完整的Cadence RTL-to-signoff流程、 Cadence Virtuoso 定制設(shè)計(jì)平臺(tái)、ARM Artisan?標(biāo)準(zhǔn)單元庫(kù)和臺(tái)積電的存儲(chǔ)器的宏。
          • 關(guān)鍵字: ARM  Cadence  處理器  Cortex-A57  
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