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燦芯半導(dǎo)體獲得ARM IP 授權(quán)
- 國際領(lǐng)先的ASIC設(shè)計(jì)公司及一站式服務(wù)供應(yīng)商,燦芯半導(dǎo)體(上海)有限公司(以下簡稱“燦芯半導(dǎo)體”)今日宣布,燦芯半導(dǎo)體與ARM簽署了一份長期協(xié)議,將被授權(quán)使用ARM的IP工具包,其中包括ARM? Cortex?, ARM9/11?和Mali?系列處理器﹑以及CoreSight?調(diào)試追蹤技術(shù)和與AMBA?兼容的系統(tǒng)設(shè)計(jì)IP。
- 關(guān)鍵字: ARM 燦芯半導(dǎo)體
基于FPGA的CMI編碼系統(tǒng)設(shè)計(jì)
- 摘要:提出了一種基于FPGA并利用Verilog HDL實(shí)現(xiàn)的CMI編碼設(shè)計(jì)方法。研究了CMI碼型的編碼特點(diǎn),提出了利用Altera公司CycloneⅡ系列EP2C5Q型號FPGA完成CMI編碼功能的方案。在系統(tǒng)程序設(shè)計(jì)中,首先產(chǎn)生m序列,然后程序
- 關(guān)鍵字: FPGA CMI 編碼 系統(tǒng)設(shè)計(jì)
基于FPGA的數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
- 摘要:基于FPGA和USB2.0的技術(shù)方案,設(shè)計(jì)了一種高速化和集成化的數(shù)據(jù)采集系統(tǒng)。該系統(tǒng)是以Altera公司的FPGA芯片EP2C5T144為主控芯片,以Cypress公司的EZ-USB FX2芯片為傳輸手段設(shè)計(jì)實(shí)現(xiàn)的。首先詳細(xì)介紹了整體系統(tǒng)的
- 關(guān)鍵字: FPGA 數(shù)據(jù)采集系統(tǒng)
基于FPGA+DSP的雷達(dá)高速數(shù)據(jù)采集系統(tǒng)的實(shí)現(xiàn)
- 摘要:激光雷達(dá)的發(fā)射波及回波信號經(jīng)光電器件轉(zhuǎn)換形成的電信號具有脈寬窄,幅度低,背景噪聲大等特點(diǎn),對其進(jìn)行低速數(shù)據(jù)采集存在數(shù)據(jù)精度不高等問題。同時(shí),A/D轉(zhuǎn)換器與數(shù)字信號處理器直接連接會導(dǎo)致數(shù)據(jù)傳輸不
- 關(guān)鍵字: FPGA DSP 雷達(dá) 高速數(shù)據(jù)
數(shù)字基帶傳輸系統(tǒng)的FPGA設(shè)計(jì)與實(shí)現(xiàn)
- 摘要:為了提高系統(tǒng)的集成度和可靠性,降低功耗和成本,增強(qiáng)系統(tǒng)的靈活性,提出一種采用非常高速積體電路的硬件描述語言(VHDL語言)來設(shè)計(jì)數(shù)字基帶傳輸系統(tǒng)的方法。詳細(xì)闡述數(shù)字基帶傳輸系統(tǒng)中信號碼型的設(shè)計(jì)原則,數(shù)
- 關(guān)鍵字: FPGA 數(shù)字基帶 傳輸系統(tǒng)
FPGA實(shí)現(xiàn)IRIG-B(DC)碼編碼和解碼的設(shè)計(jì)
- 為達(dá)到IRIG-B碼與時(shí)間信號輸入、輸出的精確同步,采用現(xiàn)代化靶場的IRIG-B碼編碼和解碼的原理,從工程的角度出發(fā),提出了使用現(xiàn)場可編程門陣列(FPGA)來實(shí)現(xiàn)IRIG-B碼編碼和解碼的設(shè)計(jì)方案和體系結(jié)構(gòu),設(shè)計(jì)中會涉及到幾個(gè)不同的時(shí)鐘頻率,F(xiàn)PGA對時(shí)鐘的同步性具有靈活性、效率高、且功耗低。抗干擾性好的特點(diǎn)。結(jié)果表明,F(xiàn)PGA能夠確保為從設(shè)備提供同源的時(shí)鐘基準(zhǔn),使時(shí)鐘與信號的延遲控制在200 ns以內(nèi),從而得到了IRIG-B碼與時(shí)間精確同步的效果。
- 關(guān)鍵字: IRIG-B FPGA DC 編碼
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