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MIMO-OFDMA無線基站的DSP-FPGA系統(tǒng)劃分
- 引言 無線運營商通過提供增強數據服務來提高單位用戶平均收益(ARPU)，這同時推動了對寬帶的需求，導致對數據速率的要求越來越高。而且，為用戶提供各種應用體驗的要求也促使底層網絡體系結構進行變革。窄帶2G GSM、IS-95系統(tǒng)等以語音為中心的技術已經發(fā)展到了基于WCDMA的HSDPA和HSUPA系統(tǒng)，峰值數據速率達到了10Mbps。今后的3GPP長期發(fā)展規(guī)范采用了多輸入多輸出(MIMO)等復雜的信號處理技術，以及正交頻分復用接入(OFDMA)和多載波碼分復用接入(MC-CDMA)等新的射頻技術，這些
- 關鍵字： MIMO WiMAX LTE 3G FPGA
基于USB2.0與FPGA技術的高速數據采集系統(tǒng)的設計
- 近年來筆記本電腦迅速普及和更新，其中大部分已經不配置RS232接口，而USB接口已成為今后一段時間PC機與外設接口的主流。本采集系統(tǒng)的設計構建了一個基于USB接口的多功能通用數據采集、傳輸平臺，將嵌入式系統(tǒng)的實時性、靈活性和PC機強大的數據存儲、處理、顯示功能結合起來。該采集系統(tǒng)在智能儀器儀表、測控系統(tǒng)、工控系統(tǒng)等領域有廣闊的應用前景。 1 系統(tǒng)總體結構設計 1.1 系統(tǒng)總體結構 系統(tǒng)總體結構框圖如圖1所示，系統(tǒng)包括：單片機與USB接口模塊、FPGA模塊、信號調理及A/D模塊。其中，單片
- 關鍵字： 單片機 USB FPGA A/D
利用FPGA實現(xiàn)工業(yè)以太網交換機設計優(yōu)化
- 利用FPGA實現(xiàn)工業(yè)以太網交換機設計優(yōu)化,工業(yè)以太網技術一直在進步，并越來越普及，而設計師面臨著對高性價比工業(yè)交換機日益強勁的需求?；贏SIC和ASSP的交換機因其架構固定，所以實際上沒有余地定制出新的系統(tǒng)特性。為了增加特性設計一般要推倒重來，此舉會導致額外的設計時間和成本支出。但如上所述的支持IEEE 1588交換機的FPGA設計可節(jié)省6到9個月的工程時間，并提供給設計師夢寐以求的靈活性，幫助他們實現(xiàn)精確定時協(xié)議（PTP）、 支持多個工業(yè)以太網標準、額外的標準接口或者其它可能的定制特性。
- 關鍵字： 交換機 設計 優(yōu)化 以太網 工業(yè) FPGA 實現(xiàn) 利用
在高清晰LCD HDTV中使用Cyclone III FPGA
- 引言 當今的液晶顯示(LCD) 技術在高清晰電視(HDTV) 領域得到了廣泛應用，其挑戰(zhàn)在于如何獲得更高的分辨率，實現(xiàn)更快的數據速率。提高數據速率需要專業(yè)圖像處理算法來支持快速移動的視頻。業(yè)界遇到的主要問題是：怎樣實現(xiàn)這些算法，率先將產品推向市場，并且能夠控制好產品功耗? 為解決這一問題，當硬件平臺和不同尺寸的LCD 顯示屏連接時，設計人員需要確定怎樣重新配置圖像處理算法。面積較大的LCD 顯示屏需要更快的數據速率，因此，難點在于怎樣根據顯示屏大小來調整數據速率。 采用新的低成本Cy
- 關鍵字： FPGA Cyclone III LCD HDTV
CEF西安展兩款超值新品推薦
- ST（意法半導體）的STM32微控制器 ARM® Cortex™-M3內核的32位閃存微控制器，具有高集成、高性能、低功耗、低成本的優(yōu)勢，最高72MHz的主頻配合Thumb-2指令集比ARM7有更高的運行速度和代碼密度。同時擁有豐富的外部資源，從36到144引腳，6K到64K的SRAM，32K到512K的FLASH全系列幾十個型號可供選擇。STM32增強型非常適合電機控制應用，如三相無刷電機、直流有刷電機和步進電機等。ST的STM3210B-MCKIT電機開發(fā)套件，提供免
- 關鍵字： 意法半導體 ARM nfiniiVision 安捷倫科
FPGA設計開發(fā)中應用仿真技術解決故障的方法
- 本文針對FPGA實際開發(fā)過程中，出現(xiàn)故障后定位困難、反復修改代碼編譯時間過長、上板后故障解決無法確認的問題，提出了一種采用仿真的方法來定位、解決故障并驗證故障解決方案?？梢源蟠蟮墓?jié)約開發(fā)時間，提高開發(fā)效率。 FPGA近年來在越來越多的領域中應用，很多大通信系統(tǒng)（如通信基站等）都用其做核心數據的處理。但是過長的編譯時間，在研發(fā)過程中使得解決故障的環(huán)節(jié)非常令人頭痛。本文介紹的就是一種用仿真方法解決故障從而減少研發(fā)過程中的編譯次數，最終達到準確定位故障、縮短解決故障時間的目的。文例所用到的軟件開發(fā)平臺
- 關鍵字： FPGA 應用仿真
影響FPGA設計中時鐘因素的探討
- 時鐘是整個電路最重要、最特殊的信號，系統(tǒng)內大部分器件的動作都是在時鐘的跳變沿上進行, 這就要求時鐘信號時延差要非常小, 否則就可能造成時序邏輯狀態(tài)出錯；因而明確FPGA設計中決定系統(tǒng)時鐘的因素，盡量較小時鐘的延時對保證設計的穩(wěn)定性有非常重要的意義。 1.1 建立時間與保持時間 建立時間（Tsu：set up time）是指在時鐘沿到來之前數據從不穩(wěn)定到穩(wěn)定所需的時間，如果建立的時間不滿足要求那么數據將不能在這個時鐘上升沿被穩(wěn)定的打入觸發(fā)器；保持時間（Th：hold time）是指數據穩(wěn)定后
- 關鍵字： FPGA 時鐘
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