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fpga+dsp 文章進(jìn)入fpga+dsp技術(shù)社區(qū)

基于FPGA的TDICCD8091 驅(qū)動(dòng)時(shí)序電路設(shè)計(jì)

0引言時(shí)間延時(shí)積分電荷耦合器件(TimeDelayandIntegra-tionChargeCoupledDevices,TDICCD)易于實(shí)現(xiàn)實(shí)...
關(guān)鍵字： FPGA TDICCD8091 驅(qū)動(dòng)時(shí)序

基于FPGA的FIR數(shù)字濾波器設(shè)計(jì)方案（二）

模型搭建好之后，需要確定16階FIR數(shù)字濾波器的系數(shù)，在這使用Matlab中的FDATool濾波器設(shè)計(jì)工具來確定。確定好濾 ...
關(guān)鍵字： FPGA FIR 數(shù)字濾波器

基于FPGA的FIR數(shù)字濾波器設(shè)計(jì)方案(一)

在Matlab/Simulink環(huán)境下，采用DSP Builder模塊搭建FIR模型，根據(jù)FDATool工具對(duì)FIR濾波器進(jìn)行了設(shè)計(jì)，然后進(jìn)行系 ...
關(guān)鍵字： FPGA FIR 數(shù)字濾波器

最新FPGA所需求的電源IC

近年來，電子設(shè)備(應(yīng)用)的多樣化與高性能化以驚人的速度不斷發(fā)展?？梢哉f，這種趨勢(shì)使各產(chǎn)品的開發(fā)周期縮短，并給...
關(guān)鍵字： FPGA 電源IC

基于USB與DSP的指紋識(shí)別系統(tǒng)的設(shè)計(jì)實(shí)現(xiàn)

摘要：介紹一種以高速的DSP芯片TMS320VC5402為平臺(tái)對(duì)指紋圖像進(jìn)行實(shí)時(shí)處理的指紋識(shí)別系統(tǒng)，用USB接口芯片與主機(jī)...
關(guān)鍵字： USB DSP 指紋識(shí)別系統(tǒng)

威盛獲授權(quán)使用Cadence Tensilica HiFi音頻/語音DSP

Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ：CDNS)，全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先公司日前宣布臺(tái)灣威盛科技(VIA Technologies)已選擇Cadence? Tensilica? HiFi Audio/Voice DSP(高保真音頻/語音數(shù)字信號(hào)處理器)用于機(jī)頂盒、平板電腦和移動(dòng)設(shè)備的系統(tǒng)芯片(SOC)設(shè)計(jì)。
關(guān)鍵字：威盛 Cadence DSP

基于ARM+FPGA的1394總線在TFT-LCD檢測(cè)系統(tǒng)中的應(yīng)用

IEEE1394是最初由Apple公司提出的高速串行總線，1995年IEEE(電氣和電子工程師協(xié)會(huì))將其認(rèn)可為IEEE1394－1995規(guī) ...
關(guān)鍵字： IEEE1394總線 ARM FPGA TFT-LCD

采用 Linux 與 DSP/BIOS RTOS 實(shí)施雙 OS 信號(hào)處理技術(shù)

在系統(tǒng)性能與編程簡(jiǎn)易性之間的權(quán)衡折中是通用操作系統(tǒng)與實(shí)時(shí)操作系統(tǒng)之間的主要區(qū)分點(diǎn)之一。GPOS...
關(guān)鍵字：信號(hào)處理 Linux DSP BIOS

Altera推出首款基于FPGA的智能交通視頻分析解決方案

Altera公司 (NASDAQ: ALTR) 日前在2013年中國(guó)國(guó)際公共安全博覽會(huì) (安博會(huì)) 上宣布，北京動(dòng)視元科技有限公司(簡(jiǎn)稱：動(dòng)視元)采用Altera基于FPGA的最新視頻分析成功推出首個(gè)基于FPGA的智能交通視頻分析解決方案——?jiǎng)右曉令Ｏ盗薪煌顩r視頻分析儀。
關(guān)鍵字： Altera FPGA 視頻分析

CEVA推出浮點(diǎn)矢量 DSP內(nèi)核CEVA-XC4500

全球領(lǐng)先的數(shù)字信號(hào)處理器(DSP)內(nèi)核和平臺(tái)解決方案授權(quán)廠商CEVA公司宣布推出世界上首個(gè)專為先進(jìn)無線基礎(chǔ)設(shè)施解決方案而設(shè)計(jì)的浮點(diǎn)矢量(vector floating-point) DSP內(nèi)核——CEVA-XC4500 DSP。
關(guān)鍵字： CEVA ARM 嵌入式 DSP

PSoC 5LP：帶CPLD的可靠ARM嵌入式處理器

您是不是需要復(fù)雜可編程邏輯器件(CPLD)但又不愿放棄固件?或者說您希望最好在單個(gè)芯片中同時(shí)集成微控制器和CPLD?PSoC? 5LP是賽普拉斯半導(dǎo)體公司的最新片上可編程系統(tǒng)，當(dāng)它用作CPU時(shí)，它就是一款32位的67 MHz ARM Cortex-M3處理器，而用作CPLD時(shí)，其可編程邏輯提供的基于LUT的FPGA門，相當(dāng)于20,000多個(gè)門。
關(guān)鍵字： ARM 嵌入式 FPGA PSoC UDB

DSP該怎樣學(xué)

我原先用的是AVR，然后到STM32，進(jìn)入公司之后開始用TI C2000系列DSP直到現(xiàn)在。
關(guān)鍵字： DSP AVR STM32 CCS CMD

十一條金律！搞定DC/DC電源轉(zhuǎn)換方案設(shè)計(jì)

搞嵌入式的工程師們往往把單片機(jī)、ARM、DSP、FPGA搞的得心應(yīng)手，而一旦進(jìn)行系統(tǒng)設(shè)計(jì)，到了給電源系統(tǒng)供電，雖然也能讓其精心設(shè)計(jì)的程序運(yùn)行起來，但對(duì)于新手來說，有時(shí)可能效率低下，往往還有供電電流不足或過大引起這樣那樣的問題，本文十大金律輕松搞定DCDC電源轉(zhuǎn)換電路設(shè)計(jì)。
關(guān)鍵字： DC/DC FPGA DSP 穩(wěn)壓器

FPGA攻略之Testbench篇

Testbench，就是測(cè)試平臺(tái)的意思，具體概念就多不介紹了，相信略懂FPGA的人都知道，編寫Testbench的主要目的是為了對(duì)使用硬件描述語言(HDL)設(shè)計(jì)的電路進(jìn)行仿真驗(yàn)證，測(cè)試設(shè)計(jì)電路的功能、部分性能是否與預(yù)期的目標(biāo)相符。
關(guān)鍵字： FPGA Quartus Testbench 開發(fā)板異步復(fù)位

可編程交流電源輸出信號(hào)質(zhì)量分析系統(tǒng)的設(shè)計(jì)

摘要：針對(duì)可編程交流電源中輸出信號(hào)質(zhì)量分析的需要，本文設(shè)計(jì)了一種基于DSP的可編程交流電源輸出信號(hào)質(zhì)量分析系統(tǒng)。
關(guān)鍵字：交流電源 DSP 信號(hào)調(diào)理濾波器 AD轉(zhuǎn)換器 201311

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fpga+dsp電路

利用FPGA資源和最小模擬電路發(fā)電進(jìn)行開關(guān)電源設(shè)計(jì)的方法
一種基于DSP和USB的指紋識(shí)別系統(tǒng)設(shè)計(jì)
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)設(shè)計(jì)與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計(jì)與實(shí)現(xiàn)

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