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利用CPLD實現(xiàn)FPGA的快速加載
- 基于SRAM的FPGA由于其可編程、可升級的特性，被廣泛應(yīng)用于現(xiàn)代通信系統(tǒng)中。由于其易失性，每次上電后都需要重新對FPGA進(jìn)行加載。隨著通信系統(tǒng)復(fù)雜度的提高，F(xiàn)PGA配置文件越來越大，加載時間越來越長，嚴(yán)重影響系統(tǒng)的啟動時同。為了提高FPGA的加載效率，在此提出一種通過CPLD進(jìn)行FPGA串行加載的方案。通過驗證，該方法既能能提高FPGA加載效率，又能節(jié)省CPU和FPGA的GIPO管腳，降低系統(tǒng)啟動時間，非常適用于現(xiàn)代復(fù)雜通信系統(tǒng)。
- 關(guān)鍵字： CPLD FPGA
面向異步視頻的嵌入式圖像處理系統(tǒng)設(shè)計
- 面向異步視頻的嵌入式圖像處理系統(tǒng)設(shè)計,摘要：在此設(shè)計出一種基于DSP+FPGA技術(shù)的面向異步視頻的嵌入式圖像處理系統(tǒng)，以一種靈活的架構(gòu)避免了幀間不同步方法對雙口RAM顯存的需求，既能夠保證圖像輸出質(zhì)量，又有利于提升圖像處理的性能指標(biāo)。系統(tǒng)以FPGA為核心
- 關(guān)鍵字： 異步視頻 圖像處理 嵌入式系統(tǒng) FPGA 幀存切換
基于SoPC的狀態(tài)監(jiān)測裝置的嵌入式軟硬件協(xié)同設(shè)計
- 基于SoPC的狀態(tài)監(jiān)測裝置的嵌入式軟硬件協(xié)同設(shè)計,摘要：首先介紹了軟硬件協(xié)同設(shè)計方法的發(fā)展過程和狀態(tài)監(jiān)測裝置開發(fā)的背景資料，然后利用該方法設(shè)計了一款新型的高性能狀態(tài)監(jiān)測裝置，并分別從硬件和軟件2個角度對設(shè)計方法進(jìn)行了深入說明。該裝置已成功集成于水電機組
- 關(guān)鍵字： 軟硬件協(xié)同 SoPC 狀態(tài)監(jiān)測 Linux FPGA PLC
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