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基于FPGA的太陽跟蹤器的設(shè)計(jì)及實(shí)現(xiàn)

在簡要介紹地日運(yùn)行規(guī)律的基礎(chǔ)上，確定了視日運(yùn)動(dòng)跟蹤法的計(jì)算模型及跟蹤裝置的機(jī)械結(jié)構(gòu)。采用FPGA芯片XC3S1500為處理器，以步進(jìn)電機(jī)為執(zhí)行機(jī)構(gòu)，采用Verilog語言設(shè)計(jì)實(shí)現(xiàn)了高度角一方位角太陽跟蹤系統(tǒng)。根據(jù)系統(tǒng)的要求建立了計(jì)時(shí)模塊、太陽高度角方位角計(jì)算模塊、日出日落時(shí)間計(jì)算模塊和步進(jìn)電機(jī)脈沖控制模塊。通過實(shí)驗(yàn)測(cè)試該系統(tǒng)能夠達(dá)到預(yù)期的性能指標(biāo)，對(duì)提高太陽能的利用率具有重要的現(xiàn)實(shí)意義。
關(guān)鍵字： FPGA 跟蹤器

基于DSP+MCU的列車滾動(dòng)軸承故障診斷系統(tǒng)設(shè)計(jì)與應(yīng)用

基于DSP+MCU的列車滾動(dòng)軸承故障診斷系統(tǒng)充分利用了DSP和MCU的信號(hào)處理和控制能力，提高了系統(tǒng)的數(shù)據(jù)處理效率。實(shí)驗(yàn)結(jié)果表明，該系統(tǒng)通過Hilbert變換法提取出包絡(luò)信號(hào)，利用小波奇異性檢測(cè)進(jìn)行故障診斷，取得了很好的效果。
關(guān)鍵字：診斷系統(tǒng) 設(shè)計(jì) 應(yīng)用故障軸承 DSP MCU 列車滾動(dòng) 基于

基于FPGA的片上系統(tǒng)和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng)

基于FPGA的片上系統(tǒng)和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng),本系統(tǒng)立足于利用Intemet實(shí)現(xiàn)核環(huán)境信息的遠(yuǎn)程采集。在實(shí)現(xiàn)上，采用了基于SOPC技術(shù)的嵌入式解決方案，通過在FPGA中嵌入NioslI軟核處理器和所需外設(shè)的IP Core(硅知識(shí)產(chǎn)權(quán)核)，然后再配備相應(yīng)的網(wǎng)絡(luò)接口，實(shí)現(xiàn)利用互聯(lián)
關(guān)鍵字：系統(tǒng) 監(jiān)控系統(tǒng) 遠(yuǎn)程嵌入式基于 FPGA

基于FPGA的SoC和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng)

本系統(tǒng)立足于利用Intemet實(shí)現(xiàn)核環(huán)境信息的遠(yuǎn)程采集。在實(shí)現(xiàn)上，采用了基于SOPC技術(shù)的嵌入式解決方案，通過...
關(guān)鍵字：遠(yuǎn)程監(jiān)控 SoC 嵌入式 FPGA

基于FPGA和頻率合成器的GPS信號(hào)源的設(shè)計(jì)

頻率合成器是發(fā)射系統(tǒng)和接收系統(tǒng)中的核心器件，采用相位負(fù)反饋頻率控制技術(shù)，具有良好的窄帶載波跟蹤性能和...
關(guān)鍵字： ADF4360-4 FPGA 頻率合成器 GPS信號(hào)源

一種基于FPGA和單片機(jī)的掃頻儀研究與設(shè)計(jì)

一個(gè)網(wǎng)絡(luò)的頻率特性包括幅頻特性和相頻特性，在系統(tǒng)設(shè)計(jì)時(shí)，各個(gè)網(wǎng)絡(luò)的頻率特性對(duì)該系統(tǒng)的穩(wěn)定性、工作頻帶...
關(guān)鍵字：掃頻儀 FPGA 單片機(jī) 掃頻信號(hào)

基于65nm FPGA的多模無線基站的高端應(yīng)用

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
關(guān)鍵字： 65nm TD-SCDMA FPGA 多模無線基站

基于FPGA芯片和頻率合成器ADF4360-4的GPS信號(hào)源的設(shè)計(jì)方案

基于FPGA芯片和頻率合成器ADF4360-4的GPS信號(hào)源的設(shè)計(jì)方案,　頻率合成器是發(fā)射系統(tǒng)和接收系統(tǒng)中的核心器件，采用相位負(fù)反饋頻率控制技術(shù)，具有良好的窄帶載波跟蹤性能和帶寬調(diào)制跟蹤性能，為系統(tǒng)上、下變頻提供本振信號(hào)，對(duì)相位噪聲和雜散具有很好的抑制作用，通過鎖相頻率合
關(guān)鍵字： GPS 信號(hào)源設(shè)計(jì) 方案 ADF4360-4 合成器 FPGA 芯片頻率

FPGA/EPLD的自上而下設(shè)計(jì)方法

FPGA/EPLD的自上而下設(shè)計(jì)方法,FPGA/EPLD的自上而下(Top-Down)設(shè)計(jì)方法：　　傳統(tǒng)的設(shè)計(jì)手段是采用原理圖輸入的方式進(jìn)行的，如圖1所示。通過調(diào)用FPGA/EPLD廠商所提供的相應(yīng)物理元件庫，在電路原理圖中繪制所設(shè)計(jì)的系統(tǒng)，然后通過網(wǎng)表轉(zhuǎn)換產(chǎn)生某一特
關(guān)鍵字：方法設(shè)計(jì) 自上而下 FPGA/EPLD

基于FPGA與SRAM的大容量數(shù)據(jù)存儲(chǔ)的設(shè)計(jì)

基于FPGA與SRAM的大容量數(shù)據(jù)存儲(chǔ)的設(shè)計(jì),　1 前言　針對(duì)FPGA中內(nèi)部BlockRAM有限的缺點(diǎn)，提出了將FPGA與外部SRAM相結(jié)合來改進(jìn)設(shè)計(jì)的方法，并給出了部分VHDL程序?！　? 硬件設(shè)計(jì)　　這里將主要討論以Xilinx公司的FPGA(XC2S600E-6fg456)和ISSI公司的SRAM(IS61
關(guān)鍵字：存儲(chǔ) 設(shè)計(jì) 數(shù)據(jù) 大容量 FPGA SRAM 基于

基于上位機(jī)與FPGA開發(fā)板的光纖通道接口適配器

基于上位機(jī)與FPGA開發(fā)板的光纖通道接口適配器,　　隨著存儲(chǔ)技術(shù)的迅速發(fā)展，存儲(chǔ)容量得到了迅速的增長，存儲(chǔ)系統(tǒng)的數(shù)據(jù)傳輸速度成為了主要的瓶頸。光纖的傳輸具有其速度上的優(yōu)勢(shì)，然而，在光纖傳輸要受到光纖通道接口的限制，因此光纖通道應(yīng)用于高速數(shù)據(jù)傳輸?shù)囊?/li>
關(guān)鍵字：通道接口適配器光纖開發(fā) 上位 FPGA 基于

嵌入式開發(fā)需要的不僅僅是處理器

　　摘要：嵌入式系統(tǒng)工程師們?cè)诨ù罅繒r(shí)間試圖找到最適合應(yīng)用的完美器件。然而令他們失望的是，現(xiàn)有器件總是缺少其他器件所具備的一項(xiàng)或多項(xiàng)重要功能，因而在設(shè)計(jì)時(shí)總是要權(quán)衡利弊而無法實(shí)現(xiàn)完美。絕大多數(shù)情況下，完美器件只是一個(gè)夢(mèng)想。　　關(guān)鍵詞：嵌入式開發(fā);處理器;MCU;編譯器對(duì)于處理器和單片機(jī)，選擇標(biāo)準(zhǔn)變得更加抽象和復(fù)雜。由于單片機(jī)可編程，正常的電氣參數(shù)選擇標(biāo)準(zhǔn)必須要考慮器件執(zhí)行某項(xiàng)具體任務(wù)時(shí)的速度和效率。從表面上看，單片機(jī)性能取決于處理器內(nèi)核，但事實(shí)上并非完全如此。處理器性能的確與處理器內(nèi)核息息相關(guān)，但同時(shí)
關(guān)鍵字：嵌入式開發(fā) 處理器 MCU 201009

Altera展示25-Gbps收發(fā)器，樹立滿足業(yè)界帶寬需求關(guān)鍵里程碑

　　Altera公司(NASDAQ: ALTR)今天宣布，公司率先在可編程邏輯中成功演示25-Gbps收發(fā)器性能，在收發(fā)器技術(shù)上樹立了關(guān)鍵里程碑。Altera在28-nm收發(fā)器測(cè)試芯片上實(shí)現(xiàn)了這一具有里程碑意義的技術(shù)，該芯片是Altera用于在28-nm FPGA上成功實(shí)現(xiàn)28-Gbps收發(fā)器的原型開發(fā)平臺(tái)。實(shí)現(xiàn)25-Gbps里程碑，使目前已有FPGA解決方案的性能提高兩倍多，并在功能上優(yōu)于競(jìng)爭(zhēng)ASSP產(chǎn)品。您可以在Altera網(wǎng)站上觀看28-nm收發(fā)器測(cè)試芯片的視頻演示。　　Altera 28-nm
關(guān)鍵字： Altera 收發(fā)器 FPGA

基于FPGA的DDC的設(shè)計(jì)

摘要：數(shù)字下變頻技術(shù)是軟件無線電的核心技術(shù)之一。本文首先介紹了DDC的組成結(jié)構(gòu)，然后詳細(xì)分析了DDC各功能模塊的工作原理，通過Modelsim完成了DDC其主要模塊的仿真和調(diào)試，并進(jìn)行初步系統(tǒng)級(jí)驗(yàn)證。在仿真的基礎(chǔ)上使用
關(guān)鍵字： FPGA DDC

出租車計(jì)費(fèi)器的EOA設(shè)計(jì)與實(shí)現(xiàn)

摘要：以現(xiàn)場(chǎng)可編程邏輯器件(FPGA)為設(shè)計(jì)載體，以硬件描述語言(VHDL)為主要表達(dá)方式，以QuartusⅡ開發(fā)軟件和GW48EDA開發(fā)系統(tǒng)為設(shè)計(jì)工具，給出了一種出租車計(jì)費(fèi)器的工作原理和軟硬件實(shí)現(xiàn)方法。同時(shí)對(duì)該出租車計(jì)費(fèi)器進(jìn)
關(guān)鍵字： FPGA