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          EEPW首頁 >> 主題列表 >> fpga:quartusⅡ

          基于FPGA和TMS320DM642的CCD圖像采集和處理系統(tǒng)硬

          • 本文面向?qū)崟r(shí)圖像采集和處理,采用模塊化設(shè)計(jì)思想,以TMS320DM642、SAA7115、OSD FPGA等實(shí)現(xiàn)了視頻圖像采集和處理系統(tǒng)的硬件電路,該系統(tǒng)電路簡單、結(jié)構(gòu)緊湊、調(diào)節(jié)靈活、可靠性高、實(shí)時(shí)性強(qiáng)的特點(diǎn),通過驗(yàn)證,滿足設(shè)計(jì)的應(yīng)用要求,可為今后視頻圖像采集和處理的進(jìn)一步研發(fā)提供參考。
          • 關(guān)鍵字: FPGA  320  642  CCD    

          基于FPGA的人工神經(jīng)網(wǎng)絡(luò)系統(tǒng)的實(shí)現(xiàn)方法

          • 摘要:為了改變?nèi)斯ど窠?jīng)網(wǎng)絡(luò)的研究僅僅局限于算法,只是在通用的串行或并行計(jì)算機(jī)上模擬實(shí)現(xiàn)的現(xiàn)狀,針對函數(shù)逼近問題,將BP神經(jīng)網(wǎng)絡(luò)的結(jié)構(gòu)分為3個(gè)模塊,采用VHDL語言完成對各個(gè)模塊的硬件描述,并使用Altera公司的Q
          • 關(guān)鍵字: FPGA  人工神經(jīng)  網(wǎng)絡(luò)系統(tǒng)  實(shí)現(xiàn)方法    

          基于FPGA的自適應(yīng)鎖相環(huán)設(shè)計(jì)

          • 摘要:利用鎖相環(huán)進(jìn)行載波跟蹤是獲取本地載波的一種重要方法,針對鎖相環(huán)的噪聲性能和跟蹤速度不能同時(shí)達(dá)到最優(yōu)的限制,在鎖相環(huán)PLL中引入自適應(yīng)模塊,根據(jù)環(huán)路所處的環(huán)境自適應(yīng)對PLL環(huán)路參數(shù)做出調(diào)整。設(shè)計(jì)中利用仿
          • 關(guān)鍵字: FPGA  鎖相環(huán)    

          直接數(shù)字頻率合成DDS原理及基于FPGA的實(shí)現(xiàn)

          • 直接數(shù)字頻率合成技術(shù)(DirectDigitalSynthesis,DDS)是一種從相位概念出發(fā)直接合成所需要的波形的新的...
          • 關(guān)鍵字: DDS  FPGA  數(shù)字通信系統(tǒng)  

          用CPLD實(shí)現(xiàn)嵌入式平臺上的實(shí)時(shí)圖像增強(qiáng)

          • 用CPLD實(shí)現(xiàn)嵌入式平臺上的實(shí)時(shí)圖像增強(qiáng), 提出了在嵌入式平臺上用CPLD實(shí)現(xiàn)實(shí)時(shí)圖像增強(qiáng)算法的解決方案,并加以實(shí)現(xiàn)#65377;重點(diǎn)討論了經(jīng)過改進(jìn)的圖像增強(qiáng)算法以及使用CPLD實(shí)現(xiàn)的具體方法,介紹了所采用的嵌入式平臺的總體結(jié)構(gòu)#65377;

            通常,在擁有DSP或
          • 關(guān)鍵字: DSP  CPLD  FPGA  

          基于單片機(jī)和FPGA的位移測量裝置的設(shè)計(jì)

          • 摘要:基于電感式傳感器測量磁芯位移的原理,以單片機(jī)和FPGA為控制中心,由DDS產(chǎn)生的正弦信號經(jīng)差分放大,并經(jīng)過差動變壓器的差分耦合,對兩路輸出信號放大整流后,采集數(shù)據(jù),對所得的數(shù)據(jù)進(jìn)行處理,實(shí)現(xiàn)了磁芯位
          • 關(guān)鍵字: 傳感器  LCD  單片機(jī)  FPGA  

          實(shí)時(shí)視頻數(shù)據(jù)采集的FPGA實(shí)現(xiàn)

          • 摘 要: 介紹一種在工礦監(jiān)視系統(tǒng)中采用FPGA實(shí)現(xiàn)視頻數(shù)據(jù)實(shí)時(shí)采集和顯示的設(shè)計(jì)方案。系統(tǒng)中采用FPGA和視頻解碼器實(shí)現(xiàn)了高速連續(xù)的視頻數(shù)據(jù)采集與處理。處理后的視頻信號通過VGA格式轉(zhuǎn)換,可以在現(xiàn)場VGA顯示器
          • 關(guān)鍵字: FPGA  實(shí)時(shí)視頻  數(shù)據(jù)采集    

          一種多光譜可見光遙感圖像壓縮系統(tǒng)設(shè)計(jì)

          • 摘要:為了實(shí)現(xiàn)多光譜可見光遙感圖像高質(zhì)量壓縮的要求,提出以JPEG2000壓縮標(biāo)準(zhǔn)為理論,將FPGA與專用壓縮芯片...
          • 關(guān)鍵字: 遙感圖像  JPEG2000  ADV212  FPGA  

          基于ADSP-TS201S的多DSP并行系統(tǒng)設(shè)計(jì)

          • 基于ADSP-TS201S的多DSP并行系統(tǒng)設(shè)計(jì),摘要:為滿足寬帶雷達(dá)信號處理對處理速度和實(shí)時(shí)性的要求,提出一種基于4片ADSP-TS201S的DSP并行系統(tǒng)設(shè)計(jì)。通過分析比較3種ADSP-TS2 01S的并行處理結(jié)構(gòu),結(jié)合實(shí)際需求,采用外部總線共享與鏈路口混合耦合的多DSP并
          • 關(guān)鍵字: DSP  FPGA  

          DDS原理及基于FPGA的實(shí)現(xiàn)

          • 本文主要介紹了DDS的原理及通過FPGA來實(shí)現(xiàn)。
          • 關(guān)鍵字: FPGA  DDS  原理    

          基于FPGA的卷積碼的編/譯碼器設(shè)計(jì)

          • 卷積碼是Elias在1955年最早提出的,稍后,Wozencraft在1957年提出了一種有效譯碼方法,即序列譯碼。Massey在1...
          • 關(guān)鍵字: FPGA  卷積碼  維特比  軟件無線電  

          多光譜可見光遙感圖像壓縮系統(tǒng)設(shè)計(jì)

          • 摘要:為了實(shí)現(xiàn)多光譜可見光遙感圖像高質(zhì)量壓縮的要求,提出以JPEG2000壓縮標(biāo)準(zhǔn)為理論,將FPGA與專用壓縮芯片ADV212相結(jié) 合的空間遙感圖像壓縮方法。該系統(tǒng)設(shè)計(jì)采用ADV212,通過小波變換及熵編碼實(shí)現(xiàn)對大數(shù)據(jù)量的空間
          • 關(guān)鍵字: RAM  FPGA  AD  

          一種基于FPGA的信道化接收機(jī)的研究與設(shè)計(jì)

          • 現(xiàn)代電子戰(zhàn)場的電磁環(huán)境復(fù)雜多變,信號環(huán)境朝著密集化、復(fù)雜化、占用電磁頻譜寬帶化的方向發(fā)展。另一方面...
          • 關(guān)鍵字: 信道化接收機(jī)  FPGA  信道化  ADC  

          短幀Turbo譯碼器的FPGA實(shí)現(xiàn)

          • 短幀Turbo譯碼器的FPGA實(shí)現(xiàn),  Turbo碼雖然具有優(yōu)異的譯碼性能,但是由于其譯碼復(fù)雜度高,譯碼延時(shí)大等問題,嚴(yán)重制約了Turbo碼在高速通信系統(tǒng)中的應(yīng)用。因此,如何設(shè)計(jì)一個(gè)簡單有效的譯碼器是目前Turbo碼實(shí)用化研究的重點(diǎn)。本文主要介紹了短幀
          • 關(guān)鍵字: 實(shí)現(xiàn)  FPGA  Turbo  短幀  
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          fpga:quartusⅡ介紹

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