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FPGA時鐘設(shè)計

摘要：在FPGA設(shè)計中，為了成功地操作，可靠的時鐘是非常關(guān)鍵的。設(shè)計不良的時鐘在極限的溫度、電壓下將導致錯誤的行為。在設(shè)計PLD／FPGA時通常采用如下四種類型時鐘：全局時鐘、門控時鐘、多級邏輯時鐘和波動式時鐘。
關(guān)鍵字： FPGA 時鐘設(shè)計

基于FPGA的自適應波束形成算法實現(xiàn)

　1 引言　　在雷達及聲納信號處理系統(tǒng)中，波束形成算法通常采用DSP軟件編程實現(xiàn)，控制邏輯電路采用CPLD來完成，這種方法具有軟件編程靈活、功能易于擴展的優(yōu)點，但對于實時性能要求很高的系統(tǒng)，如雷達、聲納探測和
關(guān)鍵字： FPGA 自適應波束算法

基于FPGA的實時中值濾波器硬件實現(xiàn)

針對高清圖像在中值濾波預處理過程中排序量多、速度慢的特點，提出適合鄰域圖像并行處理機的分塊存儲方法。在流水線結(jié)構(gòu)下，1個時鐘周期可以并行處理32個3×3鄰域的中值濾波運算，實現(xiàn)了高速、實時的1 920×1 080灰度圖像中值濾波器。
關(guān)鍵字： FPGA 中值濾波硬件實現(xiàn)

基于FPGA的多路數(shù)字信號復分接器的設(shè)計

在現(xiàn)代數(shù)字通信中，對數(shù)據(jù)傳輸容量和傳輸效率的要求越來越高，因此經(jīng)常依據(jù)時分復用[1]的原理通過數(shù)字復接與分...
關(guān)鍵字：數(shù)字復接技術(shù) FPGA 時分復用

萊迪思宣布首個符合PCI Express 2.0規(guī)范的低成本FPGA

　　萊迪思半導體公司日前宣布LatticeECP3TMFPGA系列符合PCI Express 2.0在2.5Gbps的規(guī)范。針對最近PCI – SIG研討會上涉及的1-通道和 4-通道配置，LatticeECP3 FPGA和其PCI Express(PCIe)IP核通過了符合PCI - SIGPCIe 2.0規(guī)范和互操作性的測試，確保萊迪思的解決方案與現(xiàn)有的支持系統(tǒng)的PCIe 2.0具有互操作性。
關(guān)鍵字：萊迪思 FPGA

賽靈思榮膺“2011中國經(jīng)濟-最佳推動力企業(yè)”獎

全球可編程平臺領(lǐng)導廠商賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX)）今天宣布榮膺中國經(jīng)濟CEO論壇“2011中國經(jīng)濟-最佳推動力企業(yè)”獎。賽靈思公司全球高級副總裁、亞太地區(qū)執(zhí)行總裁湯立人（Vincent Tong）和亞太地區(qū)銷售與市場副總裁楊飛先生，出席了由東方企業(yè)家、經(jīng)理人雜志、新民周刊、金融界、北京電視臺、香港科技大學商學院、中國企業(yè)國際發(fā)展協(xié)會聯(lián)合在北京發(fā)起主辦的 “中國經(jīng)濟CEO論壇暨中國經(jīng)濟成就獎評選頒獎盛典”。商務部國際貿(mào)易經(jīng)濟合作研究院研究員白明代表中國經(jīng)濟CEO 論壇
關(guān)鍵字：賽靈思 FPGA

萊迪思宣布首個符合PCI Express 2.0規(guī)范的FPGA

萊迪思半導體公司（NASDAQ: LSCC）今日宣布LatticeECP3TMFPGA系列符合PCI Express 2.0在2.5Gbps的規(guī)范。針對最近PCI – SIG研討會上涉及的1-通道和 4-通道配置，LatticeECP3 FPGA和其PCI Express（PCIe）IP核通過了符合PCI - SIGPCIe 2.0規(guī)范和互操作性的測試，確保萊迪思的解決方案與現(xiàn)有的支持系統(tǒng)的PCIe 2.0具有互操作性。
關(guān)鍵字：萊迪思半導體 FPGA

一種基于FPGA控制全彩大屏幕顯示的設(shè)計

一種基于FPGA控制全彩大屏幕顯示的設(shè)計,隨著數(shù)字技術(shù)的飛速發(fā)展，各種數(shù)字顯示屏也隨即涌現(xiàn)出來有LED、LCD、DLP等，各種數(shù)字大屏幕的控制系統(tǒng)多種多樣，有用ARM+FPGA脫機控制系統(tǒng)，也有用PC+DVI接口解碼芯片+FPGA芯片聯(lián)機控制系統(tǒng)，在這里我們講述一種不僅
關(guān)鍵字：顯示設(shè)計大屏幕全彩 FPGA 控制基于

FPGA器件的在線配置方法

FPGA器件的在線配置方法,摘要：介紹基于SRAM LUT結(jié)構(gòu)的FPGA器件的上電配置方式；著重介紹采用計算機串口下載配置數(shù)據(jù)的方法和AT89C2051單片機、串行EEPROM組成的串行配置系統(tǒng)的設(shè)計方法及實現(xiàn)多任務電路結(jié)構(gòu)中配置的方法，并從系統(tǒng)的復雜度、
關(guān)鍵字：方法配置在線器件 FPGA

基于FPGA的四階IIR數(shù)字濾波器

摘要：采用FPGA實現(xiàn)四階IIR數(shù)字濾波器，通過兩個二階節(jié)級聯(lián)構(gòu)成數(shù)字橢圓低通濾波器。通帶內(nèi)波紋小于0.1dB，阻帶衰減大于32dB。常用的數(shù)字濾波器有ＦＩＲ數(shù)字濾波器和ＩＩＲ數(shù)字濾波器。ＦＩＲ數(shù)字濾波器具有精
關(guān)鍵字：濾波器數(shù)字 IIR FPGA 基于

基于CPLD/FPGA高速數(shù)據(jù)采集系統(tǒng)的設(shè)計

0引言傳統(tǒng)的數(shù)據(jù)采集系統(tǒng)一般采用單片機，系統(tǒng)大多通過PCI總線完成數(shù)據(jù)的傳輸。其缺點是數(shù)學運算能力差...
關(guān)鍵字： CPLD FPGA 數(shù)據(jù)采集系統(tǒng)

深入智能電網(wǎng)控制系統(tǒng): IT革命由此開始

??????? 我們生活的方方面面越來越受新技術(shù)的影響——從我們手中的電話到我們的閱讀方式。　　整個工業(yè)界都在向數(shù)字領(lǐng)域轉(zhuǎn)變——一個涵蓋了軟件，網(wǎng)絡，處理器，以及傳感器的融合與信息交換的信息技術(shù)(IT)新世界。　　是什么使這種改變?nèi)绱瞬豢煽咕?，看起來沒有任何行業(yè)能夠阻止它的腳步?這當中有很多原因，從快速的物流和服務，到巨大的生產(chǎn)力。無論如何，最重要的還是性價比。事實證明，信息技術(shù)帶
關(guān)鍵字： NI 嵌入式系統(tǒng) FPGA

基于賽靈思FPGA的硬件加速技術(shù)打造高速系統(tǒng)

該平臺采用可編程邏輯實現(xiàn)片上系統(tǒng)，以 MicroBlaze CPU或 PowerPC® CPU 作為其核心。 CPU 為操作系統(tǒng)與用戶空間應用軟件運行 MLE Linux 軟件棧。由于采用 MicroBlaze 或PowerPC 作為主 CPU，當運行嵌入式Linux 操作系統(tǒng)外加強大加密功能時該系統(tǒng)顯然無法提供所需要的計算性能。況且也無法改變物理硬件。為了實現(xiàn)系統(tǒng)加速，我們使用可編程系統(tǒng)把計算從軟件域轉(zhuǎn)移到硬件側(cè)。
關(guān)鍵字： FPGA 賽靈思高速系統(tǒng) 硬件加速技術(shù)

基于FPGA的改進DES算法的實現(xiàn)

介紹了DES算法原理，詳細分析了子密鑰生成、S盒和輪函數(shù)的設(shè)計。將DES算法采用資源優(yōu)先方案，在輪函數(shù)內(nèi)部設(shè)置流水線架構(gòu)，提高了整體處理速度；簡化子密鑰與原始密鑰的生成關(guān)系，實現(xiàn)子密鑰在迭代過程的動態(tài)分發(fā)；利用雙重case語句實現(xiàn)S盒的變換功能，加快算法執(zhí)行速度。運用硬件描述語言Verilog,采用自頂向下的設(shè)計思想,在FPGA平臺上實現(xiàn)了改進DES算法的功能。
關(guān)鍵字： FPGA DES 算法

基于改進的CORDIC算法的FFT復乘及其FPGA實現(xiàn)

根據(jù)定點FFT中旋轉(zhuǎn)因子所對應的CORDIC旋轉(zhuǎn)方向可預先求解的特點，改進了CORDIC算法中旋轉(zhuǎn)方向的計算方法，在節(jié)約乘法器資源的同時兼顧了速度與精度的要求，并基于改進的CORDIC算法，利用FPGA實現(xiàn)了這種FFT復乘模塊。仿真結(jié)果表明該設(shè)計可行，具有一定的實際意義和應用前景。
關(guān)鍵字： CORDIC FPGA FFT 算法

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利用FPGA資源和最小模擬電路發(fā)電進行開關(guān)電源設(shè)計的方法
基于FPGA的機載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
基于FPGA+DSP遠程監(jiān)控器設(shè)計與實現(xiàn)
基于FPGA的LCD顯示遠程更新

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