- 摘要：給出了一種在Xinlinx的Spartan-3E評估板上實現(xiàn)Modbus通信協(xié)議的方法。該方法以PC為上位機，并在評估板上嵌入Picoblaze軟核作為下位機來實現(xiàn)Modbus通信協(xié)議的功能。文中同時介紹了使用Xilinx ISE和Picoblaze軟核
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通信 協(xié)議 Modbus 實現(xiàn) FPGA Picoblaze 基于
- 摘要：多通道頻率檢測是當前數(shù)字接收機的一種常用的頻率測量方案，該方法可以較好地解決頻率截獲概率與頻率分辨力的矛盾，并在復(fù)雜的電磁環(huán)境中具有處理多個同時到達信號的能力。文中給出了基于FPGA來實現(xiàn)多信道頻率
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FPGA 多通道 頻率 檢測技術(shù)
- 摘要：為了實現(xiàn)煙支剔除的自動化程度，減少人為干預(yù)量和提高剔除精度，文中給出了采用FPGA硬件編程方法將數(shù)據(jù)采集部件采集到的煙支數(shù)據(jù)經(jīng)A／D轉(zhuǎn)換后送入FPGA，然后根據(jù)一定的判決算法輸出控制信號，以用于控制剔除閥
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FPGA 檢測系統(tǒng)
- Altera公司今天宣布，開始提供業(yè)界第一款集成增強前向糾錯(EFEC)IP內(nèi)核，該內(nèi)核針對高性能StratixIV和Stratix...
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FPGA 100G EFEC
- 可編程時鐘器件集成了主要的時序元件，如一個PLL、分頻器、扇出緩沖器、零延遲緩沖器，從而節(jié)省電路板面積、降低成本，并提高性能。使用諸如ispClock5400D系列器件，設(shè)計人員可以更好地規(guī)劃其特定系統(tǒng)的理想時鐘產(chǎn)生和分配電路，更好地利用其FPGA上的I/O。
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分配 控制 時鐘 FPGA I/O 改進 免費
- 摘要：給出了采用FPGA設(shè)計芯片技術(shù)對QPSK解調(diào)器進行設(shè)計的實現(xiàn)方法。該方法可將解調(diào)器中原有的多種專用芯片的功能集成在一片大規(guī)?？删幊踢壿嬈骷﨔PGA上，從而實現(xiàn)了高度集成化和小型化。仿真結(jié)果表明，該方案具有突
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DQPSK FPGA 差分 解調(diào)器
- 摘要：介紹了NCO數(shù)字控制振蕩器的工作原理，詳細分析了數(shù)控振蕩器的性能指標和其在FPGA中的實現(xiàn)方法，最后給出了新設(shè)計的數(shù)控振蕩器在QUARTUSII中的仿真結(jié)果。
關(guān)鍵詞：數(shù)控振蕩器(NCO)；無雜散動態(tài)范圍(SFDR)；FPG
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FPGA NCO 數(shù)字控制 振蕩器
- 摘要：依據(jù)標準的VGA顯示接口的顯示原理，介紹了一種利用可編程邏輯器件FPGA，并以VerilogHDL語言為邏輯描述工具來完成VGA接口的控制，從而實現(xiàn)簡單的彩色條紋顯示的具體方法。
關(guān)鍵宇：VGA；FPGA；VerilogHDL；彩色
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FPGA VGA 控制器
- 摘要：為提高整個系統(tǒng)時間的同步精度，以便為測量設(shè)備提供可靠的時間信息和標準頻率信號，給出了一種基于FPGA的IRIG-B編解碼器的設(shè)計與實現(xiàn)方法。新系統(tǒng)基于模塊化設(shè)計，其中編碼部分完成標準時間信息及相應(yīng)的BCD碼的
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IRTG-B FPGA 編解碼器
- 嵌入式處理器：2011年有望增長12%，中國設(shè)計增幅高于全球
據(jù)Semico Reserch資深分析師Tony Massimini介紹[1]，2010年，微邏輯組件(微處理器、微控制器和DSP)的銷售額勁升了24.9%。但這是因為相比于2009年的災(zāi)難性的衰退所致。在相對穩(wěn)定的銷售環(huán)境下，預(yù)計2011年有望再成長12%。
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MCU FPGA 201103
- 基于Spantan FPGA的多路數(shù)字量采集模塊設(shè)計,1 引言 測控系統(tǒng)常常需要處理所采集到的各種數(shù)字量信號。通常測控系統(tǒng)采用通用MCU完成系統(tǒng)任務(wù)。但當系統(tǒng)中采集信號量較多時，僅依靠MCU則難以完成系統(tǒng)任務(wù)。針對這一問題，提出一種基于FPGA技術(shù)的多路數(shù)字量采集
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模塊 設(shè)計 采集 數(shù)字 Spantan FPGA 基于
- 隨著實時監(jiān)控系統(tǒng)的發(fā)展，大容量高速數(shù)據(jù)采集與傳輸技術(shù)不斷取得新的進展，針對當前數(shù)據(jù)傳輸采用硬件實現(xiàn)速度快，但難以進行數(shù)據(jù)處理，而軟件能實現(xiàn)很多算法但處理速度稍顯遜色的不足，采用了LZW壓縮算法及其改進算法，并將該算法在可編程邏輯器件FPGA上進行了實現(xiàn)，通過仿真，驗證了設(shè)計的正確性，提高了數(shù)據(jù)傳輸速度。
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FPGA LZW 壓縮算法
- 為適應(yīng)中國民航對單脈沖二次雷達的雙機熱備份功能要求，采用現(xiàn)場可編程門陣列(FPGA)，并使用硬件描述語言對可擦除可編程邏輯器件(EPLD)進行編程控制，以實現(xiàn)單脈沖二次雷達切換單元的主要功能：響應(yīng)監(jiān)控系統(tǒng)的切換命令，當設(shè)備故障時自動或者手動地切換到非故障機柜，使雷達連續(xù)地輸出航跡數(shù)據(jù)?，F(xiàn)場可編程門陣列的運用增強了射頻切換單元控制的靈活性與可靠性，大大提高系統(tǒng)的檢測性能與處理性能。
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FPGA 實現(xiàn) 單元 切換 雷達 射頻 航管
- 摘要：介紹LED顯示屏的工作原理，提出大屏幕LED圖文顯示屏控制系統(tǒng)MCU+FPGA的設(shè)計方案。單片機系統(tǒng)負責(zé)接收和存儲上位機LED點陣數(shù)據(jù)，F(xiàn)PGA控制器完成顯示數(shù)據(jù)的轉(zhuǎn)換、動態(tài)掃描并驅(qū)動大屏幕LED顯示屏。FPGA控制器由VH
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控制系統(tǒng) 設(shè)計 大屏幕 LED FPGA 基于
- 摘要： 給出了一種基于FPGA的數(shù)字濾波器的設(shè)計方法。該方法先通過MATLAB設(shè)計出一個具有具體指標的FIR濾波器， 再對濾波器系數(shù)進行處理， 使之便于在FPGA中實現(xiàn)， 然后采用基于分布式算法和CSD編碼的濾波器結(jié)構(gòu)進
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FPGA FIR 濾波器設(shè)計
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