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基于FPGA及DDS技術(shù)的USM測(cè)試電源的設(shè)計(jì)

超聲波電機(jī)的運(yùn)轉(zhuǎn)需要一個(gè)兩相相差90°(或可調(diào))的高頻交流信號(hào)源。本方案采用DDS技術(shù)的設(shè)計(jì)思路，用VHDL硬件描述語言對(duì)FPGA器件編程產(chǎn)生了兩相四路高頻信號(hào)。該信號(hào)經(jīng)過驅(qū)動(dòng)隔離電路施加于H橋逆變器中，在電感的平滑作用下，生成了滿足USM測(cè)試要求的可調(diào)頻、調(diào)相、調(diào)幅的兩相高頻交流信號(hào)源，成功地對(duì)USM45電機(jī)進(jìn)行了驅(qū)動(dòng)測(cè)試。該電路可用于研究超聲波電機(jī)的運(yùn)行狀態(tài)的研究及獲取其最佳工作點(diǎn)參數(shù)。
關(guān)鍵字：測(cè)試電源設(shè)計(jì) USM 技術(shù) FPGA DDS 基于

基于DDS和FPGA技術(shù)的高動(dòng)態(tài)擴(kuò)頻信號(hào)源的研究

提出一種基于DDS和FPGA技術(shù)的高動(dòng)態(tài)擴(kuò)頻仿真信號(hào)源的實(shí)現(xiàn)方案。采用了DDS技術(shù)的芯片AD9854和AD9850,能夠模擬多普勒頻移,實(shí)現(xiàn)高動(dòng)態(tài)環(huán)境仿真。載波中心頻率變化范圍達(dá)到100kHz,變化率1.8kHz/s。
關(guān)鍵字： FPGA DDS 動(dòng)態(tài) 擴(kuò)頻

一種基于FPGA的鎖相環(huán)位同步提取電路設(shè)計(jì)

一般的位同步電路大多采用標(biāo)準(zhǔn)邏輯器件按傳統(tǒng)數(shù)字系統(tǒng)設(shè)計(jì)方法構(gòu)成，具有功耗大，可靠性低的缺點(diǎn)。用FPGA設(shè)計(jì)電路具有很高的靈活性和可靠性，可以提高集成度和設(shè)計(jì)速度，增強(qiáng)系統(tǒng)的整體性能。本文給出了一種基于fpga的數(shù)字鎖相環(huán)位同步提取電路。
關(guān)鍵字： FPGA 鎖相環(huán) 電路設(shè)計(jì) 位同步

基于FPGA的數(shù)字脈沖壓縮系統(tǒng)實(shí)現(xiàn)

針對(duì)采用線性調(diào)頻信號(hào)的寬帶雷達(dá)系統(tǒng)，完成單通道高速數(shù)據(jù)采集和數(shù)字脈沖壓縮系統(tǒng)的工程實(shí)現(xiàn)。系統(tǒng)使用ADS5500完成14位、60 MSPS的數(shù)據(jù)采集，使用FPGA實(shí)現(xiàn)1 024點(diǎn)的數(shù)字脈沖壓縮。脈沖壓縮模塊采用快速傅里葉變換IP核進(jìn)行設(shè)計(jì)，可以在脈沖壓縮的不同階段對(duì)其進(jìn)行復(fù)用，分別完成FFT和IFFT運(yùn)算，從而使硬件規(guī)模大大減少。系統(tǒng)采用塊浮點(diǎn)數(shù)據(jù)格式以提高動(dòng)態(tài)范圍，同時(shí)減小截?cái)?或舍入)誤差對(duì)輸出信噪比的影響。
關(guān)鍵字： FPGA 數(shù)字脈沖壓縮系統(tǒng)

中型組機(jī)器人運(yùn)動(dòng)控制系統(tǒng)的FPGA設(shè)計(jì)

以RoboCup中型組足球機(jī)器人為實(shí)驗(yàn)平臺(tái)，提出一種基于FPGA的全方位移動(dòng)足球機(jī)器人運(yùn)動(dòng)控制系統(tǒng)的實(shí)現(xiàn)方法。首先分析和研究三輪全方位移動(dòng)機(jī)器人的運(yùn)動(dòng)學(xué)特性，建立其運(yùn)動(dòng)控制模型，然后以FPGA為主要處理器，設(shè)計(jì)了PID速度閉環(huán)控制算法，實(shí)現(xiàn)了對(duì)機(jī)器人的精確控制。實(shí)驗(yàn)發(fā)現(xiàn)，該設(shè)計(jì)方法具有很好的實(shí)時(shí)性，能夠?qū)θ轿灰苿?dòng)機(jī)器人進(jìn)行快速、準(zhǔn)確的控制。
關(guān)鍵字： FPGA 設(shè)計(jì) 控制系統(tǒng) 運(yùn)動(dòng) 機(jī)器人中型

FPGA在PCI Express總線接口中的應(yīng)用

隨著高速數(shù)據(jù)采集設(shè)備傳輸帶寬的日益提高，開發(fā)者需要采用新的計(jì)算機(jī)總線進(jìn)行數(shù)據(jù)傳輸。這里敘述了使用EP2SGX90系列FPGA完成PCI-Express協(xié)議轉(zhuǎn)換，多種DMA工作方式及相關(guān)寄存器的作用。以鏈?zhǔn)紻MA傳輸方式為例，詳細(xì)介紹該傳輸方式下的寄存器設(shè)置及在驅(qū)動(dòng)程序中的實(shí)現(xiàn)范例。實(shí)驗(yàn)表明，用FPGA實(shí)現(xiàn)協(xié)議轉(zhuǎn)換，總線持續(xù)傳輸速率最高可以達(dá)到1．2 Gb／s，滿足大多數(shù)高速數(shù)據(jù)采集設(shè)備的要求。在此摒棄了采用專用總線接口芯片的傳統(tǒng)方法，將開發(fā)者的邏輯設(shè)計(jì)和總線協(xié)議轉(zhuǎn)換放到同一個(gè)FPGA芯片中，不但節(jié)省了硬件
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基于FPGA的SPI總線接口的實(shí)現(xiàn)

在現(xiàn)代EDA外圍電子器件的接口中存在多種標(biāo)準(zhǔn)，已知的一些接口協(xié)議存在速度慢、協(xié)議復(fù)雜等問題。SPI總線是能夠克服上述缺點(diǎn)的一種外圍串行總線，其能很好地滿足要求。通過使用Lattice公司的FPGA芯片以及工程開發(fā)軟件，特別是在線邏輯分析儀這一先進(jìn)的EDA工具，實(shí)現(xiàn)了基于FPGA的SPI接口的連接。將FPGA編程的靈活性和SPI總線的易用性結(jié)合，實(shí)現(xiàn)了FLASH的存取功能。同時(shí)也為同類型接口的芯片應(yīng)用提供了一個(gè)原型，為進(jìn)一步的工程設(shè)計(jì)提供了支持。
關(guān)鍵字： FPGA SPI 總線接口

愛特公司發(fā)布SmartFusion FPGA馬達(dá)控制參考設(shè)計(jì)

　　愛特公司(Actel Corporation)宣布提供面向馬達(dá)控制應(yīng)用的SmartFusion™智能混合信號(hào)FPGA參考設(shè)計(jì)。這些靠單一SmartFusion器件中實(shí)現(xiàn)的參考設(shè)計(jì)詮釋了使用多種反饋方法的磁場(chǎng)定向控制(FOC)，用于永磁同步馬達(dá)(permanent magnet synchronous motors, PMSM)。SmartFusion器件集成了一個(gè)FPGA、一個(gè)硬核ARM® Cortex™-M3微控制器和可編程模擬模塊，具有適合馬達(dá)控制應(yīng)用的獨(dú)特性能，可
關(guān)鍵字：愛特 FPGA 馬達(dá)控制

FPGA 28納米激戰(zhàn)　臺(tái)積電可望受惠

　　可程序邏輯閘陣列芯片(FPGA)雙雄賽靈思(Xilinx)與阿爾特拉(Altera)先后推出28納米FPGA產(chǎn)品，不僅使FPGA市場(chǎng)戰(zhàn)火升溫，也讓晶圓代工市場(chǎng)激烈角逐，在Xilinx首度與臺(tái)積電攜手合作后，Altera在28納米產(chǎn)品的布局上亦相當(dāng)積極，近期亦展示在28納米 FPGA平臺(tái)上的25-Gbps收發(fā)器，F(xiàn)PGA雙雄的激烈競(jìng)賽，預(yù)料臺(tái)積電將成為最大受惠者。　　Altera指出，在28納米FPGA中展示25-Gbps收發(fā)器，是收發(fā)器產(chǎn)品的里程碑，該芯片是Altera用于在28納米FPGA上，成
關(guān)鍵字：臺(tái)積電 FPGA 28納米

基于FPGA的兩種DDS實(shí)現(xiàn)

闡述了兩種DDS的原理，頻率合成方式(DDFS)和直讀方式(DDWS)，給出了FPGA實(shí)現(xiàn)方式，分析了DDS的幾個(gè)關(guān)鍵的技術(shù)指標(biāo)，并通過Matlab仿真。頻率合成方式是比較常用的DDS產(chǎn)生方式，對(duì)它做了詳細(xì)的原理性介紹和實(shí)現(xiàn)說明，重點(diǎn)通過仿真詳細(xì)對(duì)比了兩種實(shí)現(xiàn)方式在性能指標(biāo)上的優(yōu)劣，為后人的選擇提供技術(shù)參考。
關(guān)鍵字： FPGA DDS

基于FPGA的片上系統(tǒng)和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng)

基于FPGA的片上系統(tǒng)和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng),本系統(tǒng)立足于利用Intemet實(shí)現(xiàn)核環(huán)境信息的遠(yuǎn)程采集。在實(shí)現(xiàn)上，采用了基于SOPC技術(shù)的嵌入式解決方案，通過在FPGA中嵌入NioslI軟核處理器和所需外設(shè)的IP Core(硅知識(shí)產(chǎn)權(quán)核)，然后再配備相應(yīng)的網(wǎng)絡(luò)接口，實(shí)現(xiàn)利用互聯(lián)
關(guān)鍵字：系統(tǒng) 監(jiān)控系統(tǒng) 遠(yuǎn)程嵌入式基于 FPGA

基于FPGA的太陽跟蹤器的設(shè)計(jì)及實(shí)現(xiàn)

在簡(jiǎn)要介紹地日運(yùn)行規(guī)律的基礎(chǔ)上，確定了視日運(yùn)動(dòng)跟蹤法的計(jì)算模型及跟蹤裝置的機(jī)械結(jié)構(gòu)。采用FPGA芯片XC3S1500為處理器，以步進(jìn)電機(jī)為執(zhí)行機(jī)構(gòu)，采用Verilog語言設(shè)計(jì)實(shí)現(xiàn)了高度角一方位角太陽跟蹤系統(tǒng)。根據(jù)系統(tǒng)的要求建立了計(jì)時(shí)模塊、太陽高度角方位角計(jì)算模塊、日出日落時(shí)間計(jì)算模塊和步進(jìn)電機(jī)脈沖控制模塊。通過實(shí)驗(yàn)測(cè)試該系統(tǒng)能夠達(dá)到預(yù)期的性能指標(biāo)，對(duì)提高太陽能的利用率具有重要的現(xiàn)實(shí)意義。
關(guān)鍵字： FPGA 跟蹤器

基于FPGA芯片和頻率合成器ADF4360-4的GPS信號(hào)源的設(shè)計(jì)方案

基于FPGA芯片和頻率合成器ADF4360-4的GPS信號(hào)源的設(shè)計(jì)方案,　頻率合成器是發(fā)射系統(tǒng)和接收系統(tǒng)中的核心器件，采用相位負(fù)反饋頻率控制技術(shù)，具有良好的窄帶載波跟蹤性能和帶寬調(diào)制跟蹤性能，為系統(tǒng)上、下變頻提供本振信號(hào)，對(duì)相位噪聲和雜散具有很好的抑制作用，通過鎖相頻率合
關(guān)鍵字： GPS 信號(hào)源設(shè)計(jì) 方案 ADF4360-4 合成器 FPGA 芯片頻率