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Altium在Altium Designer軟件內(nèi)新增Aldec FPGA仿真技術(shù)
- Altium和Aldec日前簽署的OEM協(xié)議中決定將Aldec的FPGA仿真功能添加到Altium Designer軟件中去。 該協(xié)議的簽署使進(jìn)行FPGA(現(xiàn)場(chǎng)可編程門陣列)設(shè)計(jì)的電子產(chǎn)品設(shè)計(jì)師們?nèi)缁⑻硪?，業(yè)內(nèi)領(lǐng)先的Aldec VHDL及Verilog仿真功能實(shí)現(xiàn)了無縫集成，與Altium Designer軟件融為一體。電子產(chǎn)品設(shè)計(jì)師們可以在Altium電子產(chǎn)品設(shè)計(jì)統(tǒng)一架構(gòu)中使用久經(jīng)考驗(yàn)的Aldec仿真技術(shù)。 Altium首席執(zhí)行官Nick Martin表示：“多年來，Alti
- 關(guān)鍵字： Altium FPGA Designer
基于FPGA實(shí)現(xiàn)多路模擬信號(hào)自適應(yīng)采集系統(tǒng)
- 主要介紹基于FPGA實(shí)現(xiàn)多路模擬信號(hào)自適應(yīng)采集系統(tǒng)的設(shè)計(jì)。該系統(tǒng)主要包括軟件和硬件兩部分：硬件主要采用FPGA芯片，AD7982-1，ADG406和運(yùn)放AD824來搭建硬件平臺(tái)；軟件包括FPGA程序和事后數(shù)據(jù)處理程序。系統(tǒng)采用動(dòng)態(tài)8位量化方式克服了固定8位量化對(duì)信號(hào)采集精度的影響，目前已成功用于產(chǎn)品中。
- 關(guān)鍵字： FPGA 多路 采集系統(tǒng) 模擬信號(hào)
基于CycloneII和MSP430的網(wǎng)絡(luò)數(shù)據(jù)加密實(shí)現(xiàn)
- 1引言隨著信息技術(shù)和網(wǎng)絡(luò)化進(jìn)程的發(fā)展，網(wǎng)絡(luò)通信安全問題日益突出?，F(xiàn)場(chǎng)可編程門陣列(FPGA)以其自...
- 關(guān)鍵字： MSP430 CycloneII 網(wǎng)絡(luò)數(shù)據(jù)加密 FPGA
SignalTapII ELA的FPGA在線調(diào)試技術(shù)
- 通過對(duì)FPGA內(nèi)部信號(hào)的捕獲測(cè)試，可以實(shí)現(xiàn)對(duì)系統(tǒng)設(shè)計(jì)缺陷的實(shí)時(shí)分析和修正。與外部測(cè)試設(shè)備相比，可以總結(jié)出SignalTapII ELA的幾點(diǎn)優(yōu)越性：不占用額外的I／O引腳，不占用PCB上的空間，不破壞信號(hào)的時(shí)序和完整性，不需額外費(fèi)用；從多方面證實(shí)，該測(cè)試手段可以減少調(diào)試時(shí)間，縮短設(shè)計(jì)周期。
- 關(guān)鍵字： SignalTapII FPGA ELA 在線調(diào)試
誰會(huì)在代工投資“盛宴”中缺席？
- 在前3年之前全球代工總是在看前4大的動(dòng)向，包括臺(tái)積電、聯(lián)電、中芯國際及特許。然而，臺(tái)積電一家獨(dú)大，聯(lián)電居老二似乎也相安無事。 自AMD分出Globalfoundries，及ATIC又兼并特許，再把Globalfoundries與特許合并在一起。表面上看少了一個(gè)特許，實(shí)際上由于Globalfoundries在其金主支持下積極建新廠，在代工業(yè)界引發(fā)了波浪,至少誰將成為老二成為話題。 加上存儲(chǔ)器大享三星近期開始投資代工，放言要接高通的手機(jī)芯片訂單;加上fabless大廠Xilinx改變策略，把2
- 關(guān)鍵字： 臺(tái)積電 FPGA 28nm
子帶分解的自適應(yīng)濾波器的FPGA實(shí)現(xiàn)
- 基于子帶分解的自適應(yīng)濾波器在提高收斂性能的同時(shí)又可以節(jié)省一定的計(jì)算量。采用Altera公司的仿真軟件Altera DSP Builder和QuartusⅡ7．2進(jìn)行子帶分解的NLMS算法的自適應(yīng)濾波器現(xiàn)場(chǎng)可編程門陣列設(shè)計(jì)，利用Simulink和ModelSim對(duì)設(shè)計(jì)方案進(jìn)行了模型仿真和功能仿真，達(dá)到較好的效果。
- 關(guān)鍵字： FPGA 分解 自適應(yīng)濾波器
常用FPGA/CPLD四種設(shè)計(jì)技巧
- 常用FPGA/CPLD四種設(shè)計(jì)技巧,FPGA/CPLD的設(shè)計(jì)思想與技巧是一個(gè)非常大的話題，本文僅介紹一些常用的設(shè)計(jì)思想與技巧，包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意，如果能有意識(shí)地利用這些原則指導(dǎo)日
- 關(guān)鍵字： 技巧 設(shè)計(jì) FPGA/CPLD 常用
AEMB軟核處理器的SoC系統(tǒng)驗(yàn)證平臺(tái)的構(gòu)建
- SoC芯片的規(guī)模一般遠(yuǎn)大于普通的ASIC，同時(shí)深亞微米工藝帶來的設(shè)計(jì)困難等使得SoC設(shè)計(jì)的復(fù)雜度大大提高。仿...
- 關(guān)鍵字： FPGA SoC 系統(tǒng)驗(yàn)證平臺(tái) AEMB 軟核處理器
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