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Spartan-3A 的 DDR 2 接口數(shù)據(jù)采集
- 1引言DDR2(DoubleDataRate2)SDRAM是由JEDEC(電子設(shè)備工程聯(lián)合委員會(huì))制定的新生代內(nèi)存技術(shù)標(biāo)準(zhǔn),它與上一...
- 關(guān)鍵字: DDR FPGA 接口 數(shù)據(jù)采集
FPGA+DSP核心架構(gòu)的實(shí)時(shí)三維圖像信息處理
- 三維圖像信息處理一直是圖像視頻處理領(lǐng)域的熱點(diǎn)和難點(diǎn),目前國(guó)內(nèi)外成熟的三維信息處理系統(tǒng)不多,已有的系統(tǒng)主要...
- 關(guān)鍵字: FPGA DSP 實(shí)時(shí)圖像處理
基于FPGA的160路數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
- 目前,數(shù)據(jù)采集系統(tǒng)對(duì)采樣率、分辨率和抗干擾能力的要求越來(lái)越高。尤其是在典型的多路采集+多路開(kāi)關(guān)+單路A/D轉(zhuǎn)換器的數(shù)據(jù)采集中,采集速度受到限制。為此,介紹了一種基于現(xiàn)場(chǎng)可編程門陣列(FPGA)的高速多路數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)和實(shí)現(xiàn)。采用模擬開(kāi)關(guān)級(jí)聯(lián)的方法,有效地達(dá)到了160路采集速度。采用該方法設(shè)計(jì)的采集卡能有效完成多路同步高速數(shù)據(jù)采集任務(wù),且成功地用于某裝置的輸出信號(hào)檢測(cè)。
- 關(guān)鍵字: FPGA 160 數(shù)據(jù)采集 系統(tǒng)設(shè)計(jì)
安全通信系統(tǒng)的FPGA實(shí)現(xiàn)
- 摘要:本文針對(duì)網(wǎng)絡(luò)通信過(guò)程中存在信息泄露、信息篡改、非法用戶入侵等安全威脅而設(shè)計(jì)的一套基于FPGA平臺(tái)的的網(wǎng)絡(luò)通信安全傳輸系統(tǒng)。 關(guān)鍵詞:網(wǎng)絡(luò)通信;FPGA;加密. 緒論 信息安全的解決方案目前主要集中于采取單一的措施來(lái)保證信息的安全性,針對(duì)各種攻擊手段,防范措施主要集中于信息加密技術(shù)、安全交換機(jī)技術(shù)、防火墻技術(shù)、認(rèn)證技術(shù),入侵檢測(cè)技術(shù)等,這些技術(shù)從不同的方面對(duì)安全性提供了較好的保障,但各有缺點(diǎn)和不足,這將成為網(wǎng)絡(luò)防護(hù)的軟肋,因此,本文也嘗試性地提出了一種集數(shù)據(jù)加密技術(shù)和訪問(wèn)控制策略于一體的信息
- 關(guān)鍵字: 網(wǎng)絡(luò)通信 FPGA 200812
基于Actel Fusion FPGA的無(wú)位置傳感器無(wú)刷電機(jī)控制
- 針對(duì)Actel公司推出的F1asion系列混合信號(hào)FPGA,介紹了一種基于nasion FPGA的無(wú)刷電機(jī)無(wú)位置傳感器的控制器。試驗(yàn)結(jié)果表明,采用Fusion混合信號(hào)FPGA的無(wú)刷電機(jī)控制器具有集成度高,性能穩(wěn)定,抗干擾能力強(qiáng),控制精度高等優(yōu)點(diǎn)。
- 關(guān)鍵字: Fusion Actel FPGA 無(wú)位置傳感器
數(shù)字下變頻的FPGA實(shí)現(xiàn)
- 摘要:本文介紹了數(shù)字下變頻的組成結(jié)構(gòu),并通過(guò)一個(gè)具體的實(shí)例,給出了FPGA實(shí)現(xiàn)的具體過(guò)程。 關(guān)鍵詞:FPGA;數(shù)字下變頻;VHDL 引言 數(shù)字化中頻(DIF)頻譜分析儀在高中頻實(shí)現(xiàn)數(shù)字化處理,具有分析帶寬大、RBW小、測(cè)量時(shí)長(zhǎng)短,可對(duì)復(fù)雜信號(hào)實(shí)施時(shí)—頻分析的功能,因而得到越來(lái)越廣泛的應(yīng)用。但由于現(xiàn)有的數(shù)字信號(hào)處理器(DSP)處理速度有限,往往難以對(duì)高速率A/D采樣得到的數(shù)字信號(hào)直接進(jìn)行實(shí)時(shí)處理。為了解決這一矛盾,需要采用數(shù)字下變頻(DDC)技術(shù),將采樣得到的高速率信號(hào)變成低速率基帶信
- 關(guān)鍵字: FPGA 200812
直擴(kuò)導(dǎo)航系統(tǒng)中數(shù)字科思塔斯環(huán)的FPGA設(shè)計(jì)與實(shí)現(xiàn)
- 引言 擴(kuò)頻接收機(jī)載波的同步包括捕獲和跟蹤兩個(gè)過(guò)程,載波捕獲即多普勒頻移的粗略估計(jì)通常包含在偽碼同步過(guò)程中,而精確的載波相位及多普勒頻移則通過(guò)FLL(鎖頻環(huán))和PLL(鎖相環(huán))跟蹤來(lái)實(shí)現(xiàn)。鎖頻環(huán)直接跟蹤載波頻率,而鎖相環(huán)則直接對(duì)載波相位進(jìn)行跟蹤。鎖相環(huán)具有較高的跟蹤精度,但對(duì)通信鏈路干擾的容忍能力差,特別是受載體動(dòng)態(tài)引入的多普勒頻移影響較大;而鎖頻環(huán)具有較好的動(dòng)態(tài)性能,但跟蹤精度較低。載波跟蹤環(huán)的跟蹤精度決定了最后定位測(cè)量的精度。常規(guī)接收機(jī)中載波跟蹤是在數(shù)字延遲鎖定環(huán)對(duì)偽碼相關(guān)解擴(kuò)的基礎(chǔ)上,通過(guò)科斯塔
- 關(guān)鍵字: FPGA 導(dǎo)航
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