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淺談FPGA設(shè)計(jì)原則與技巧
- 前言FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,作為專用集成電路領(lǐng)域中的一種半定制電路,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展下的產(chǎn)物。近幾年來(lái)由于FPGA器件的應(yīng)用十分廣泛,而F
- 關(guān)鍵字: FPGA 設(shè)計(jì)原則
基于FPGA的簡(jiǎn)易微型計(jì)算機(jī)結(jié)構(gòu)分析與實(shí)現(xiàn)
- 引 言通常,人們對(duì)微型計(jì)算機(jī)的工作原理及硬件結(jié)構(gòu)的了解來(lái)源于書本知識(shí),深入理解掌握其功能特點(diǎn)比較困難,要自己親手去做一個(gè)類似功能的微型計(jì)算機(jī)更是不可能。隨著可編程邏輯器件的廣泛應(yīng)用,為數(shù)字系統(tǒng)的設(shè)計(jì)帶來(lái)
- 關(guān)鍵字: FPGA 微型計(jì)算機(jī) 結(jié)構(gòu)分析
基于FPGA的數(shù)字電壓表的設(shè)計(jì)
- 0 引 言傳統(tǒng)的數(shù)字電壓表設(shè)汁通常以大規(guī)模ASIC(專用集成電路)為核心器件,并輔以少量中規(guī)模集成電路及顯示器件構(gòu)成。ASIC完成從模擬量的輸入到數(shù)字量的輸出,是數(shù)字電壓表的心臟。這種電壓表的設(shè)計(jì)簡(jiǎn)單、精確度高,但
- 關(guān)鍵字: FPGA 數(shù)字電壓表
基于Nios軟核處理器的溫備份智能容錯(cuò)系統(tǒng)設(shè)計(jì)方案
- 1 引 言隨著計(jì)算機(jī)應(yīng)用技術(shù)的發(fā)展,計(jì)算機(jī)應(yīng)用已經(jīng)早就從單機(jī)系統(tǒng)發(fā)展到網(wǎng)絡(luò)系統(tǒng)。但是隨著網(wǎng)絡(luò)系統(tǒng)的擴(kuò)大,要保證整個(gè)大系統(tǒng)的正常運(yùn)轉(zhuǎn)就遠(yuǎn)比保證單機(jī)系統(tǒng)的正常運(yùn)轉(zhuǎn)困難得多,不過(guò)只要處理好各個(gè)系統(tǒng)的協(xié)調(diào)關(guān)系以
- 關(guān)鍵字: Nios 軟核處理器 備份 智能容錯(cuò)系
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