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賽靈思基于業(yè)界首款統(tǒng)一可擴(kuò)展架構(gòu)的7系列FPGA全新登場(chǎng)
- 功耗銳減 50%，容量高達(dá) 200 萬(wàn)個(gè)邏輯單元 Virtex-7、Kintex-7 和 Artix-7 系列實(shí)現(xiàn)了突破性的低功耗、高系統(tǒng)性能與設(shè)計(jì)效率，可充分滿(mǎn)足新型應(yīng)用和市場(chǎng)需求 2010 年 6 月 22 日，中國(guó)北京訊 — 全球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX)）今天宣布推出業(yè)界首款采用唯一統(tǒng)一架構(gòu)、將整體功耗降低一半且具有業(yè)界最高容量（多達(dá) 200 萬(wàn)個(gè)邏輯單元）的 FPGA 系列產(chǎn)品，能滿(mǎn)足從低成本到超高端系列產(chǎn)品的擴(kuò)展需求。賽靈
- 關(guān)鍵字： 賽靈思 FPGA Virtex-7 Kintex-7 Artix-7
一種單片機(jī)和FPGA的遠(yuǎn)程溫度監(jiān)控系統(tǒng)
- 關(guān)鍵字： 遠(yuǎn)程溫度監(jiān)控 AT89S51 DS18B20 Nios II軟核處理器
基于FPGA實(shí)現(xiàn)的高速串行交換模塊實(shí)現(xiàn)方法研究
- 采用Xilinx公司的Virtex-5系列FPGA設(shè)計(jì)了一個(gè)用于多種高速串行協(xié)議的數(shù)據(jù)交換模塊，并解決了該模塊實(shí)現(xiàn)中的關(guān)鍵問(wèn)題。該交換模塊實(shí)現(xiàn)4X模式RapidIO協(xié)議與4X模式PCI Express協(xié)議之間的數(shù)據(jù)交換，以及自定義光纖協(xié)議與4X模式PCI Express協(xié)議之間的數(shù)據(jù)交換，實(shí)現(xiàn)了單字讀寫(xiě)以及DMA操作，并提供高速穩(wěn)定的傳輸帶寬。
- 關(guān)鍵字： FPGA 高速串行 模塊 實(shí)現(xiàn)方法
ModelSim+Synplify+Quartus的Altera FPGA的仿真實(shí)現(xiàn)
- ModelSim+Synplify+Quartus的Altera FPGA的仿真實(shí)現(xiàn),工作內(nèi)容:
1、設(shè)計(jì)一個(gè)多路選擇器，利用ModelSimSE做功能仿真；
2、利用Synplify Pro進(jìn)行綜合，生成xxx.vqm文件；
3、利用Quartus II導(dǎo)入xxx.vqm進(jìn)行自動(dòng)布局布線(xiàn)，并生成xxx.vo(Verilog
4、利用ModelSimSE做 - 關(guān)鍵字： 仿真 實(shí)現(xiàn) FPGA Altera Synplify Quartus ModelSim
對(duì)FPGA進(jìn)行系統(tǒng)設(shè)計(jì)的Xilinx軟件使用方法
- 對(duì)FPGA進(jìn)行系統(tǒng)設(shè)計(jì)的Xilinx軟件使用方法,Solution:在對(duì)FPGA設(shè)計(jì)進(jìn)行最初步的系統(tǒng)規(guī)劃的時(shí)候，需要進(jìn)行模塊劃分，模塊接口定義等工作。通常，我們只能在紙上進(jìn)行設(shè)計(jì)。雖然在紙上我們可以很隨意地書(shū)寫(xiě)，而用紙畫(huà)的不方便就在于，如果對(duì)某一個(gè)模塊進(jìn)行較大改動(dòng)
- 關(guān)鍵字： 軟件 使用方法 Xilinx 設(shè)計(jì) 進(jìn)行 系統(tǒng) FPGA
基于FPGA過(guò)采樣技術(shù)及實(shí)現(xiàn)
- 過(guò)采樣技術(shù)應(yīng)用于通用模塊時(shí)，低通濾波器的參數(shù)隨著下抽取率不同而發(fā)生改變。本文設(shè)計(jì)了適合通用模塊應(yīng)用的可變參數(shù)低通濾波器，并利用FPGA進(jìn)行實(shí)現(xiàn)。模塊測(cè)試結(jié)果表明：可變參數(shù)濾波器設(shè)計(jì)合理，基于FPGA的過(guò)采樣模塊最高分辨率可達(dá)25bit/s。
- 關(guān)鍵字： 可變參數(shù)濾波器 FPGA 過(guò)采樣 插值濾波器 201006
基于FPGA的電網(wǎng)實(shí)時(shí)數(shù)據(jù)采集與控制
- 為了消除FFT頻譜泄漏和柵欄效應(yīng)，提高諧波分析精度，文中給出了用高速A／D采集IPcore來(lái)實(shí)現(xiàn)電網(wǎng)數(shù)據(jù)實(shí)時(shí)采集的設(shè)計(jì)方法，同時(shí)采用數(shù)字鎖相倍頻同步方法進(jìn)行了誤差修正。其中全數(shù)字鎖相倍頻電路和A／D采集控制電路均采用VHDL語(yǔ)言和可編程邏輯器件設(shè)計(jì)實(shí)現(xiàn)，并用quartusII軟件進(jìn)行了仿真。
- 關(guān)鍵字： FPGA 電網(wǎng)實(shí)時(shí) 數(shù)據(jù)采集
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