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          基于FPGA的混沌加密虹膜識別系統(tǒng)設(shè)計(二)

          •   7.1.3 虹膜外邊緣的確定   (1) 虹膜外邊緣的特征分析   由圖1中所示的虹膜圖像可以看出,虹膜外邊緣的主要特點是:較相對與虹膜內(nèi)邊緣而言,邊緣處灰度變化不是特別明顯,有一小段漸變的區(qū)域。也就是說,虹膜內(nèi)部灰度趨近于一致這個事實,在參考文獻[8]中,介紹的環(huán)量積分算子應(yīng)該式是一種有效的方法。   即:    ?   (7-10)   (2) 采用環(huán)量積分算子實現(xiàn)虹膜外邊緣的檢測   如上分析,虹膜環(huán)量積分算子是檢測虹膜外邊緣的一種有效手段,為了克服虹膜紋理對環(huán)量線
          • 關(guān)鍵字: FPGA  虹膜識別  CMOS  

          基于FPGA的混沌加密虹膜識別系統(tǒng)設(shè)計(一)

          •   項目信息   1.項目名稱:基于FPGA的混沌加密虹膜識別系統(tǒng)設(shè)計   2.應(yīng)用領(lǐng)域:工業(yè)控制、科研、醫(yī)療、安檢   3.設(shè)計摘要:   基于虹膜的生物識別技術(shù)是一種最新的識別技術(shù),通過一定的虹膜識別算法,可以達到十分優(yōu)異的準確性。隨著虹膜識別技術(shù)的發(fā)展,它的應(yīng)用領(lǐng)域越來越寬,不僅在高度機密場所應(yīng)用,并逐步推廣到機場、銀行、金融、公安、出入境口岸、安全、網(wǎng)絡(luò)、電子商務(wù)等場合。在研究了虹膜識別算法,即預(yù)處理、特征提取和匹配的基礎(chǔ)上,我們設(shè)計了一種可便攜使用的基于FPGA的嵌入式虹膜識別系統(tǒng)。本系
          • 關(guān)鍵字: FPGA  虹膜識別  CMOS  

          基于svpwm變頻調(diào)速的雙電機控制算法應(yīng)用

          •   1.引言   隨著工業(yè)技術(shù)的發(fā)展,在航空、軍事、機械制造領(lǐng)域等需要多個電機同時驅(qū)動一個或多個工作部件進行協(xié)調(diào)控制的場合越來越多。傳統(tǒng)的控制系統(tǒng)多采用單一電機實現(xiàn)單軸控制,電機的輸出轉(zhuǎn)矩有一定的限制,當傳動系統(tǒng)需要較大的驅(qū)動功率時,必須特制功率與之相匹配的驅(qū)動電機和驅(qū)動器,使得系統(tǒng)的成本上升,而且過大的輸出功率的電機受到制造工藝和電機性能的影響,大功率的驅(qū)動器的研制也會受到半導(dǎo)體功率器件的限制[1].電機在實時跟隨同一目標轉(zhuǎn)速的同時。還需要保持兩電機問的轉(zhuǎn)速同步,否則便會導(dǎo)致后面的機械傳動精度下降。針
          • 關(guān)鍵字: svpwm  電機控制  PWM  

          基于SoC FPGA進行工業(yè)設(shè)計及電機控制

          •   引言   在工業(yè)系統(tǒng)中選擇器件需要考慮多個因素,其中包括:性能、工程變更的成本、上市時間、人員的技能、重用現(xiàn)有IP/程序庫的可能性、現(xiàn)場升級的成本,以及低功耗和低成本。   工業(yè)市場的近期發(fā)展推動了對具有高集成度、高性能、低功耗FPGA器件的需求。設(shè)計人員更喜歡網(wǎng)絡(luò)通信而不是點對點通信,這意味著可能需要額外的控制器用于通信,進而間接增加了BOM成本、電路板尺寸和相關(guān)NRE(一次性工程費用)成本。   總體擁有成本用于分析和估計購置的壽命周期成本,它是所有與設(shè)計相關(guān)的直接和間接成本的擴展集,包括工
          • 關(guān)鍵字: FPGA  SoC  永磁同步電機  

          FPGA研發(fā)之道(10)架構(gòu)設(shè)計漫談(五)數(shù)字電路的靈魂-流水線

          •   流水線,最早為人熟知,起源于十九世紀初的福特汽車工廠,富有遠見的福特,改變了那種人圍著汽車轉(zhuǎn)、負責(zé)各個環(huán)節(jié)的生產(chǎn)模式,轉(zhuǎn)變成了流動的汽車組裝線和固定操作的人員。于是,工廠的一頭是不斷輸入的橡膠和鋼鐵,工廠的另一頭則是一輛輛正在下線的汽車。這種改變,不但提升了效率,更是拉開了工業(yè)時代大生產(chǎn)的序幕。   如今,這種模式常常應(yīng)用于數(shù)字電路的設(shè)計之中,與現(xiàn)在流驅(qū)動的FPGA架構(gòu)不謀而合。舉例來說:某設(shè)計輸入為A種數(shù)據(jù)流,而輸出則是B種數(shù)據(jù)流,其流水架構(gòu)如下所示:    ?   每個模塊只
          • 關(guān)鍵字: FPGA  架構(gòu)設(shè)計  流水線  

          FPGA研發(fā)之道(9)架構(gòu)設(shè)計漫談(四)并行與復(fù)用

          •   FPGA其在眾多器件中能夠被工程師青睞的一個很重要的原因就是其強悍的處理能力。那如何能夠做到高速的數(shù)據(jù)處理,數(shù)據(jù)的并行處理則是其中一個很重要的方式。   數(shù)據(jù)的并行處理,從結(jié)構(gòu)上非常簡單,但是設(shè)計上卻是相當復(fù)雜,對于現(xiàn)有的FPGA來說,雖然各種FPGA的容量都在增加,但是在有限的邏輯中達到更高的處理能力則是FPGA工程師面臨的挑戰(zhàn)。常用并行計算結(jié)構(gòu)如下圖所示:    ?   上圖中:前端處理單元負責(zé)將進入數(shù)據(jù)信息,分配到多個計算單元中,圖中為3個計算單元(幾個根據(jù)所需的性能計算得
          • 關(guān)鍵字: FPGA  架構(gòu)設(shè)計  并行  

          FPGA研發(fā)之道(8)架構(gòu)設(shè)計漫談(三)時鐘和復(fù)位

          •   接口確定以后,F(xiàn)PGA內(nèi)部如何規(guī)劃?首先需要考慮就是時鐘和復(fù)位。   時鐘:根據(jù)時鐘的分類,可以分為邏輯時鐘,接口時鐘,存儲器時鐘等;   (1)邏輯時鐘取決與邏輯的關(guān)鍵路徑,最終值是設(shè)計和優(yōu)化的結(jié)果,從經(jīng)驗而不是實際出發(fā):低端FPGA(cyclone spantan)工作頻率在40-80Mhz之間,而高端器件(stratix virtex)可達100-200Mhz之間,根據(jù)各系列的先后性能會有所提升,但不是革命性的。   (2)接口時鐘,異步信號的時序一般也是通過FPGA片內(nèi)同步邏輯產(chǎn)生,一般
          • 關(guān)鍵字: FPGA  架構(gòu)設(shè)計  復(fù)位  

          FPGA研發(fā)之道(7)架構(gòu)設(shè)計漫談(二)穩(wěn)定壓倒一切

          •   敏捷開發(fā)宣言中,有一條定律是“可以工作的軟件勝過面面俱到的文檔”。如何定義可可以工作的,這就是需求確定后架構(gòu)設(shè)計的首要問題。而大部分看這句話的同志更喜歡后半句,用于作為不寫文檔的借口。   FPGA的架構(gòu)設(shè)計最首先可以確定就是外接接口,就像以前說的,穩(wěn)定可靠的接口是成功的一半。接口的選擇需要考慮幾個問題。   1, 有無外部成熟IP。一般來說,ALTERA和XILINX都提供大量的接口IP,采用這些IP能夠提升研發(fā)進度,但不同IP在不同F(xiàn)PGA上需要不同license,這個
          • 關(guān)鍵字: FPGA  ALTERA  XILINX  

          FPGA研發(fā)之道(6)架構(gòu)設(shè)計漫談(一)流驅(qū)動和調(diào)用式

          •   勿用諱言,現(xiàn)在國內(nèi)FPGA開發(fā)還處于小作坊的開發(fā)階段,一般都是三、四個人,七八臺機器.小作坊如何也能做出大成果。這是每個FPGA工程師都要面臨的問題。架構(gòu)設(shè)計是面臨的第一關(guān)。經(jīng)常有這樣的項目,需求分析,架構(gòu)設(shè)計匆匆忙忙,號稱一兩個月開發(fā)完畢,實際上維護項目就花了一年半時間。主要包括幾個問題,一,性能不滿足需求。二,設(shè)計頻繁變更。三,系統(tǒng)不穩(wěn)定,調(diào)試問題不收斂。   磨刀不誤砍柴工,F(xiàn)PGA設(shè)計的需求分析是整個設(shè)計第一步。如何將系統(tǒng)的功能需求,轉(zhuǎn)換成FPGA的設(shè)計需求,是FPGA架構(gòu)設(shè)計的首要問題。首
          • 關(guān)鍵字: FPGA  架構(gòu)設(shè)計  SOPC  

          基于DDS的頻譜分析儀設(shè)計

          •   1 引言   直接數(shù)字頻率合成(DDS)是近幾年一種新型的頻率合成法,其具有頻率切換速度快,頻率分辨率高,以及便于集成等優(yōu)點。在此,設(shè)計了基于DDS的頻譜分析儀,該頻譜分析儀依據(jù)外差原理,被測信號與本征頻率混頻,實現(xiàn)信號的頻譜分析。   2 系統(tǒng)設(shè)計   圖1給出系統(tǒng)設(shè)計框圖,主要由本機振蕩電路、混頻電路、放大檢波電路、頻譜輸出顯示電路等組成。通過單片機和現(xiàn)場可編程門陣列(FPGA)共同控制AD985l,以產(chǎn)生正弦掃頻輸出信號,然后經(jīng)濾波、程控放大得到穩(wěn)定輸出,與經(jīng)放大處理的被測信號混頻,再經(jīng)放
          • 關(guān)鍵字: DDS  FPGA  AD985l  

          基于FPGA的簡易頻譜分析儀

          •   1 引言   目前,由于頻譜分析儀價格昂貴,高等院校只是少數(shù)實驗室配有頻譜儀。但電子信息類教學(xué),如果沒有頻譜儀輔助觀察,學(xué)生只能從書本中抽象理解信號特征,嚴重影響教學(xué)實驗效果。   針對這種現(xiàn)狀提出一種基于FPGA的簡易頻譜分析儀設(shè)計方案,其優(yōu)點是成本低,性能指標滿足教學(xué)實驗所要求的檢測信號范圍。   2 設(shè)計方案   圖1為系統(tǒng)設(shè)計總體框圖。該系統(tǒng)采用C8051系列單片機中的 C8051F121作為控制器,CvcloneⅢ系列EP3C40F484C8型FPGA為數(shù)字信號算法處理單元。系統(tǒng)設(shè)計
          • 關(guān)鍵字: FPGA  頻譜分析儀  AD603  

          基于NIOS II的頻譜分析儀的設(shè)計與研制

          •   頻譜分析儀是微電子測量領(lǐng)域中最基礎(chǔ)、最重要的測量儀器之一,是從事各種電子產(chǎn)品研發(fā)、生產(chǎn)、檢驗的重要工具。高分辨率、寬頻帶數(shù)字頻譜分析的方法和實現(xiàn)一直是該領(lǐng)域的研究熱點[1]?,F(xiàn)代頻譜分析儀是基于現(xiàn)代數(shù)字信號處理理論的頻譜分析儀,信號經(jīng)過前置預(yù)處理、抗混疊濾波、A/D變換、數(shù)字頻譜分析等環(huán)節(jié)而得到信號中的頻率分量, 達到與傳統(tǒng)頻譜分析儀同樣的結(jié)果。   本設(shè)計完全利用FPGA實現(xiàn)FFT,在FPGA上實現(xiàn)整個系統(tǒng)構(gòu)建。其中CPU選用Altera公司的Nios II軟核處理器進行開發(fā), 硬件平臺關(guān)鍵模塊使
          • 關(guān)鍵字: NIOS II  頻譜分析儀  FPGA  

          基于手機藍牙控制的LED燈的設(shè)計

          •   1.引言   隨著,2012年10月30日飛利浦在AppleStore出售最新的高科技Hue系列LED燈,并且只會交由蘋果出售。Hue系列將是完全可有自定義的,并且通過一個燈泡內(nèi)紅藍綠三原色的LED可以混合出1600萬種顏色的燈光。整個過程完全由iPhone上的App來進行控制。從而引發(fā)了智能燈控發(fā)展的新思考,國內(nèi)相關(guān)人士也紛紛進行研究。考慮到Hue是采用WiFi無線控制,而國內(nèi)WiFi并未普及,本研究采用更普遍的藍牙技術(shù),采用手機藍牙與單片機通信產(chǎn)生可調(diào)占空比PWM波信號控制LED驅(qū)動電路實現(xiàn)LE
          • 關(guān)鍵字: LED  PWM  藍牙模塊  

          基于FPGA的SPWM變頻系統(tǒng)設(shè)計與實現(xiàn)

          •   由于脈寬調(diào)制技術(shù)是通過調(diào)整輸出脈沖的頻率及占空比來實現(xiàn)輸出電壓的變壓變頻效果,所以在電機調(diào)速、逆變器等眾多領(lǐng)域得到了日益廣泛的應(yīng)用。   而電磁法作為一種地球物理探測的有效方法,已經(jīng)廣泛地應(yīng)用于礦藏勘探、地質(zhì)災(zāi)害預(yù)測等領(lǐng)域。電磁法儀一般包括發(fā)射機和接收機兩大部分?,F(xiàn)階段,電磁法儀器的發(fā)射機部分一般直接采用等寬PWM技術(shù),其電流諧波畸變率較大,電壓利用率不高,效率很低。   本文利用FPGA技術(shù),根據(jù)SPWM自然采樣法原理,設(shè)計了應(yīng)用于電磁法儀的發(fā)射機的SPWM系統(tǒng)。該系統(tǒng)應(yīng)用到現(xiàn)有的電磁法儀器中,
          • 關(guān)鍵字: FPGA  SPWM  Matlab  

          基于SOPC的SPWM脈沖發(fā)生器的實現(xiàn)

          •   隨著電力電子開關(guān)器件及技術(shù)的不斷發(fā)展,SPWM(正弦波脈寬調(diào)制)技術(shù)在逆變控制領(lǐng)域得到廣泛應(yīng)用。傳統(tǒng)的SPWM驅(qū)動芯片速度慢、不夠靈活,存在著電路設(shè)計復(fù)雜、體積大、抗干擾能力差、設(shè)計周期長等缺點,對于許多有特殊要求的場合,由專用芯片很難滿足實際的要求,因此,本文采用Altera公司的EP2C35F672C8N開發(fā)一種基于可編程片上系統(tǒng)的SPWM脈沖波形電路,SOPC技術(shù)將微處理器和SP-WM波形電路整合到一塊FPGA器件當中。可編程的片上系統(tǒng)SOPC(System 0n Programmable Ch
          • 關(guān)鍵字: SOPC  SPWM  FPGA  
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          fpga-pwm介紹

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