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Altera宣布可立即提供下一代非易失MAX 10 FPGA和評估套件
- Altera公司今天宣布開始提供非易失MAX® 10 FPGA，這是Altera第10代系列產(chǎn)品中的最新型號。使用TSMC的55 nm嵌入式閃存工藝技術(shù)，MAX 10 FPGA這一革命性的非易失FPGA在小外形封裝、低成本和瞬時接通可編程邏輯器件封裝中包含了雙配置閃存、模擬和嵌入式處理功能。MAX 10 FPGA現(xiàn)在已經(jīng)開始發(fā)售，由多種設(shè)計解決方案提供支持，這些方案加速了系統(tǒng)開發(fā)，包括Quartus® II軟件、評估套件、設(shè)計實例，以及通過Altera設(shè)計服務(wù)網(wǎng)絡(luò)(DSN)提供的設(shè)計服
- 關(guān)鍵字： Altera FPGA MAX 10
使用SoC FPGA進行工業(yè)設(shè)計和電機控制
- 在工業(yè)系統(tǒng)中選擇器件需要考慮多個因素，其中包括：性能、工程變更的成本、上市時間、人員的技能、重用現(xiàn)有IP/程序庫的可能性、現(xiàn)場升級的成本，以及低功耗和低成本。 工業(yè)市場的近期發(fā)展推動了對具有高集成度、高性能、低功耗FPGA器件的需求。設(shè)計人員更喜歡網(wǎng)絡(luò)通信而不是點對點通信，這意味著可能需要額外的控制器用于通信，進而間接增加了BOM成本、電路板尺寸和相關(guān)NRE(一次性工程費用)成本?！ 】傮w擁有成本用于分析和估計購置的壽命周期成本，它是所有與設(shè)計相關(guān)的直接和間接成本的擴展集，包括工程技術(shù)成本、安裝和維
- 關(guān)鍵字： FPGA 電機控制
基于FPGA的m序列信號發(fā)生器設(shè)計
- m序列是一種偽隨機序列(PN碼)，廣泛用于數(shù)據(jù)白噪化、去白噪化、數(shù)據(jù)傳輸加密、解密等通信、控制領(lǐng)域?；贔PGA與Verilog硬件描述語言設(shè)計井實現(xiàn)了一種數(shù)據(jù)率按步進可調(diào)、低數(shù)據(jù)誤碼率、反饋多項式為 的m序列信號發(fā)生器。系統(tǒng)時鐘為20MHz，m序列信號發(fā)生器輸出的數(shù)據(jù)率為20～100 kbps，通過2個按鍵實現(xiàn)20 kbps步進可調(diào)與系統(tǒng)復(fù)位，輸出誤碼率小于1%. m序列是最長線性反饋移位寄存器序列的簡稱，它是由帶線性反饋的移位寄存器產(chǎn)生的周期最長的一種偽隨機
- 關(guān)鍵字： FPGA m序列 信號發(fā)生器
反熔絲FPGA在密碼芯片設(shè)計中的運用
- 詳細介紹了反熔絲FPGA在提高密碼芯片速度和對密碼算法進行保護方面的應(yīng)用，并給出了密碼算法芯片中部分模塊的實現(xiàn)方法。 1引言 隨著計算機和通信的發(fā)展，信息傳輸過程中信息安全的重要性越來越受到人們的重視。在信息傳輸過程中，人們普遍采用將待傳輸?shù)男畔⒓用苓M行傳輸，然后在收端進行解密還原信息。對信息的加解密通常采用兩種方法：軟件加解密和硬件加解密。軟件加解密實現(xiàn)簡單，但須對密碼算法進行多重保護存放且加解密速度較慢，而硬件加解密可加快加解密運行速度。在當(dāng)今信息網(wǎng)絡(luò)化的環(huán)境下，對加密的速度要求將越來
- 關(guān)鍵字： FPGA 反熔絲 QUICKLOGIC
FLASH和反熔絲類型的FPGA你了解多少
- 由于航天應(yīng)用對可靠性提出了更高的要求，這是與一般的FPGA開發(fā)最大的不同。當(dāng)高能粒子撞擊可編程邏輯器件時，撞擊的能量會改變器件中的可配置的SRAM單元的配置數(shù)據(jù)，使系統(tǒng)運行到無法預(yù)知的狀態(tài)，從而引起整個系統(tǒng)失效。這在航天設(shè)備中是必須要避免的。以FLASH和反熔絲技術(shù)為基礎(chǔ)的FPGA與以SRAM為基礎(chǔ)的FPGA相比，在抗單粒子事件方面具有很大的優(yōu)勢，可靠性高。 ACTEL公司是可編程邏輯解決方案供應(yīng)商。它提供了多種服務(wù)，包括基于反熔絲和閃存技術(shù)的FPGA、高性能IP核、軟件開發(fā)工具和設(shè)計服務(wù)，定位
- 關(guān)鍵字： FPGA FLASH 反熔絲
Maxim Integrated推出面向Arduino平臺的Pmod?適配器，有效加速開發(fā)進程
- Maxim Integrated Products推出Pmod - Arduino適配器(MAXREFDES72#)，加速各種量產(chǎn)傳感器的原型開發(fā)。MAXREFDES72#可將任何連有Pmod的電路板方便地接入Arduino兼容微控制器平臺。該款適配器采用Maxim業(yè)內(nèi)領(lǐng)先的器件，能夠快速實現(xiàn)物聯(lián)網(wǎng)設(shè)計，并與更多的數(shù)字處理器和應(yīng)用方便對接。 長期以來，Pmod模塊始終是將專業(yè)級外設(shè)整合到工程原型開發(fā)(尤其是FPGA平臺)的保障。MAXREFDES72#實現(xiàn)了Pmod與Arduino兼容平臺之間的
- 關(guān)鍵字： Maxim Integrated Arduino FPGA
艾德克斯針對LED Driver測試的解決方案
- 摘要：近年來，LED照明產(chǎn)品以其耗電量低、使用壽命長、高亮度、低熱能、綠色環(huán)保、堅固耐用、色彩豐富、產(chǎn)品外觀多樣化、性能穩(wěn)定等特點越來越多地受到世界各地人們的關(guān)注，一路由戶外向室內(nèi)照明應(yīng)用市場發(fā)展。而要在LED市場上立于不敗之地，其“高可靠性”越來越成為LED產(chǎn)品最重要的特性。而LED電源的品質(zhì)直接制約了LED產(chǎn)品的可靠性。 引言 目前的LED恒流源產(chǎn)業(yè)，通常采用CR和CV兩種傳統(tǒng)模式進行測試，但由于LED驅(qū)動電源大多采用開關(guān)原理設(shè)計而成，因此存在較大的電流和電壓紋
- 關(guān)鍵字： 艾德克斯 LED PWM 浪涌電流 電子負載 201410
環(huán)路供電變送器設(shè)計權(quán)衡考量
- 摘要：環(huán)路供電變送器已經(jīng)從純粹的模擬信號調(diào)理器發(fā)展為高度靈活的智能變送器，但所選擇的設(shè)計方法仍取決于系統(tǒng)的性能、功能和成本要求。本文提供了三種不同的經(jīng)基準測試的變送器設(shè)計。 在環(huán)路供電設(shè)計中，4~20mA的環(huán)路同時提供電源和數(shù)據(jù)，所以系統(tǒng)回路的工作電流必須小于4mA。事實上，小于或等于3.6mA的電流是比較典型的目標(biāo)值，這是由于其對于環(huán)路屬于低報警電流。設(shè)計中的其它重要考慮因素是最終性能、功能、尺寸和成本。 我們討論的第一個電路(圖1)采用純模擬信號鏈。 該電路測量一個由5V基準
- 關(guān)鍵字： 變送器 傳感器 RTD PWM 環(huán)路供電 201410
英蓓特科技推出功能完善的SoC FPGA開發(fā)套件Lark Board
- 英蓓特科技日前宣布推出基于Altera Cyclone® V SoC的高性能開發(fā)板Lark Board。Lark Board專為大容量數(shù)據(jù)應(yīng)用的開發(fā)而設(shè)計，適用于汽車、醫(yī)療設(shè)備、視頻監(jiān)控和工業(yè)控制等領(lǐng)域。 Altera大中華銷售總監(jiān)Jeff Li表示：“Lark Board的問世使開發(fā)人員能夠更加高效地利用Cyclone V SoC在架構(gòu)、密度和性能上的優(yōu)勢，這為他們進行嵌入式系統(tǒng)設(shè)計開發(fā)提供了一個功能完整且強大的開發(fā)平臺。” Lark Board采用5CS
- 關(guān)鍵字： Altera SoC FPGA
一種基于HD-SDI技術(shù)的高清圖像處理系統(tǒng)設(shè)計
- 摘要：隨著圖像處理技術(shù)及傳感器技術(shù)的不斷發(fā)展，高清數(shù)字圖像取代模擬圖像成為一種趨勢。設(shè)計了一種基于HD-SDI技術(shù)的高清圖像處理系統(tǒng)，可通過FPGA+DSP架構(gòu)對1080P全高清圖像進行采集和字符疊加，并實時進行目標(biāo)提取和偏差量計算。疊加視頻可通過DVI數(shù)字接口或模擬接口實時顯示。利用圖像高分辨率特性，系統(tǒng)可實現(xiàn)運動目標(biāo)精確跟蹤。 引言 隨著數(shù)字視頻的迅速發(fā)展，高清數(shù)字圖像代替模擬圖像成為必然趨勢。光電系統(tǒng)采用全高清圖像技術(shù)，不僅能大大提高顯示效果，而且能顯著提高系統(tǒng)的跟蹤精度。因此，高清
- 關(guān)鍵字： HD-SDI DSP FPGA
基于FPGA的高速訪問USB設(shè)備設(shè)計
- 摘要：針對FPGA訪問USB設(shè)備存在傳輸速率低、資源消耗大、開發(fā)復(fù)雜的缺點，提出了一種將ARM處理器與FPGA相結(jié)合實現(xiàn)高速訪問USB設(shè)備的方案。該方案利用ARM處理器的USB Host讀取USB設(shè)備數(shù)據(jù)井緩存于高速內(nèi)存，采用乒乓機制通過SRAM接口將數(shù)據(jù)傳給FPGA。經(jīng)測試，數(shù)據(jù)傳輸速率可以達到48 Mbps。該方案具有開發(fā)難度小，資源占用率低和傳輸速率高的特點，適合于FPGA高速讀取大量外部數(shù)據(jù)。 引言 目前FPGA通過USB接口獲取USB設(shè)備中數(shù)據(jù)的方案大致分為兩大類，一類為在FPG
- 關(guān)鍵字： FPGA USB CH376
萊迪斯和賽普拉斯聯(lián)手推出新開發(fā)套件簡化USB 3.0視頻橋接器的設(shè)計
- 萊迪斯半導(dǎo)體公司和賽普拉斯半導(dǎo)體公司日前宣布，在Intel開發(fā)者大會(IDF)上推出一款具有完整參考設(shè)計的低成本開發(fā)套件，用于USB 3.0視頻橋接器的開發(fā)。全新萊迪斯USB 3.0視頻橋接器開發(fā)套件簡化了USB 3.0音頻和高清視頻的集成，可用于諸多應(yīng)用領(lǐng)域。該套件采用了萊迪斯的ECP3™ FPGA系列和賽普拉斯的EZ-USB® FX3™ USB 3.0外設(shè)控制器。 USB 3.0的5 Gbps帶寬可順利傳輸高清視頻，而無需會降低圖像質(zhì)量的壓縮過程。萊迪斯USB
- 關(guān)鍵字： 萊迪斯 USB 3.0 FPGA
Pico示波器在故障診斷中的應(yīng)用
- 當(dāng)今，工程師面臨著越來越嚴苛和復(fù)雜的測試任務(wù)。有時候設(shè)備在實驗中能夠正常工作，但是在實際現(xiàn)場應(yīng)用時，就會出現(xiàn)這樣那樣的問題，從而導(dǎo)致設(shè)備無法正常運行。一旦出現(xiàn)問題，一方面會引起客戶的不滿，一方面可能會造成生產(chǎn)損失，昂貴的維修費用，甚至帶來安全隱患。每當(dāng)這個時候，客戶總是希望現(xiàn)場應(yīng)用工程師能夠快速準確的進行故障定位并維修以便于他們恢復(fù)生產(chǎn)，這就給故障診斷工程師帶來了巨大的挑戰(zhàn)。 現(xiàn)場診斷時，工程師往往需要隨身攜帶一套小巧輕便、但功能強大的分析工具，捕捉波形異常，例如 定時錯誤、串?dāng)_、瞬態(tài)、電源質(zhì)量
- 關(guān)鍵字： 示波器 PicoScope FPGA
Digilent Nexys3 FPGA開發(fā)板評測（一）
- FPGA即現(xiàn)場可編程門陣列，屬于可編程邏輯器件的一種。隨著工藝的進步和EDA設(shè)計工具的不斷發(fā)展，F(xiàn)PGA已經(jīng)成為實現(xiàn)數(shù)字系統(tǒng)的主流平臺之一。FPGA的集成度越來越高，功耗和成本卻在降低，所以其應(yīng)用領(lǐng)域也越來越廣。對于硬件工程師來說，器件的選型和資源評估變得更重要?！ ‘?dāng)我們要選擇FPGA開發(fā)板的時候，首先要問的問題是我們能得到什么以及我們準備用它來做什么?對于初學(xué)者來說FPGA是令人生畏的，不過如果有一個好的開發(fā)板能達到事半功倍的效果，會發(fā)現(xiàn)入門并不困難。接下來我們來看看Digilent公司推出的Ne
- 關(guān)鍵字： FPGA Nexys3 Xilinx Spartan6
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歡迎您創(chuàng)建該詞條，闡述對fpga-pwm的理解，并與今后在此搜索fpga-pwm的朋友們分享。 創(chuàng)建詞條
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