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萊迪思和HELION TECHNOLOGY發(fā)布了適用于LatticeECP3 FPGA系列的壓縮和加密IP核
- 萊迪思半導(dǎo)體公司和Helion Technology今日宣布一系列適用于LatticeECP3 FPGA系列的壓縮和加密的IP核現(xiàn)已上市。該系列具有有效載荷壓縮系統(tǒng)核，提高了有限信道帶寬的利用率，因此非常適合微波回程應(yīng)用、寬帶無線接入適用于802.16e（WiMAX）以及潛在的其他多鏈路多輸入-多輸出（MIMO）應(yīng)用中的使用。在LatticeECP3器件中，IP核可以從500Mbps無縫擴展至超過3Gbps，并可用于典型的網(wǎng)絡(luò)應(yīng)用中的第2層或第3層。IP核采用了非常強大和成熟的LZRW無損壓縮算法，它
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Altera、Apical和AltaSens聯(lián)合發(fā)布HD寬動態(tài)范圍視頻監(jiān)控芯片組
- 延續(xù)其在高清晰(HD)寬動態(tài)范圍(WDR)監(jiān)控攝像機解決方案上的領(lǐng)先優(yōu)勢，Altera公司、Apical有限公司(UK)以及AltaSens有限公司今天宣布，開始提供業(yè)界第一款HD WDR視頻監(jiān)控芯片組。這一獨特的芯片組結(jié)合了Altera Cyclone® IV E FPGA和安全芯片，支持Apical的HD WDR全圖像信號處理(ISP)流水線IP和AltaSens的1080p60 A3372E3-4T圖像傳感器。這一獨特的解決方案能夠方便的使用Apical IP，降低了用戶在全傳感器處理解
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一種密鑰可配置的DES加密算法的FPGA
- 一種密鑰可配置的DES加密算法的FPGA,摘 要： 在傳統(tǒng)的DES加密算法的基礎(chǔ)上，提出一種對密鑰實行動態(tài)管理的硬件設(shè)計方案，給出了其FPGA實現(xiàn)方法。通過對DES加密原理的分析，利用其子密鑰的生成與核心算法相關(guān)性較弱的特點，對密鑰進行重新配置。DES算法采
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DES 線性反饋移位寄存器 混沌加密 FPGA
隨著密碼學(xué)技術(shù)的飛速發(fā)展，軟件加密已經(jīng)非常流行，但由于硬件加密的穩(wěn)定性和兼容性更好而且速度更快，所以仍是商業(yè)和軍事用途的主要選擇。而FPGA在實現(xiàn)算法方面具有靈活性、物理安全性和比軟件更高的速度性能，已成為硬件實現(xiàn)加密算法的最好選擇。
基于FPGA的多路圖像采集系統(tǒng)的軟件設(shè)計
- 摘要：分析了現(xiàn)有的視頻采集方案的研究現(xiàn)狀，對如何采用CCD攝像頭采集多通道、高分辨率、高質(zhì)量的圖像以及基于FPGA的嵌入式圖像采集系統(tǒng)的實現(xiàn)方法做了研究。與傳統(tǒng)圖像采集系統(tǒng)相比，該系統(tǒng)主要利用四片視頻解碼芯片
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基于FPGA的空間目標(biāo)碰撞預(yù)警系統(tǒng)
- 摘要：為了解決空間目標(biāo)與航天器發(fā)生碰撞的問題，設(shè)計了一種基于FPGA，以在軌目標(biāo)三維坐標(biāo)為待處理數(shù)據(jù)進行快速并行處理的目標(biāo)碰撞預(yù)警系統(tǒng)。該系統(tǒng)基于Xilinx公司FPGA芯片中的內(nèi)容可尋址存儲器(Content Addressable
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寬帶數(shù)字信道化接收機的FPGA實現(xiàn)
- 摘要：為解決現(xiàn)代電子戰(zhàn)對接收機處理帶寬寬、靈敏度高及實時性處理的要求，提出一種數(shù)字信道化接收機的設(shè)計方法。在推導(dǎo)高效信道化接收機模型的基礎(chǔ)上，采用多相濾波器結(jié)構(gòu)實現(xiàn)的數(shù)字信道化接收機。該接收機利用超高
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