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Xilinx CEO 描繪公司新愿景與戰(zhàn)略藍(lán)圖
- 自適應(yīng)和智能計算的全球領(lǐng)先企業(yè)賽靈思公司(Xilinx,?Inc.)總裁兼首席執(zhí)行官(CEO)Victor?Peng?，今天揭示了公司的未來愿景與戰(zhàn)略藍(lán)圖。Peng?的愿景旨在為賽靈思帶來新發(fā)展、新技術(shù)和新方向，打造“自適應(yīng)計算加速平臺”。在該世界中，賽靈思將超越?FPGA?的局限，推出高度靈活且自適應(yīng)的全新處理器及平臺產(chǎn)品系列，為用戶從端點到邊緣再到云端多種不同技術(shù)的快速創(chuàng)新提供支持?！ D一?賽靈思CEO?Victor
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“老司機(jī)”十年FPGA從業(yè)經(jīng)驗總結(jié)
- 大學(xué)時代第一次接觸FPGA至今已有10多年的時間,至今記得當(dāng)初第一次在EDA實驗平臺上完成數(shù)字秒表、搶答器、密碼鎖等實驗時那個興奮勁。當(dāng)時由于沒有接觸到HDL硬件描述語言,設(shè)計都是在MAX+plus II原理圖環(huán)境下用74系列邏輯器件搭建起來的。 后來讀研究生,工作陸陸續(xù)續(xù)也用過Quartus II、FoundaTIon、ISE、Libero,并且學(xué)習(xí)了verilogHDL語言,學(xué)習(xí)的過程中也慢慢體會到verilog的妙用,原來一小段語言就能完成復(fù)雜的原理圖設(shè)計,而且語言的移植性可操作性比原理圖
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高云半導(dǎo)體宣布在香港科學(xué)園設(shè)立香港研發(fā)中心
- 作為國內(nèi)領(lǐng)先的可編程邏輯器件供應(yīng)商,廣東高云半導(dǎo)體科技股份有限公司(以下簡稱“高云半導(dǎo)體”)今日宣布成立香港研發(fā)中心,新成立的研發(fā)中心位于香港科學(xué)園二期浚湖樓,這是繼濟(jì)南、上海、廣州、美國硅谷四大研發(fā)中心之后,高云半導(dǎo)體成立的第五大研發(fā)中心。 “在香港科學(xué)園設(shè)立研發(fā)中心,將為高云半導(dǎo)體在國際市場開拓,創(chuàng)新合作等方面提供重要的技術(shù)支持,”高云半導(dǎo)體CEO朱璟輝介紹,“作為一個創(chuàng)新驅(qū)動型的公司,高云將在香港打造一個實力雄厚的研發(fā)與技術(shù)支
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高云半導(dǎo)體宣布在香港科學(xué)園設(shè)立香港研發(fā)中心
- 中國香港，2018年3月12日，作為國內(nèi)領(lǐng)先的可編程邏輯器件供應(yīng)商，廣東高云半導(dǎo)體科技股份有限公司（以下簡稱“高云半導(dǎo)體”）今日宣布成立香港研發(fā)中心，新成立的研發(fā)中心位于香港科學(xué)園二期浚湖樓，這是繼濟(jì)南、上海、廣州、美國硅谷四大研發(fā)中心之后，高云半導(dǎo)體成立的第五大研發(fā)中心。
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基于OMAP-L138 DSP+ARM的處理器與FPGA實現(xiàn)SDR系統(tǒng)
- CritICal Link公司的某客戶需要針對多個應(yīng)用開發(fā)一個擴(kuò)頻無線電收發(fā)器。該客戶已經(jīng)開發(fā)出一套算法，準(zhǔn)備用于對信號進(jìn)行調(diào)制和解調(diào)，但他們卻缺少構(gòu)建完整系統(tǒng)的資源和專業(yè)知識?？蛻粝Ｍ密浖x無線電(SDR)系統(tǒng)的靈活性優(yōu)勢。本文將探討如何基于德州儀器(TI)的OMAP-L138 DSP+ARM處理器與FPGA來實現(xiàn)該系統(tǒng)?！ ∑脚_ Critical Link選擇其MityDSP-L138F嵌入式系統(tǒng)模塊作為SDR的基礎(chǔ)，因為該模塊不僅具有很強(qiáng)的處理能力，而且可以
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這5個竅門，是每一個嵌入式開發(fā)者設(shè)計前都應(yīng)該了解的！
- 一個嵌入式應(yīng)用軟件都會在某些時候訪問最底層的固件和進(jìn)行一些硬件控制。驅(qū)動的設(shè)計和實施是確保一個系統(tǒng)能夠滿足其實時性要求的關(guān)鍵。以下5個竅門是每一個開發(fā)者在設(shè)計驅(qū)動程序時應(yīng)該考慮的，下面就隨我們一起來了解一下相關(guān)內(nèi)容吧?！ ?.使用設(shè)計模式 設(shè)計模式是一個用來處理那些在軟件中會重復(fù)出現(xiàn)的問題的解決方案。開發(fā)人員可以選擇浪費寶貴的時間和預(yù)算從無到有地重新發(fā)明一個解決方案，也可以從他的解決方案工具箱中選擇一個最適合解決這個問題的方案。在微處理器出現(xiàn)之初，底層驅(qū)動已經(jīng)很成熟了，那么，為什么不利用現(xiàn)有的成熟的
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基于DSP和FPGA的機(jī)器視覺系統(tǒng)設(shè)計與實現(xiàn)
- 本文將機(jī)器視覺與網(wǎng)絡(luò)技術(shù)相結(jié)合，使用TI公司新近推出的6000系列DSPsTMS320DM642為核心，應(yīng)用ALTERA公司的FPGA，用其實現(xiàn)圖像預(yù)處理，減輕了DSPs的負(fù)擔(dān)。應(yīng)用網(wǎng)絡(luò)技術(shù)實現(xiàn)圖像傳輸?！ ?、引言 機(jī)器視覺自起步發(fā)展到現(xiàn)在，已有15年的發(fā)展歷史。應(yīng)該說機(jī)器視覺作為一種應(yīng)用系統(tǒng)，其功能特點是隨著工業(yè)自動化的發(fā)展而逐漸完善和發(fā)展的?！ ∧壳埃瑖H上視覺系統(tǒng)的應(yīng)用方興未艾，1998年的市場規(guī)模為46億美元。在國外，機(jī)器視覺的應(yīng)用普及主要體現(xiàn)在半導(dǎo)體及電子行業(yè)，其中大概 40%
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再續(xù)FPGA初心，京微齊力脫胎京微雅格重新起航
- 新的一年開啟新的希望，新的空白承載新的夢想。這是年初一集微網(wǎng)給讀者們拜年時寫的寄語。在中國農(nóng)歷新年開年之際，半導(dǎo)體產(chǎn)業(yè)里也迎來了許多新的起點。例如長江存儲在與蘋果就采購前者的Nand閃存芯片一事談判，又例如前京微雅格副總裁王海力堅守18個月后的二次創(chuàng)業(yè)。 2005年年底，即將從清華大學(xué)計算機(jī)專業(yè)博士畢業(yè)的王海力加入了一家新成立的中外合資公司——雅格羅技，開始了國產(chǎn)FPGA芯片研發(fā)。2010年在北京市政府相關(guān)引導(dǎo)資金支持下，該公司也轉(zhuǎn)換身份并更名為“京微雅格&r
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FPGA重點知識13條，助你構(gòu)建完整“邏輯觀”之三
- 10、FPGA的時序基礎(chǔ)理論 我們的分析從下圖開始，下圖是常用的靜態(tài)分析結(jié)構(gòu)圖，一開始看不懂公式不要緊，因為我會在后面給以非常簡單的解釋： 這兩個公式是一個非常全面的，準(zhǔn)確的關(guān)于建立時間和保持時間的公式。其中Tperiod為時鐘周期;Tcko為D觸發(fā)器開始采樣瞬間到D觸發(fā)器采樣的數(shù)據(jù)開始輸出的時間;Tlogic為中間的組合邏輯的延時;Tnet為走線的延時;Tsetup為D觸發(fā)器的建立時間;Tclk_skew為時鐘偏移，偏移的原因是因為時鐘到達(dá)前后兩個D觸發(fā)器的路線不是一樣長?！ ∵@里我們來做如下轉(zhuǎn)
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FPGA重點知識13條，助你構(gòu)建完整“邏輯觀”之二
- 8、FPGA時鐘系統(tǒng) 1. FPGA的全局時鐘是什么? FPGA的全局時鐘應(yīng)該是從晶振分出來的，最原始的頻率。其他需要的各種頻率都是在這個基礎(chǔ)上利用PLL或者其他分頻手段得到的?！ ?. 全局時鐘和BUFG: BUFG，輸入為固定管腳，輸出為H型全銅全局高速網(wǎng)絡(luò)，這樣抖動和到任意觸發(fā)器的延時差最小，這個也就是FPGA做同步設(shè)計可以不需要做后仿真的原因?！ ∪謺r鐘：今天我們從另一個角度來看一下時鐘的概念：時鐘是D觸發(fā)器的重要組成部分，一個有效邊沿使得D觸發(fā)器進(jìn)行一次工作。而更多的時候，D觸發(fā)器保
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FPGA重點知識13條，助你構(gòu)建完整“邏輯觀”之一
- 1、查找表LUT和編程方式 第一部分： 查找表LUT FPGA是在PAL、GAL、EPLD、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為ASIC領(lǐng)域中的一種半定制電路而出現(xiàn)的，即解決了定制電路的不足，又克服了原有可編程器件門電路有限的缺點?！ ∮捎贔PGA需要被反復(fù)燒寫，它實現(xiàn)組合邏輯的基本結(jié)構(gòu)不可能像ASIC那樣通過固定的與非門來完成，而只能采用一種易于反復(fù)配置的結(jié)構(gòu)。查找表可以很好 地滿足這一要求，目前主流FPGA都采用了基于SRAM工藝的查找表結(jié)構(gòu)，也有一些軍品和宇航級FPGA采用
- 關(guān)鍵字： FPGA CPLD
eFPGA or FPGA SoC，誰將引領(lǐng)下一代可編程硬件潮流？
- eFPGA：冉冉升起的新星,eFPGA即嵌入式FPGA(embedded FPGA)，是近期興起的新型電路IP。 隨著摩爾定律越來越接近瓶頸，制造ASIC芯片的成本越來越高。因此，設(shè)計者會希望ASIC能實現(xiàn)一定的可配置性，同時又不影響性能。在希望能做成可配置的模塊中，負(fù)責(zé)與其他芯片或者總線通信的接口單元又首當(dāng)其沖。在芯片中，模塊間的通信往往使用簡單的并行接口或者配合簡單的時序邏輯，但是在芯片間通信時為了保證可靠性，必須通過一系列握手(handshake)協(xié)議來完成通信接口。設(shè)計者往往希望自己的SoC
- 關(guān)鍵字： eFPGA FPGA
PFM對比PWM，區(qū)別和優(yōu)勢在哪里？
- 做電源設(shè)計的應(yīng)該都知道PWM 和PFM 這兩個概念 開關(guān)電源的控制技術(shù)主要有三種： (1)脈沖寬度調(diào)制(PWM); (2)脈沖頻率調(diào)制(PFM); (3)脈沖寬度頻率調(diào)制(PWM-PFM). PWM：(pulse width modulation)脈沖寬度調(diào)制 脈寬調(diào)制PWM是開關(guān)型穩(wěn)壓電源中的術(shù)語。這是按穩(wěn)壓的控制方式分類的，除了PWM型，還有PFM型和PWM、PFM混合型。脈寬寬度調(diào)制式(PWM)開關(guān)型穩(wěn)壓電路是在控制電路輸出頻率不變的情況下，通過電壓反饋調(diào)整其占空比，從而達(dá)到穩(wěn)定輸出
- 關(guān)鍵字： PFM PWM
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