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可能毀掉您設(shè)計(jì)的 PCB 布局樣式錯(cuò)誤

現(xiàn)代 PCB 布局軟件允許工程師、設(shè)計(jì)師和愛(ài)好者快速輕松地設(shè)計(jì) PCB。該軟件提供了創(chuàng)造性的自由，但有時(shí)這并不是一件好事。PCB 設(shè)計(jì)人員可能會(huì)犯草率的設(shè)計(jì)錯(cuò)誤，這些錯(cuò)誤不會(huì)影響產(chǎn)品的功能，但可能會(huì)影響裝配、調(diào)試和產(chǎn)量，因?yàn)檫@些草率的錯(cuò)誤會(huì)造成混亂。本文介紹了一些基本的草率 PCB 設(shè)計(jì)風(fēng)格錯(cuò)誤以及如何避免這些錯(cuò)誤?，F(xiàn)代 PCB 布局軟件允許工程師、設(shè)計(jì)師和愛(ài)好者快速輕松地設(shè)計(jì) PCB。該軟件提供了創(chuàng)造性的自由，但有時(shí)這并不是一件好事。PCB 設(shè)計(jì)人員可能會(huì)犯草率的設(shè)計(jì)錯(cuò)誤，這些錯(cuò)誤不會(huì)影響產(chǎn)品的功能，但
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PCB業(yè)拚能源轉(zhuǎn)型 TPCA：產(chǎn)官學(xué)合作不可少

中國(guó)臺(tái)灣電路板協(xié)會(huì)（TPCA）理事長(zhǎng)李長(zhǎng)明18日出席「打造凈零時(shí)代競(jìng)爭(zhēng)力」論壇提到，凈零碳排是愿景也是個(gè)龐大的工程，需要政府、企業(yè)、民間通力合作，盼建構(gòu)更多元化再生能源與交易平臺(tái)，透過(guò)能源轉(zhuǎn)型帶動(dòng)PCB產(chǎn)業(yè)低碳轉(zhuǎn)型。李長(zhǎng)明表示，根據(jù)碳盤查的結(jié)果，中國(guó)臺(tái)灣PCB產(chǎn)業(yè)占中國(guó)臺(tái)灣整體碳排的1.2％，并非碳排大戶，但PCB產(chǎn)業(yè)仍積極響應(yīng)減碳，不只是因應(yīng)政策法規(guī)的要求，更重要的是客戶已提出具體的要求，以及來(lái)自競(jìng)爭(zhēng)對(duì)手的壓力，像中國(guó)臺(tái)灣PCB廠有許多知名的品牌客戶提出2030年到2040年的具體凈零要求。李長(zhǎng)明分析
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PCB 產(chǎn)業(yè) 2023 年陷入衰退，IC 載板成長(zhǎng)率先降后升

PCB 企業(yè)正處在發(fā)展成為百億規(guī)模的高速成長(zhǎng)期，未來(lái)潛力巨大。
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Cadence 推出 Allegro X AI，旨在加速 PCB 設(shè)計(jì)流程，可將周轉(zhuǎn)時(shí)間縮短 10 倍以上

中國(guó)上海，2023 年 4 月 7 日 —— 楷登電子（美國(guó) Cadence 公司，NASDAQ：CDNS）今日宣布推出 Cadence? Allegro? X AI technology，這是 Cadence 新一代系統(tǒng)設(shè)計(jì)技術(shù)，在性能和自動(dòng)化方面實(shí)現(xiàn)了革命性的提升。這款 AI 新產(chǎn)品依托于 Allegro X Design Platform 平臺(tái)，可顯著節(jié)省 PCB 設(shè)計(jì)時(shí)間，與手動(dòng)設(shè)計(jì)電路板相比，在不犧牲甚至有可能提高質(zhì)量的前提下，將布局布線（P&R）任務(wù)用時(shí)從數(shù)天縮短至幾分鐘。?
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散熱性能優(yōu)化的車載雙層板PCB設(shè)計(jì)，符合CISPR25 Class 5 規(guī)范

汽車電子供應(yīng)商在爭(zhēng)相提供自動(dòng)化、互聯(lián)化和電氣化解決方案的競(jìng)賽中面臨不斷增長(zhǎng)的成本壓力。而采用雙層PCB設(shè)計(jì)是降低成本的一種有效方法。但雙層PCB需要十分謹(jǐn)慎的設(shè)計(jì)，因?yàn)槠渖崽匦圆患?，有可能?dǎo)致性能的降級(jí)。在本文中，汽車專家將以MPS的MPQ4323-AEC1 為例給出實(shí)用建議，說(shuō)明如何微調(diào)雙層PCB的電路和布局設(shè)計(jì)，以實(shí)現(xiàn)最佳散熱特性，同時(shí)符合CISPR25 5類標(biāo)準(zhǔn)。采用雙層PCB布局PCB的層數(shù)取決于PCB空間、組件數(shù)量以及計(jì)劃投入的生產(chǎn)成本。硬件設(shè)計(jì)師通常只有兩層電路板可用。在汽車用雙層PCB設(shè)計(jì)
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PCB無(wú)處“安放”？幾個(gè)工業(yè)PCB互連技能點(diǎn)，幫你解決！

眾所周知，PCB板設(shè)計(jì)是電子設(shè)計(jì)工程師必須具備的一項(xiàng)基本功，也是檢驗(yàn)硬件工程師技術(shù)實(shí)力的試金石。不過(guò)，如果你希望在“畫(huà)板子”這種板級(jí)設(shè)計(jì)之外，還能夠向電子產(chǎn)品的系統(tǒng)級(jí)設(shè)計(jì)進(jìn)階，那么PCB之間的互連設(shè)計(jì)，就成了一個(gè)必須掌握的技能點(diǎn)。之所以要考慮PCB之間的互連，原因很好理解：如今電子系統(tǒng)日趨復(fù)雜，再考慮到系統(tǒng)擴(kuò)展性的要求，想要將所有功能在一塊大PCB上實(shí)現(xiàn)顯然是不可能的，因此就需要化整為零，將不同的功能放在不同的PCB上來(lái)實(shí)現(xiàn)，再將這些“小”PCB相互連接起來(lái)構(gòu)建完整的大系統(tǒng)。但是這說(shuō)起來(lái)容易，在實(shí)戰(zhàn)中，如
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電路板廠PCB關(guān)鍵信號(hào)如何去布線？

電路板廠在PCB布線規(guī)則中，有一條“關(guān)鍵信號(hào)線優(yōu)先”的原則，即電源、摸擬信號(hào)、高速信號(hào)、時(shí)鐘信號(hào)、差分信號(hào)和同步信號(hào)等關(guān)鍵信號(hào)優(yōu)先布線。接下來(lái)，我們不妨就來(lái)詳細(xì)了解下這些關(guān)鍵信號(hào)的布線要求。模擬信號(hào)布線要求模擬信號(hào)的主要特點(diǎn)是抗干擾性差，布線時(shí)主要考慮對(duì)模擬信號(hào)的保護(hù)。對(duì)模擬信號(hào)的處理主要體現(xiàn)在以下幾點(diǎn)：1. 為增加其抗干擾能力，走線要盡量短。2. 部分模擬信號(hào)可以放棄阻抗控制要求，走線可以適當(dāng)加粗。3. 限定布線區(qū)域，盡量在模擬區(qū)域內(nèi)完成布線，遠(yuǎn)離數(shù)字信號(hào)。高速信號(hào)布線要求1. 多層布線據(jù)電路板廠了解，
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幾個(gè)氮化鎵GaN驅(qū)動(dòng)器PCB設(shè)計(jì)必須掌握的要點(diǎn)

NCP51820 是一款 650 V、高速、半橋驅(qū)動(dòng)器，能夠以高達(dá) 200 V/ns 的 dV/dt 速率驅(qū)動(dòng)氮化鎵（以下簡(jiǎn)稱“GaN”）功率開(kāi)關(guān)。之前我們簡(jiǎn)單介紹過(guò)氮化鎵GaN驅(qū)動(dòng)器的PCB設(shè)計(jì)策略概要，本文將為大家重點(diǎn)說(shuō)明利用 NCP51820 設(shè)計(jì)高性能 GaN 半橋柵極驅(qū)動(dòng)電路必須考慮的 PCB 設(shè)計(jì)注意事項(xiàng)。本設(shè)計(jì)文檔其余部分引用的布線示例將使用含有源極開(kāi)爾文連接引腳的 GaNFET 封裝。VDD 電容VDD 引腳應(yīng)有兩個(gè)盡可能靠近 VDD 引腳放置的陶瓷電容。如圖 7 所示，較低值的高頻旁路電
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氮化鎵GaN驅(qū)動(dòng)器的PCB設(shè)計(jì)策略概要

NCP51820 是一款 650 V、高速、半橋驅(qū)動(dòng)器，能夠以高達(dá) 200 V/ns 的 dV/dt 速率驅(qū)動(dòng)氮化鎵（以下簡(jiǎn)稱“GaN”）功率開(kāi)關(guān)。只有合理設(shè)計(jì)能夠支持這種功率開(kāi)關(guān)轉(zhuǎn)換的印刷電路板 (PCB) ，才能實(shí)現(xiàn)實(shí)現(xiàn)高電壓、高頻率、快速dV/dt邊沿速率開(kāi)關(guān)的全部性能優(yōu)勢(shì)。本文將簡(jiǎn)單介紹NCP51820及利用 NCP51820 設(shè)計(jì)高性能 GaN 半橋柵極驅(qū)動(dòng)電路的 PCB 設(shè)計(jì)要點(diǎn)。NCP51820 是一款全功能專用驅(qū)動(dòng)器，為充分發(fā)揮高電子遷移率晶體管 (HEMT) GaNFET 的開(kāi)關(guān)性能而
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如何輕松完成剛?cè)峤Y(jié)合 PCB 彎曲的電磁分析？

對(duì)于使用剛?cè)峤Y(jié)合 PCB 的系統(tǒng)，確保功能性、安全性和有效性是重中之重，尤其是用于先進(jìn)醫(yī)療植入物、高精度關(guān)鍵軍事設(shè)備以及類似受監(jiān)管機(jī)密設(shè)備的系統(tǒng)。為此，一定要對(duì)它們進(jìn)行全面詳盡的仿真。Footprint 尺寸較小的系統(tǒng)必須具有很高的封裝密度，才能容得下各種器件。對(duì)于使用剛?cè)峤Y(jié)合 PCB 的系統(tǒng)，確保功能性、安全性和有效性是重中之重，尤其是用于先進(jìn)醫(yī)療植入物、高精度關(guān)鍵軍事設(shè)備以及類似受監(jiān)管機(jī)密設(shè)備的系統(tǒng)。為此，一定要對(duì)它們進(jìn)行全面詳盡的仿真。Footprint 尺寸較小的系統(tǒng)必須具有很高的封裝
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PCB通孔中的PTH NPTH的區(qū)別

可以觀察到電路板中有著許多大大小小的空洞，會(huì)發(fā)現(xiàn)是許多密密麻麻的小孔，每個(gè)孔洞都是有其目的而被設(shè)計(jì)出來(lái)的。這些孔洞大體上可以分成 PTH（Plating Through Hole，電鍍通孔）及 NPTH（Non Plating Through Hole，非電鍍通孔）兩種，這里說(shuō)「通孔」是因?yàn)檫@種孔真的就是從電路板的一面貫穿到另外一面，其實(shí)電路板內(nèi)除了通孔外，還有其他不是貫穿電路板的孔，可以觀察到電路板中有著許多大大小小的空洞，會(huì)發(fā)現(xiàn)是許多密密麻麻的小孔，每個(gè)孔洞都是有其
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如何通過(guò)最小化熱回路PCB ESR和ESL來(lái)優(yōu)化開(kāi)關(guān)電源布局

問(wèn)題：能否優(yōu)化開(kāi)關(guān)電源的效率？?答案：當(dāng)然可以，最小化熱回路PCB ESR和ESL是優(yōu)化效率的重要方法。?簡(jiǎn)介對(duì)于功率轉(zhuǎn)換器，寄生參數(shù)最小的熱回路PCB布局能夠改善能效比，降低電壓振鈴，并減少電磁干擾(EMI)。ADI將在本文討論如何通過(guò)最小化PCB的等效串聯(lián)電阻(ESR)和等效串聯(lián)電感(ESL)來(lái)優(yōu)化熱回路布局設(shè)計(jì)。文中研究并比較了影響因素，包括解耦電容位置、功率FET尺寸和位置以及過(guò)孔布置。通過(guò)實(shí)驗(yàn)驗(yàn)證了分析結(jié)果，并總結(jié)了最小化PCB ESR和ESL的有效方法。?熱回路和
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美國(guó)“顯卡稅”又推遲9個(gè)月：一旦征收最多漲價(jià)25％

美國(guó)貿(mào)易代表辦公室(USTR)決定，繼續(xù)暫緩根據(jù)301條款向從中國(guó)進(jìn)口的352類產(chǎn)品征收關(guān)稅，期限9個(gè)月，直到2023年9月30日。這其中就包括PCB電路板，尤其是用于顯卡的，稅率高達(dá)驚人的25％，被很多人稱為“顯卡稅” ，當(dāng)然筆記本、主板也同樣包括在內(nèi)。事實(shí)上，“顯卡稅”早就提出來(lái)了，但因?yàn)榉N種原因，一直沒(méi)有真正實(shí)施。2022年3月28日，USTR給出的豁免截止期限是2022年12月31日，近期隨著這一期限的臨近，讓很多游戲玩家憂心忡忡。
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在高速電路設(shè)計(jì)中候PCB布線的損耗解決方案

眼圖的結(jié)果也表明效果是顯而易見(jiàn)的。其實(shí)在產(chǎn)品設(shè)計(jì)的過(guò)程中，PCB的布線往往不是你想修改就能修改的，這牽涉到很多方面和部門之間的協(xié)作；換PCB材料也很麻煩，只要有改板之后才能調(diào)整。所以，有時(shí)候可以換一個(gè)思路，考慮下通路上的問(wèn)題，這時(shí)說(shuō)不定會(huì)有意想不到的效果。前段時(shí)間我們寫(xiě)了一篇關(guān)于USB3.0的信號(hào)完整性的文章，說(shuō)了其中一個(gè)元器件的選用問(wèn)題。正好一個(gè)朋友又遇到了類似的問(wèn)題，由于損耗過(guò)大，一個(gè)勁的又是去調(diào)節(jié)PCB布線長(zhǎng)度，長(zhǎng)度壓縮了1inch，還是不行；又是去換PCB材料，也沒(méi)有很好地解決問(wèn)題，其實(shí)終發(fā)現(xiàn)的問(wèn)
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高效差分對(duì)布線指南：提高 PCB 布線速度

“眾人拾柴火焰高” ——資源整合通常會(huì)帶來(lái)更好的結(jié)果。畢竟 “三個(gè)臭皮匠，頂個(gè)諸葛亮”，在電子領(lǐng)域也是如此：較之單一的走線，差分對(duì)布線更受青睞。本文要點(diǎn)●PCB 差分對(duì)的基礎(chǔ)知識(shí)?！癫罘謱?duì)布線指南，實(shí)現(xiàn)更好的布線設(shè)計(jì)?！窀咝Ю?PCB 設(shè)計(jì)工具?！氨娙耸安窕鹧娓摺?——資源整合通常會(huì)帶來(lái)更好的結(jié)果。畢竟 “三個(gè)臭皮匠，頂個(gè)諸葛亮”，在電子領(lǐng)域也是如此：較之單一的走線，差分對(duì)布線更受青睞。不過(guò)，差分對(duì)布線可能沒(méi)那么容易，因?yàn)樗鼈儽仨氉裱囟ǖ囊?guī)則，這樣才能確保信號(hào)的性能。這些規(guī)則決定了一些細(xì)節(jié)，如差分對(duì)的
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