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四種常用FPGA/CPLD設(shè)計思想與技巧之乒乓操作
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- 關(guān)鍵字： CPLD設(shè)計 FPGA 乒乓 Xilinx Altera Lattice actel 操作 系統(tǒng)設(shè)計 思想
FPGA在多制式視頻轉(zhuǎn)換系統(tǒng)中的應用
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SYNPLICITY聯(lián)手LATTICE將項目擴展到DSP綜合技術(shù)領(lǐng)域
- SYNPLICITY和 LATTICE進一步加強合作，日前共同推出了面向 DSP 設(shè)計的高度優(yōu)化的非專有 ESL 綜合流程技術(shù) Synplify DSP。Synplicity 的 Synplify® DSP 軟件現(xiàn)可支持 LatticeECP2M 和 LatticeXP2 現(xiàn)場可編程門陣列 (FPGA) 器件，從而為航空航天、無線、電信及數(shù)字多媒體應用領(lǐng)域的 DSP 算法實施提供了功能強大的解決方案。 Lattice 公司的市場營銷副總裁 Stan Kop
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萊迪思為LatticeECP2低成本FPGA擴展市場
- --第二代 EConomy Plus器件降低了50%的價格并達到雙倍的密度 -- 萊迪思半導體公司近日公布了其第二代EConomy Plus 現(xiàn)場可編程門陣列 (FPGA)器件，LatticeECP2系列。用了富士通90納米CMOS工藝和300毫米硅片，在大批量的情況下，此系列使得FPGA價格降到每1000查找表（LUT）低于0.50美元。與130納米 LatticeECP FPGA相比，新的系
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萊迪思富士通發(fā)布LatticeSC和LatticeECP2
- －通力合作打造出難以超越的FPGA產(chǎn)品系列－ 萊迪思半導體公司近日宣布推出其新一代的90納米FPGA，包含兩個全新的FPGA器件系列。LatticeSC™ 系統(tǒng)芯片F(xiàn)PGA的設(shè)計宗旨是提供業(yè)界最佳的整體性能，而LatticeECP2™ FPGA則將業(yè)界成本最低的FPGA結(jié)構(gòu)和高端的FPGA功能集于一身。這兩個器件系列都采用了富士通公司經(jīng)過優(yōu)化的工藝，既滿足了高容量FPGA對成本效率的要求，又能夠提供擁有數(shù)百萬門的系統(tǒng)級FPGA所需的千兆赫性能。這兩個器件系列將在
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Lattice可簡化時鐘網(wǎng)絡(luò)設(shè)計
- Lattice半導體公司為高性能通訊和計算產(chǎn)品推出第二代零延時時鐘發(fā)生器，它可產(chǎn)生20個時鐘輸出，每個輸出的轉(zhuǎn)換率都可以獨立編程，提供標準輸入輸出和頻率選擇。ispClock5600A的鎖相環(huán)(PLL)及分隔器系統(tǒng)可從參考輸入綜合多種時鐘頻率。 該發(fā)生器基于非易失系統(tǒng)內(nèi)E2CMOS，與該公司第一代ispClock5600器件兼容，但增加了很多新功能，各種參數(shù)性能也有了顯著改進。最大壓控振蕩器(VCO)工作頻率已經(jīng)提升到800MHz。它支持33.33-、100-、133.33-和50MHz時鐘頻率。輸
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用可編程的扭斜控制來解決時鐘網(wǎng)絡(luò)問題的方法
- 時鐘網(wǎng)絡(luò)管理問題提高同步設(shè)計的整體性能的關(guān)鍵是提高時鐘網(wǎng)絡(luò)的頻率。然而，諸如時序裕量、信號完整性、相關(guān)時鐘邊沿的同步等因素極大地增加了時鐘網(wǎng)絡(luò)設(shè)計的復雜度。傳統(tǒng)上，時鐘網(wǎng)絡(luò)的設(shè)計采用了簡單的元件，諸如扇出緩沖器、時鐘發(fā)生器、延時線、零延時緩沖器和頻率合成器。由于PCB走線長度不等而引起的時序誤差，采用蜿蜒走線設(shè)計的走線長度匹配方法來處理。走線阻抗與輸出驅(qū)動阻抗的不匹配經(jīng)常通過反復試驗選擇串聯(lián)電阻來消除。多種信號的標準使得時鐘邊沿的同步更加復雜。至今，這三種挑戰(zhàn)會經(jīng)常遇到，并且鮮有理想的解決方案。以下描述了
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可編程邏輯器件融合CPLD+FPGA最佳特性
- 可編程邏輯器件融合CPLD+FPGA最佳特性 Lattice(萊迪思)半導體公司近日推出了新的MachXO可編程邏輯器件系列產(chǎn)品，Lattice稱，這種新一代的跨越式可編程邏輯器件支持傳統(tǒng)上由高密度的CPLD或者低容量的FPGA所實現(xiàn)的應用?！ ?jù)Lattice現(xiàn)場應用支持副總裁Jock Tomlinson介紹，MachXO邏輯器件建立在低成本的130nm嵌入式Flash處理工藝上。它能夠在單芯片中瞬時工作，這種特性對于許多CPLD應用來說是十分重要的。3.5ns的管腳至管腳的延時使得器件能夠滿足當代系統(tǒng)
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三端并聯(lián)穩(wěn)壓器的隱藏應用
- 三端并聯(lián)穩(wěn)壓器的隱藏應用 引言 眾多半導體公司均推出了三端并聯(lián)穩(wěn)壓器 (three-terminal shunt regulator)。此類器件帶有內(nèi)部基準精確度、運算放大器及內(nèi)部并聯(lián)晶體管，以精確控制供電電壓。圖 1 給出了典型的電路應用。三端并聯(lián)穩(wěn)壓器是廉價的半導體器件，除了并聯(lián)穩(wěn)壓器以外，其還具備其他有用的電源設(shè)計應用。這種半導體器件可用作廉價的運算放大器，用于控制回路反饋。該器件還可同晶體管及無源組件協(xié)同使用，又可用于快速自舉電路。此外，這種器件經(jīng)過配置，還可作為低功耗輔助電
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SiGe半導體助便攜式消費類電子產(chǎn)品實現(xiàn)嵌入式Wi-Fi 功能(圖)
- SiGe半導體助便攜式消費類電子產(chǎn)品實現(xiàn)嵌入式Wi-Fi 功能(圖) SiGe 半導體公司 (SiGe Semiconductor, Inc) 現(xiàn)已進一步擴展其 Wi-Fi 芯片系列，在產(chǎn)品中加入專為降低便攜式消費類電子產(chǎn)品尺寸及功耗而設(shè)計的無線射頻 (RF) 前端方案?！ ∪碌?RangeCharger 器件包括 SE2550L RF 前端模塊及 SE2523L 功率放大器，主要面向 802.11b/g 無線局域網(wǎng) (WLAN) 系統(tǒng)。SE2550L 在一個微型芯片級封裝內(nèi)集成了收發(fā)器和天線之間所需
- 關(guān)鍵字： SiGe 半導體公司
下一代成幀器/映射器：提升網(wǎng)絡(luò)傳輸效率
- 下一代成幀器/映射器：提升網(wǎng)絡(luò)傳輸效率 上司、公司和客戶無時無刻不在要求我們以較少的投入實現(xiàn)較高的產(chǎn)出。在以一種最佳的成本效益型方式來完成經(jīng)由傳輸基礎(chǔ)設(shè)施的數(shù)據(jù)移動任務(wù)時，這種要求尤其明顯?！ ∽畛醯膫鬏斁W(wǎng)絡(luò)基于一種簡單的“配置完成便不再過問”的規(guī)則。它依靠的是SONET/SDH TDM（時分復用）能力。但是，向基于分組的傳輸要求的轉(zhuǎn)變迫使業(yè)界不得不開發(fā)新的標準和架構(gòu)。而這反過來又促成了成幀器/映射器芯片在物理層水平上的發(fā)展，從而提供一條將現(xiàn)有的傳輸網(wǎng)絡(luò)更加有效地應用于數(shù)據(jù)業(yè)
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