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          EEPW首頁 >> 主題列表 >> mcu-fpga

          FPGA約束、時序分析的概念介紹

          • 時序約束的概念和基本策略時序約束主要包括周期約束(FFS到FFS,即觸發(fā)器到觸發(fā)器)和偏移約束(IPAD到FFS、FFS到OPAD)以及靜態(tài)路徑約束(IPAD到OPAD)等3種。通過附加約束條件可以使綜合布線工具調(diào)整映射和布局布線過程,使設計達到時序要求。例如用OFFSET_IN_BEFORE約束可以告訴綜合布線工具輸入信號在時鐘之前什么時候準備好,綜合布線工具就可以根據(jù)這個約束調(diào)整與IPAD相連的Logic Circuitry的綜合實現(xiàn)過程,使結(jié)果滿足FFS的建立時間要求。附加時序約束的一般策略是先附加
          • 關鍵字: FPGA  約束  時序  

          FPGA:EPP(增強型并行端口)

          • EPP 使與 PC 的通信變得快速而簡單。在這里,我們使用Pluto-P FPGA板與支持EPP的PC進行通信。EPP 1 - 什么是 EPP?EPP 是 IEEE 1284(并行端口標準)的一部分。IEEE 1284 還定義了 SPP 和 ECP,但 EPP 提供了兩者的優(yōu)點,即速度和簡單性。EPP的主要特點是:通過并行端口提供雙向通信,即對連接到 PC 并行端口的外圍設備進行讀寫的方式。事務是 8 位寬的,并且是原子的。主機 (PC) 始終是事務的發(fā)起者,讀取或?qū)懭搿]有爆發(fā)的概念。您可以發(fā)
          • 關鍵字: FPGA  EPP  增強型并行端口  

          FPGA:SPI接口

          • SPI可以用作FPGA和其他芯片之間簡單有效的通信方式。SPI 1 - 什么是SPI?SPI是一個簡單的接口,允許一個芯片與一個或多個其他芯片進行通信。它看起來如何?讓我們從一個簡單的例子開始,其中只有兩個芯片必須一起通信。SPI 需要在兩個芯片之間使用 4 根線。如您所見,這些電線被稱為 SCK、MOSI、MISO 和 SSEL,其中一個芯片是“主芯片”,另一個芯片是“從芯片”。SPI基礎知識基本上:它是同步的。它是全雙工串行。它不是即插即用的。有一個(也只有一個)主站和一個或多個(或多個)從站。更多細
          • 關鍵字: FPGA  SPI接口  

          PSG獨立運作拯救的是英特爾還是FPGA

          • 根據(jù)英特爾官方的公告,2024年1月1日起,可編程解決方案部門(PSG)將獨立運營,并計劃2年內(nèi)開啟IPO。值得一提的是,英特爾的PSG其實就是以2015年5月達成收購協(xié)議的Altera為主體,從當年花費167億美元成為英特爾最大一筆收購,到現(xiàn)在要獨立運營甚至上市套現(xiàn),種種操作背后蘊含了哪些原因我們不得而知,不過這筆投資的回報價值幾何也許能終見分曉。 在半導體行業(yè),作為霸占銷售額榜首位置最久的公司,英特爾在收購方面表現(xiàn)得一直很積極,但從另一個角度來看,英特爾的收購交易獲得較高評價的也不多,很多交易即使計算
          • 關鍵字: 英特爾  PSG  FPGA  Altera  賽靈思  Lattice  

          如何在下一代 MCU 應用中實現(xiàn)投影顯示

          • 你是否曾想過在微控制器 (MCU) 驅(qū)動應用程序中添加投影顯示?想象一下,在家用電器中使用投影顯示器來提供易于交互、色彩明艷且功耗更低的界面,同時能夠不占用傳統(tǒng) LCD 或薄膜晶體管那么多的空間。你是否曾想過在微控制器 (MCU) 驅(qū)動應用程序中添加投影顯示?想象一下,在家用電器中使用投影顯示器來提供易于交互、色彩明艷且功耗更低的界面,同時能夠不占用傳統(tǒng) LCD 或薄膜晶體管那么多的空間。自由形式投影顯示器使設計人員能夠添加創(chuàng)新型人機界面 (HMI),且無需邊框和按需顯示,使得在不使用時能夠保持界面清晰。
          • 關鍵字: TI  MCU  投影顯示  

          FPGA串行接口(RS-232)

          • 串行接口是將FPGA連接到PC的簡單方法。 我們只需要一個發(fā)射器和接收器模塊。異步發(fā)射器它通過序列化要傳輸?shù)臄?shù)據(jù)來創(chuàng)建信號“TxD”。異步接收器它從 FPGA 外部獲取信號“RxD”,并將其“解串化”,以便在 FPGA 內(nèi)部輕松使用。串行接口 1 - RS-232 串行接口的工作原理RS-232接口具有以下特點:使用 9 針連接器“DB-9”(較舊的 PC 使用 25 針“DB-25”)。允許雙向全雙工通信(PC可以同時發(fā)送和接收數(shù)據(jù))??梢砸源蠹s 10KBytes/s 的最大速度進行通信。DB-9 連接
          • 關鍵字: FPGA  串行接口  

          FPGA計數(shù)器的藝術

          • 計數(shù)器構(gòu)成了一個基本的FPGA構(gòu)建塊。 它們有各種形狀和形式......計數(shù)器 1 - 二進制計數(shù)器最簡單的計數(shù)器可以使用幾行 Verilog 構(gòu)建快速高效的二進制計數(shù)器。例如,下面是一個 32 位計數(shù)器。reg [31:0] cnt;always @(posedge clk) cnt <= cnt+1;此類計數(shù)器從 0 計數(shù)到 4294967295,然后回滾 0 以繼續(xù)其進程。 它占用的資源很少,并且在FPGA中運行速度快,這要歸功于隱藏的攜帶鏈(稍后會詳細介紹)。 現(xiàn)在,讓我們看看一些變化。首先
          • 關鍵字: FPGA  計時器  二進制  

          實現(xiàn)最高效的數(shù)據(jù)轉(zhuǎn)換:深入了解Achronix JESD204C解決方案

          • 長期以來,Achronix為不同行業(yè)的數(shù)據(jù)密集型和高帶寬應用提供了創(chuàng)新性的FPGA產(chǎn)品和技術,并幫助客戶不斷打破性能極限。其中一些應用需要與先進的模擬/數(shù)字轉(zhuǎn)換器(ADC)和數(shù)字/模擬轉(zhuǎn)換器(DAC)進行對接——可由JESD204C完美地完成這項任務。JESD204B/C是由JEDEC定義和開發(fā)的高速數(shù)據(jù)轉(zhuǎn)換器串行接口標準。該標準減少了高速數(shù)據(jù)轉(zhuǎn)換器和其他高性能器件(如Achronix Speedster7t FPGA)之間的數(shù)據(jù)輸入和輸出數(shù)量。這種數(shù)字和模擬信號鏈的組合使設計人員能夠獲得簡化的小尺寸電路
          • 關鍵字: 數(shù)據(jù)轉(zhuǎn)換  Achronix  JESD204C  FPGA  

          萊迪思即將舉辦網(wǎng)絡研討會探討全新推出的創(chuàng)新中端FPGA

          • 萊迪思半導體,低功耗可編程器件的領先供應商,近日宣布將舉辦一場網(wǎng)絡研討會,介紹其最新的兩款創(chuàng)新型中端FPGA器件系列,萊迪思Avant?-G和Avant?-X,分別為通用FPGA和高級互連FPGA。在網(wǎng)絡研討會上,萊迪思將介紹這些新型FPGA相關的技術,新產(chǎn)品旨在為通信、計算、工業(yè)和汽車市場的中端應用提供低功耗、先進的連接和優(yōu)化的計算能力等特性。●? ?主辦方:萊迪思半導體●? ?內(nèi)容:萊迪思最新推出的中端FPGA——Avant-G和Avant-X●? &
          • 關鍵字: 萊迪思  中端FPGA  FPGA  

          跨越時鐘域

          • FPGA設計可以使用多個時鐘。每個時鐘在FPGA內(nèi)部形成一個“時鐘域”,如果在另一個時鐘域中需要在一個時鐘域中生成的信號,則需要格外小心。跨時鐘域1-信號假設 clkB 域中需要來自 clkA 域的信號。 它需要“同步”到 clkB 域,因此我們要構(gòu)建一個同步器設計,它從 clkA 域獲取一個信號,并在 clkB 域中創(chuàng)建一個新信號。在第一種設計中,我們假設與 clkA 和 clkB 時鐘速度相比,“信號輸入”變化緩慢。您需要做的就是使用兩個觸發(fā)器將信號從 clkA 移動到 clkB。module Sig
          • 關鍵字: FPGA  時鐘  時鐘域  

          用FPGA邏輯消抖動

          • 我們將一個開關連接到FPGA上,連接方式如下圖:機械開關的問題就是有抖動,每次按一下開關,你會得到下面的信號:這種信號很少碰到,多數(shù)情況是下面的這種:我們可以用FPGA的計數(shù)器來記錄按鍵的次數(shù),并通過數(shù)碼管顯示出來: 上電的時候,一起是好的:如果按十次鍵,得到下面的結(jié)果:顯然不對。那如何解決呢? 一種方式是添加一個R/C濾波器,再跟一個施密特觸發(fā)器之后送給FPGA,當然還有更簡單的方式,就是在FPGA內(nèi)部進行消抖動。 FPGA擅長簡單的運算,讓我們使用FPGA中的計數(shù)器來查看按下或釋放按鈕的時間。只有當計
          • 關鍵字: FPGA  消除抖動  

          如何在下一代MCU應用中實現(xiàn)投影顯示

          • 你是否曾想過在微控制器 (MCU) 驅(qū)動應用程序中添加投影顯示?想象一下,在家用電器中使用投影顯示器來提供易于交互、色彩明艷且功耗更低的界面,同時能夠不占用傳統(tǒng) LCD 或薄膜晶體管那么多的空間。 自由形式投影顯示器使設計人員能夠添加創(chuàng)新型人機界面 (HMI),且無需邊框和按需顯示,使得在不使用時能夠保持界面清晰。利用 DLP? 技術,設計人員可以在緊湊的空間中添加投影模塊,并在不增加系統(tǒng)尺寸的情況下顯示更大的圖像。 為了幫助設計人員開始創(chuàng)建此類顯示器,德州儀器 (TI) 開
          • 關鍵字: MCU  投影顯示  德州儀器  

          用FPGA做正交解碼

          • FPGA非常適合用邏輯來實現(xiàn)正交解碼的功能。什么是正交信號?正交信號是兩個相位差為90度的信號。它們在機械系統(tǒng)中用于確定軸的運動(或旋轉(zhuǎn))。這是一個向前移動幾步的軸。如果對脈沖計數(shù),則可以說軸移動了3步。如果計算邊緣,則可以說軸移動了12步。這就是我們在此頁面上所做的。現(xiàn)在,軸向后移動了相同的量。因此,想法是通過查看邊緣和水平,我們可以確定運動的方向和距離。這是一個示例,其中軸向前移動10步,然后向后移動7步。它們在哪里使用?在機械手軸中,用于反饋控制。用旋鈕確定用戶輸入。在電腦鼠標中,確定運動方向。如果
          • 關鍵字: FPGA  L正交解碼  

          全球汽車半導體行業(yè)將以每年10%的速度增長

          • 12月22日消息,據(jù)報道,Adroit Market Research預計,全球汽車半導體行業(yè)將以每年10%的速度增長,到2032年將達到1530億美元,2023年至2032年復合年增長率 (CAGR) 為10.3%。報告顯示,半導體器件市場將從2022年的$43B增長到2028年的$84.3B,復合年增長率高達11.9%。目前的市場表明,到2022年,每輛汽車的半導體器件價值約為540美元,在ADAS、電氣化等汽車行業(yè)大趨勢下,到2028年,該數(shù)字將增長至約912美元。電動化和ADAS是技術變革的主要驅(qū)
          • 關鍵字: 汽車電子  半導體  ADAS  碳化硅  DRAM  MCU  

          文本LCD模塊的控制FPGA

          • 文本LCD模塊便宜且易于使用微控制器或FPGA進行接口。這是一個1行x 16個字符的模塊:要控制LCD模塊,您需要11個IO引腳來驅(qū)動8位數(shù)據(jù)總線和3個控制信號。3個控制信號是:E:啟用或“ LCD選擇”。高活躍。讀/寫:讀/寫。0寫入,1讀取。RS:寄存器選擇,0表示命令字節(jié),1表示數(shù)據(jù)字節(jié)。大多數(shù)LCD模塊都基于HD44780芯片或是兼容的。查閱Wikipedia以獲取更多信息。7位設計讓我們用FPGA板驅(qū)動LCD模塊。這是我們設計的框圖:Pluto從PC串行端口接收數(shù)據(jù),對其進行反序列化,然后將其發(fā)
          • 關鍵字: FPGA  LCD模塊  
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