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          Cadence發(fā)布面向TSMC 3nm工藝的112G-ELR SerDes IP展示

          • 3nm 時代來臨了!Cadence 在 2023 年 TSMC 北美技術研討會期間發(fā)布了面向臺積電 3nm 工藝(N3E)的 112G 超長距離(112G-ELR)SerDes IP 展示,這是 Cadence 112G-ELR SerDes IP 系列產品的新成員。在后摩爾時代的趨勢下,F(xiàn)inFET 晶體管的體積在 TSMC 3nm 工藝下進一步縮小,進一步采用系統(tǒng)級封裝設計(SiP)。通過結合工藝技術的優(yōu)勢與 Cadence 業(yè)界領先的數(shù)字信號處理(DSP)SerDes 架構,全新的 112G-ELR
          • 關鍵字: Cadence  TSMC  3nm工藝  SerDes IP  

          DRAM迎來3D時代?

          芯原股份:公司的神經網絡處理器IP系列產品可廣泛適用于AIoT、智慧汽車等應用場景

          • 2023年5月8日,芯原股份(688521.SH)在互動平臺表示,芯原用于人工智能的神經網絡處理器IP(NPU)業(yè)界領先,已經在10多個領域、60多家客戶的110多款芯片中被采用。根據(jù)目前市場的需求,芯原基于自身神經網絡處理器IP可伸縮可擴展的特性,已發(fā)展了覆蓋從高性能云計算到低功耗邊緣計算的垂直解決方案;同時還推出了從攝像頭輸入到顯示器輸出的完整智能像素解決方案。因此,在人工智能領域,芯原的神經網絡處理器IP系列產品可廣泛適用于包括智慧物聯(lián)網(AIoT)、智慧汽車、智慧可穿戴、智慧家居、視頻數(shù)據(jù)中心、智
          • 關鍵字: 芯原股份  IP  神經網絡處理器IP  

          楷登電子成功流片基于臺積電N3E工藝的16G UCIe先進封裝IP

          • 近日,楷登電子(Cadence)宣布基于臺積電3nm(N3E)工藝技術的Cadence? 16G UCIe? 2.5D先進封裝IP成功流片。該IP采用臺積電3D Fabric? CoWoS-S硅中介層技術實現(xiàn),可提供超高的帶寬密度、高效的低功耗性能和卓越的低延遲,非常適合需要極高算力的應用。據(jù)悉,楷登電子目前正與許多客戶合作,來自N3E測試芯片流片的UCIe先進封裝IP已開始發(fā)貨并可供使用。這個預先驗證的解決方案可以實現(xiàn)快速集成,為客戶節(jié)省時間和精力。
          • 關鍵字: 楷登電子  臺積電  N3E  UCIe  先進封裝  IP  

          為什么嵌入式FPGA(eFPGA)IP是ADAS應用的理想選擇?

          • 提高汽車電氣化和自動駕駛的一個主要方面是先進駕駛輔助系統(tǒng)(ADAS)的普及。如今,這些系統(tǒng)正迅速應用于市場上幾乎所有的車輛,而且隨著技術的成熟,這一趨勢只會持續(xù)下去。然而,隨著技術的發(fā)展,ADAS設計人員面臨的硬件挑戰(zhàn)變得越來越復雜。在本文中,我們將介紹ADAS的硬件需求,F(xiàn)PGA如何填補這些空白,以及為什么eFPGA IP將成為下一個ADAS硬件趨勢。ADAS的硬件要求ADAS在現(xiàn)代汽車中的發(fā)展給底層硬件帶來了一些嚴峻的挑戰(zhàn)。在像ADAS這樣的關鍵任務應用中,最重要的目標是確保車輛乘員的安全。這個目標要
          • 關鍵字: 嵌入式FPGA  eFPGA  IP  ADAS  

          ASICLAND為汽車、AI企業(yè)和AI邊緣SoC應用選擇Arteris IP

          • 加利福尼亞州坎貝爾 – 2023 年 4 月 12 日 – 致力于加速片上系統(tǒng)(SoC)創(chuàng)建的領先系統(tǒng) IP 提供商Arteris, Inc.(納斯達克股票代碼:AIP),今天宣布 ASICLAND 已獲得具有汽車安全完整性等級 ASIL B 和 AI 選項的Arteris FlexNoC授權。該技術將被用于汽車的主系統(tǒng)總線和各種應用的AI SoC之中。ASICLAND是一家領先的ASIC半導體和SoC設計服務公司。該公司為5nm,7nm,12nm,16nm和28nm處理器開發(fā)了許多具有復雜技術的半導體產
          • 關鍵字: ASICLAND  SoC  Arteris  IP  

          IAR Embedded Secure IP保障產品開發(fā)后期安全性

          • 憑借IAR的全新安全解決方案,嵌入式開發(fā)人員即使是在軟件開發(fā)過程的后期階段,也能輕松地為現(xiàn)有應用植入可靠的安全性,并直接投入生產瑞典烏普薩拉–2023年4月13日–嵌入式開發(fā)軟件和服務的全球領導者IAR宣布推出IAR Embedded Secure IP解決方案,以幫助開發(fā)者即使在產品項目周期的后期,也能夠為其固件應用植入嵌入式安全方案。通過IAR Embedded Secure IP解決方案,軟件經理、工程師和項目經理可以在設計過程中的任何階段,甚至是生產和制造階段,以獨特、靈活且安全的方式快速升級他們
          • 關鍵字: IAR Embedded Secure IP  開發(fā)后期安全性  

          “周易”X2 NPU:屬于中國的科技與浪漫

          • 日前,安謀科技召開新品發(fā)布會,正式宣布推出自研新一代人工智能處理器“周易”X2 NPU。作為安謀科技自研IP的又一力作,“周易”X2 NPU不僅在算力、精度、靈活性等方面進行了大幅提升,還針對車載、邊緣計算等應用場景進行了專門優(yōu)化,為新興領域不斷迭代的計算需求提供更為完善的解決方案。具有無法忽視的巨大潛力——汽車市場“周易”X2 NPU 第一個瞄準的是汽車市場,中國有強勁的汽車發(fā)展動力,據(jù)觀察近年來中國市場汽車銷量約占全球汽車銷量的1/3。中國市場不僅僅吸引全球汽車企業(yè),近兩年中國本土也涌現(xiàn)除了大批本土智
          • 關鍵字: 安謀科技  NPU  AI處理器  

          自研矩陣再添新軍!安謀科技發(fā)布新一代“周易”X2 NPU

          •  2023年3月28日,安謀科技(中國)有限公司(以下簡稱“安謀科技”)正式發(fā)布自研新一代人工智能處理器“周易”X2 NPU。作為安謀科技自研IP的又一力作,“周易”X2 NPU不僅在算力、精度、靈活性等方面進行了大幅提升,還針對車載、邊緣計算等應用場景進行了專門優(yōu)化,為新興領域不斷迭代的計算需求提供更為完善的解決方案。隨著“周易”X2 NPU的推出,安謀科技正式發(fā)布“周易”NPU軟件開源計劃,通過開放源碼,滿足客戶更自主、更靈活的算法移植需求,攜手合作伙伴共建國內NPU產業(yè)生態(tài)。安謀科技聯(lián)席C
          • 關鍵字: NPU  安謀科技  周易  

          半導體IP企芯原股份預計2022年凈利同比增長455.31%

          • 2月23日,半導體IP企業(yè)芯原股份公布2022年年度業(yè)績快報,報告期內,公司預計實現(xiàn)營業(yè)收入26.79億元,同比增長25.23%;預計實現(xiàn)歸屬于母公司所有者的凈利潤7381.43萬元,同比增長455.31%。芯原股份表示,2022年度,在半導體產業(yè)周期的景氣度轉換、下行壓力增大的產業(yè)背景下,公司保持了營業(yè)收入同比快速增長趨勢。其中知識產權授權使用費收入預計同比增長28.79%、特許權使用費收入預計同比增長12.49%、芯片設計業(yè)務收入預計同比增長4.46%、量產業(yè)務收入預計同比增長36.41%。2022年
          • 關鍵字: IP  芯原股份  

          Arteris推出下一代FlexNoC 5物理感知片上網絡IP

          • 亮點: ●? ?第五代片上網絡互連硅IP技術●? ?與手動物理迭代相比,物理收斂速度快5倍●? ?使客戶能夠在時間進度和預算限制內實現(xiàn)PPA目標致力于加速片上系統(tǒng)(SoC)創(chuàng)建的領先系統(tǒng) IP 提供商Arteris,?Inc.(納斯達克股票代碼:AIP)今天宣布,推出 Arteris FlexNoC 5 物理感知片上網絡(NoC)互連 IP。FlexNoC 5 使 SoC 架構團隊、邏輯設計人員和集成商能夠整合跨功耗、性能和面積(PPA
          • 關鍵字: Arteris  FlexNoC 5  物理感知片上網絡  IP  

          倍捷連接器收購IP&E供應商Testco Inc.

          • 倍捷連接器(PEI-Genesis)總裁兼首席執(zhí)行官Steven Fisher正式宣布收購有40年歷史,總部位于加州的連接、被動、和機電元器件(IP&E)供應商Testco Inc.,。Steven Fisher表示:“此次收購將為客戶提供更廣泛的IP&E產品方案。我們是行業(yè)值得信賴的互連專家,本次收購有助于提升我們解決互連問題的能力,更豐富的產品和服務,會進一步加強我們和客戶的合作。”40年以來,Testco?Inc.?為全球科技公司提供連接、被動、和機電元器件(IP
          • 關鍵字: 倍捷連接器  IP&E  Testco  

          芯來科技:立足開源架構,做好RISC-V生態(tài)圈

          • 過去幾年,國際形勢的變化讓壯大中國芯片設計產業(yè)成為中國半導體產業(yè)發(fā)展的主題,伴隨著全社會對中國半導體產業(yè)的關注提升和資本的涌入,整個半導體設計產業(yè)鏈迎來全面的發(fā)展機遇。對中國集成電路設計產業(yè)來說,芯片設計能力的提升,不僅需要設計公司技術的提升,還需要先進的本土芯片制造能力和相關設計工具的鼎力支撐。  隨著國內芯片設計企業(yè)的大量涌現(xiàn),本土芯片設計帶動著設計IP需求增長非常明顯,這不僅給成立多年的本土IP企業(yè)發(fā)展的黃金機遇,同時也催生出大量的新興IP初創(chuàng)企業(yè),這些企業(yè)的起點高、IP運作經驗豐富,共同
          • 關鍵字: 芯來科技  RISC-V  IP  ICCAD  

          奎芯科技:致力于打通Chiplet設計到封裝全鏈條

          • 過去幾年,國際形勢的變化讓壯大中國芯片設計產業(yè)成為中國半導體產業(yè)發(fā)展的主題,伴隨著全社會對中國半導體產業(yè)的關注提升和資本的涌入,整個半導體設計產業(yè)鏈迎來全面的發(fā)展機遇。對中國集成電路設計產業(yè)來說,芯片設計能力的提升,不僅需要設計公司技術的提升,還需要先進的本土芯片制造能力和相關設計工具的鼎力支撐。 隨著國內芯片設計企業(yè)的大量涌現(xiàn),本土芯片設計帶動著設計IP需求增長非常明顯,這不僅給成立多年的本土IP企業(yè)發(fā)展的黃金機遇,同時也催生出大量的新興IP初創(chuàng)企業(yè),這些企業(yè)的起點高、IP運作經驗豐富,共同為
          • 關鍵字: 奎芯科技  Chiplet  IP  ICCAD  

          Codasip 宣布成立 Codasip 實驗室,以加速行業(yè)前沿技術的開發(fā)和應用!

          • 德國慕尼黑,2022年12月7日——處理器設計自動化和RISC-V處理器IP的領導者Codasip今日宣布成立Codasip實驗室(Codasip Labs)。作為公司內部創(chuàng)新中心,新的Codasip實驗室將支持關鍵應用領域中創(chuàng)新技術的開發(fā)和商業(yè)應用,覆蓋了安全、功能安全(FuSa)和人工智能/機器學習(AI/ML)等方向。該實驗室的使命在于識別和構建相關技術,以擴展定制計算的可能性,并加快具有定制化的、領域專用設計的差異化產品的開發(fā),并縮短其上市時間。Codasip實驗室將由公司創(chuàng)始人兼總裁馬克仁(Ka
          • 關鍵字: Codasip  Codasip 實驗室  IP  RISC-V  
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          neo npu ip介紹

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