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          差分對:你需要了解的與過孔有關(guān)的四件事

          • 差分對:你需要了解的與過孔有關(guān)的四件事- 在一個高速印刷電路板 (PCB) 中,通孔在降低信號完整性性能方面一直飽受詬病。然而,過孔的使用是不可避免的。在標準的電路板上,元器件被放置在頂層,而差分對的走線在內(nèi)層。內(nèi)層的電磁輻射和對與對之間的串擾較低。必須使用過孔將電路板平面上的組件與內(nèi)層相連。
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          工程師設(shè)計小Tips:PCB設(shè)計接地問題精要

          •   模擬地/數(shù)字地以及模擬電源/數(shù)字電源只不過是相對的概念。提出這些概念的主要原因是數(shù)字電路對模擬電路的干擾已經(jīng)到了不能容忍的地步。目前的標準處理辦法如下:  1.地線從整流濾波后就分為2根,其中一根作為模擬地,所有模擬部分的電路地全部接到這個模擬地上面;另一根為數(shù)字地,所有數(shù)字部分的電路地全部接到這個數(shù)字地上面?! ?.直流電源穩(wěn)壓芯片出來,經(jīng)過濾波后同樣分為2根,其中一根經(jīng)過LC/RC濾波后作為模擬電源,所有模擬部分的電路電源全部接到這個模擬電源上面;另一根為數(shù)字電源,所有數(shù)字部分的電路電源全部接到這
          • 關(guān)鍵字: PCB  接地  

          PCB設(shè)計布通率及設(shè)計效率技巧

          •   PCB布線設(shè)計中,對于布通率的的提高有一套完整的方法,在此,我們?yōu)榇蠹姨峁┨岣逷CB設(shè)計布通率以及設(shè)計效率的有效技巧,不僅能為客戶節(jié)省項目開發(fā)周期,還能最大限度的保證設(shè)計成品的質(zhì)量?! ?、確定PCB的層數(shù)  電路板尺寸和布線層數(shù)需要在設(shè)計初期確定。如果設(shè)計要求使用高密度球柵數(shù)組(BGA)組件,就必須考慮這些器件布線所需要的最少布線層數(shù)。布線層的數(shù)量以及層疊(stack-up)方式會直接影響到印制線的布線和阻抗。板的大小有助于確定層疊方式和印制線寬度,實現(xiàn)期望的設(shè)計效果?! 《嗄陙?,人們總是認為電路板
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          PCB元件布局原則與實用小技巧

          • PCB元件布局原則與實用小技巧-在電子設(shè)計中,項目原理圖設(shè)計完成編譯通過之后,就需要進行PCB的設(shè)計。PCB設(shè)計首先在確定了板形尺寸,疊層設(shè)計,整體的分區(qū)構(gòu)想之后,就需要進行設(shè)計的第一步:元件布局。
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          高速PCB布線的四大技巧和要領(lǐng)

          • 高速PCB布線的四大技巧和要領(lǐng)-在高速PCB的設(shè)計過程中,布線是技巧最細、限定最高的,工程師在這個過程中往往會面臨各種問題。本文將首先對PCB做一個基礎(chǔ)的介紹,同時對布線的原則做一個簡單講解,最后還會帶來非常實用的四個PCB布線的技巧和要領(lǐng)。
          • 關(guān)鍵字: PCB布線  pcb  數(shù)字電路  

          【技巧分享】PCB電路板散熱設(shè)計技巧

          • 【技巧分享】PCB電路板散熱設(shè)計技巧-設(shè)備過熱會導(dǎo)致器件失效,電子設(shè)備的可靠性能就會下降,故PCB電路板的散熱是一個非常重要的環(huán)節(jié),那么PCB電路板散熱技巧是怎樣的,下面我們一起來討論下。
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          干貨!匯總電路開發(fā)設(shè)計使用的軟件

          • 干貨!匯總電路開發(fā)設(shè)計使用的軟件-電路開發(fā)設(shè)計需要學(xué)習(xí)的軟件有哪些?電路設(shè)計軟件指的是電路圖繪制、優(yōu)化、測試、仿真類軟件。在國內(nèi),開發(fā)使用做多的電路設(shè)計軟件如下:protel,powerpcb,Allegro,orcad,cam350等等,這些電路設(shè)計軟件包含電原理圖繪制、印制電路板設(shè)計、數(shù)字電路仿真、可編程邏輯器件設(shè)計等功能,可以幫助大家更好的開發(fā)和學(xué)習(xí)。
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          面積緊湊的PCB也可實現(xiàn)高功率數(shù)字控制與遙測功能

          • 面積緊湊的PCB也可實現(xiàn)高功率數(shù)字控制與遙測功能-對于任何人來說,數(shù)字電源系統(tǒng)管理 (DPSM) 在通信和計算機行業(yè)內(nèi)的持續(xù)采用,在很大程度上繼續(xù)由位于其系統(tǒng)架構(gòu)核心的 20nm 以下 ASIC 和 / 或 FPGA 所需之高電流水平驅(qū)動都是不足為奇的。我們以下一代數(shù)據(jù)中心交換機中使用的最新 ASIC 為例來說明。
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          非同小可:如何簡化減小穩(wěn)壓器尺寸的工序

          • 非同小可:如何簡化減小穩(wěn)壓器尺寸的工序-如果可以簡化減小穩(wěn)壓器尺寸的工序就好了,但在大多數(shù)情況下,可用的電路板空間總是不夠容納所有的部件,有限的空間需要承載更多的特性和功能。 高集成度和摩爾定律在減小設(shè)備尺寸方面非常有效,但對于直流(DC/DC)轉(zhuǎn)換器卻效果不大,因為功率轉(zhuǎn)換器往往要占用30%到50%的系統(tǒng)空間。那么,怎樣才能突破這一瓶頸呢?
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          (多圖) PCB設(shè)計:如何減少錯誤并提高效率

          • (多圖) PCB設(shè)計:如何減少錯誤并提高效率-電路板設(shè)計是一項關(guān)鍵而又耗時的任務(wù),出現(xiàn)任何問題都需要工程師逐個網(wǎng)絡(luò)逐個元件地檢查整個設(shè)計。可以說電路板設(shè)計要求的細心程度不亞于芯片設(shè)計。下面我們一起來探討在PCB設(shè)計時如何減少錯誤并提高效率?
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          高速ADC PCB的布局布線技巧

          • 高速ADC PCB的布局布線技巧-在高速模擬信號鏈設(shè)計中,印刷電路板(PCB)布局布線需 要考慮許多選項,有些選項比其它選項更重要,有些選項 則取決于應(yīng)用。最終的答案各不相同,但在所有情況下, 設(shè)計工程師都應(yīng)盡量消除最佳做法的誤差,而不要過分計 較布局布線的每一個細節(jié)。
          • 關(guān)鍵字: 高速ADC  pcb  

          降低噪聲與電磁干擾的PCB設(shè)計24個竅門

          • 降低噪聲與電磁干擾的PCB設(shè)計24個竅門-電子設(shè)備的靈敏度越來越高,這要求設(shè)備的抗干擾能力也越來越強,因此PCB設(shè)計也變得更加困難,如何提高PCB的抗干擾能力成為眾多工程師們關(guān)注的重點問題之一。本文將介紹PCB設(shè)計中降低噪聲與電磁干擾的一些小竅門。
          • 關(guān)鍵字: PCB  電磁干擾  

          電源模塊的PCB設(shè)計

          • 電源模塊的PCB設(shè)計-線性電源功率器件工作在線性狀態(tài),如我們常用的穩(wěn)壓芯片LM7805、LM317、SPX1117等。下圖一是LM7805穩(wěn)壓電源電路原理圖。
          • 關(guān)鍵字: PCB  電源模塊  

          模擬技術(shù)在AT切割晶體諧振器設(shè)計上的應(yīng)用

          • 模擬技術(shù)在AT切割晶體諧振器設(shè)計上的應(yīng)用-振蕩電路重要的一點是振蕩穩(wěn)定,其指標之一是振蕩裕量 ,顯示對于ESR(信號衰減的重要原因),電路中晶體諧振器以外的部分有多大的信號增幅能力。理論上,振蕩裕量>1,電路就會振蕩,但偶爾會出現(xiàn)在接近1倍時不振蕩、振蕩啟動時間異常地長等現(xiàn)象,導(dǎo)致電路所在設(shè)備不能正常工作。
          • 關(guān)鍵字: ESR  諧振器  振蕩電路  

          專家支招:通過PCB分層堆疊設(shè)計控制EMI輻射

          • 專家支招:通過PCB分層堆疊設(shè)計控制EMI輻射-解決EMI問題的辦法很多,現(xiàn)代的EMI抑制方法包括:利用EMI抑制涂層、選用合適的EMI抑制零配件和EMI仿真設(shè)計等。本文從最基本的PCB布板出發(fā),討論PCB分層堆疊在控制EMI輻射中的作用和設(shè)計技巧。
          • 關(guān)鍵字: 電磁干擾  PCB  
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