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嵌入式應(yīng)用設(shè)計(jì)模式
- 簡(jiǎn)介 首先介紹嵌入式應(yīng)用的概念,接著闡述軟件開(kāi)發(fā)和硬件設(shè)計(jì)的方法和發(fā)展趨勢(shì)。開(kāi)發(fā)軟件的使用從匯編語(yǔ)言→C ...
- 關(guān)鍵字: C語(yǔ)言 RTOS SOC PLD VHDL平臺(tái)
采用MachXO的PLD控制開(kāi)發(fā)技術(shù)設(shè)計(jì)
- 采用MachXO的PLD控制開(kāi)發(fā)技術(shù)設(shè)計(jì),MachXO PLD是非易失的可以無(wú)限次重新配置的可編邏輯器件PLD),具有256-2280個(gè)查找表(LUT),73-271個(gè)I/O,多達(dá)27.6Kb sysMEM嵌入?yún)^(qū)塊RAM,多達(dá)7.7Kb分布式RAM,可編程的sysIOtrade;緩沖器支持LVCMOS 3.3/2.5/1.8/
- 關(guān)鍵字: 開(kāi)發(fā)技術(shù) 設(shè)計(jì) 控制 PLD MachXO 采用
用VHDL/VerilogHD語(yǔ)言開(kāi)發(fā)PLD/FPGA的完整流程
- 用VHDL/VerilogHD語(yǔ)言開(kāi)發(fā)PLD/FPGA的完整流程,用VHDL/VerilogHD語(yǔ)言開(kāi)發(fā)PLD/FPGA的完整流程為: 1.文本編輯:用任何文本編輯器都可以進(jìn)行,也可以用專用的HDL編輯環(huán)境。通常VHDL文件保存為.vhd文件,Verilog文件保存為.v文件 2.功能仿真:將文件調(diào)入HDL仿真
- 關(guān)鍵字: 完整 流程 PLD/FPGA 開(kāi)發(fā) 語(yǔ)言 VHDL/VerilogHD
PLD技術(shù)在功能薄膜材料研究中的應(yīng)用
- 薄膜材料已在半導(dǎo)體材料、超導(dǎo)材料、生物材料、微電子元件等方面得到廣泛應(yīng)用。為了得到高質(zhì)量的薄膜材料,脈沖激光沉積技術(shù)受到了廣泛的關(guān)注。本文介紹了脈沖激光沉積(PLD)薄膜技術(shù)的原理及特點(diǎn),分析了脈沖激光沉積
- 關(guān)鍵字: PLD 薄膜 材料 中的應(yīng)用
pld介紹
一、概述
PLD(programmable logic device)--可編程邏輯器件:PLD是做為一種通用集成電路生產(chǎn)的,他的邏輯功能按照用戶對(duì)器件編程來(lái)高定。一般的PLD的集成度很高,足以滿足設(shè)計(jì)一般的數(shù)字系統(tǒng)的需要。這樣就可以由設(shè)計(jì)人員自行編程而把一個(gè)數(shù)字系統(tǒng)“集成”在一片PLD上,而不必去請(qǐng)芯片制造廠商設(shè)計(jì)和制作專用的集成電路芯片了。
二、分類
目前和平和使用的P [ 查看詳細(xì) ]
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