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serdes ip 文章進入serdes ip技術社區(qū)

USB2.0主機控制器IP核的設計

USB2.0主機控制器IP核的設計,摘要：為了擺脫對USB2.0 主機控制器ASIC 芯片的依賴，提高產品集成度，本文設計了針對全速和高速USB 海量存儲設備的USB2.0 主機控制器IP 核。首先介紹USB2.0 主機控制器IP核中主要涉及的USB2.0 通信協(xié)議以及與物理層
關鍵字：設計 IP 控制器主機 USB2.0

基于SIP協(xié)議的IP電話通信系統(tǒng)的組成原理

0 概述
IP電話以其通話費率低、方便集成和智能化等優(yōu)勢而得到了眾多消費者的極大認可，并因此而對原有固定電話運營者的長途電話和國際電話業(yè)務造成了巨大沖擊。因此，隨著以太網(wǎng)接口的直接入戶，開發(fā)出一種帶有RJ-4
關鍵字：系統(tǒng) 組成原理通信電話 SIP 協(xié)議 IP 基于

NGN IP地址分配和路由的設計及規(guī)劃

NGN業(yè)務具有端到端(Peer-to-Peer)及永久在線(Always-on-Line)的通信模式，需要分配大量IP地址，存在公網(wǎng)IP地址不足的問題。同時運營商在城域網(wǎng)中必須采用靜態(tài)路由、動態(tài)路由、策略路由和路由策略等技術設置城域網(wǎng)路由
關鍵字：設計規(guī)劃路由分配 IP 地址 NGN

基于FPGA LPM多功能信號發(fā)生器設計

摘要：以FPGA芯片為載體，通過QuartusII的LPM_ROM模塊和VHDL語言為核心設計一個多功能信號發(fā)生器，根據(jù)輸入...
關鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

基于FPGA的電子設計競賽電路板的設計與實現(xiàn)

摘要：介紹了一種基于FPGA的電子設計競賽電路板，該電路板由美國Altera公司的Cyclone系列FPGAEP1C6、單片...
關鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

基于FPGA的像素探測器數(shù)據(jù)緩存設計

粒子對撞機[1]是建立在高能同步加速器上的一種粒子對撞裝置。對撞機運行時，能量強大的粒子在其內部經過加速...
關鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

基于FPGA的CORDIC算法的改進及實現(xiàn)

坐標旋轉計算機CORDIC(TheCoordinateRotationalDigitalComputer)算法是一種用于計算一些常用的基本運算...
關鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

低壓差分SerDes的全雙工互連和分組數(shù)據(jù)傳輸技術

低壓差分SerDes的全雙工互連和分組數(shù)據(jù)傳輸技術,由于現(xiàn)代數(shù)字信號處理器(dsp)設計、半導體工藝、并行處理和互連與傳輸技術的進步，現(xiàn)代高性能dsp的處理能力得到極大發(fā)展。但在移動通信、雷達信號處理和實時圖像處理等復雜電子系統(tǒng)中，單片dsp的性能仍可能無法滿足需
關鍵字：數(shù)據(jù)傳輸技術分組全雙工差分 SerDes 低壓

符合IEEE1451標準的IP傳感器的設計方案介紹

摘要:本文基于簡化的IEEE1451智能傳感器信息模型,提出了基于嵌入式Internet技術的IP傳感器模型,并進行了原型實現(xiàn)。分析了IP傳感器的網(wǎng)絡時延問題,并在網(wǎng)絡環(huán)境下對其時延性能進行了測試。實驗結果表明,所設計的IP傳感器可廣泛應用于分布式網(wǎng)絡化傳感、測量和控制系統(tǒng)。　　

關鍵詞:智能傳感器;IP傳感器;網(wǎng)絡化傳感;網(wǎng)絡時延
關鍵字：設計方案介紹傳感器 IP IEEE1451 標準符合

基于數(shù)字媒體處理器芯片em8620l的ip機頂盒設計

基于數(shù)字媒體處理器芯片em8620l的ip機頂盒的電路,外圍電路簡單,實用性強,可實現(xiàn)各種高質量的視頻、音頻輸出,并通過網(wǎng)絡支持視頻點播。iptv是利用寬帶網(wǎng)基礎設施,以家用電視機（或計算機）作為顯示設備、集互聯(lián)網(wǎng)、多
關鍵字： ip 機頂盒設計 em8620l 芯片數(shù)字媒體處理器基于

賽靈思推出關鍵互聯(lián)IP

全球可編程平臺領導廠商賽靈思公司 (Xilinx, Inc. )今天宣布推出三款對構建低成本高靈活性可編程 3G+/4G 無線基站至關重要的關鍵互聯(lián)功能 IP ——賽靈思Serial RapidIO Gen 2 v1.2 終端LogiCORE IP、JESD204 v1.1 LogiCORE IP以及CPRI v4.1 LogiCORE IP，所有這三款產品均支持各類互聯(lián)標準，可幫助開發(fā)人員在構建具有更高系統(tǒng)容量的新型無線網(wǎng)絡設備時，克服各種設計挑戰(zhàn)。
關鍵字： Xilinx LogiCORE IP

使用賽靈思FPGA實現(xiàn)位與周期準確的浮點DSP算法

現(xiàn)有FPGA和系統(tǒng)級要求導致對浮點運算的需求變得越來越普遍。此視頻演示了SystemGeneratorforDSP是如何為...
關鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費電子 FPGA

基于DSP的IP電話設計

基于DSP的IP電話設計,引言傳統(tǒng)的電話網(wǎng)是以電路交換的方式傳輸語音信號的，它需要的基本帶寬為64kbit/s。據(jù)統(tǒng)計，在正常通話情況下，大約只有40％的時間為有聲期，其余時間電路均為空占，網(wǎng)絡帶寬利用率不高。隨著計算機技術的不斷發(fā)
關鍵字：設計電話 IP DSP 基于

衛(wèi)星IP通信網(wǎng)設計技術分析

隨著互聯(lián)網(wǎng)應用的不斷普及和影響范圍的擴大，各種通信方式都在適應IP( 網(wǎng)際協(xié)議) 應用。衛(wèi)星通信也不例外，逐步從傳統(tǒng)透明傳輸方式向IP 傳輸方式發(fā)展。但是衛(wèi)星通信用于傳輸IP 業(yè)務有自己獨特的特點需要在設計時考慮
關鍵字：技術分析設計通信網(wǎng) IP 衛(wèi)星

TCP/IP的以太網(wǎng)LCD電子標簽系統(tǒng)設計

近年來，由于電子商務的發(fā)展，物流業(yè)呈現(xiàn)出JIT運送普及化、小批量、多品種、高頻率的貨物運輸?shù)忍攸c。在實際的生產作業(yè)中，對小批量、多品種、高頻率貨物的處理始終是一個難題?，F(xiàn)有電子標簽系統(tǒng)在控制上都是采用現(xiàn)場
關鍵字：系統(tǒng) 設計電子標簽 LCD 以太網(wǎng) TCP/IP

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串口聯(lián)網(wǎng)解決方案
CPU卡消費管理系統(tǒng)方案
Wifi 遙控模型解決方案
RS232/422/485轉TCP/IP服務器解決方案

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