soc 2 type ii 文章 進入soc 2 type ii技術社區(qū)
基于FPGA的數(shù)字顯示系統(tǒng)設計
- 本文以Virtex-II系列PlatformFPGA為例,說明采用FPGA方案進行數(shù)字顯示系統(tǒng)設計所具有的靈活、快速和低成本等特性。
- 關鍵字: 數(shù)字顯示系統(tǒng) SoC FPGA
SoundWaveIP子系統(tǒng)常見問題解答
- 一個IP子系統(tǒng)將多種經(jīng)驗證的IP模塊單元和完整的軟件解決方案整合到一個集成化設計之中,以完成一種諸如音頻、視頻及圖像這樣的系統(tǒng)級功能。
- 關鍵字: 音頻IP子系統(tǒng) SoC 軟件集成流程
基于CPLD的片內(nèi)振蕩器設計及其優(yōu)化
- 本文介紹一種通用的基于CPLD的片內(nèi)振蕩器設計方法,它基于環(huán)形振蕩器原理,只占用片上普通邏輯資源(LE),無需使用專用邏輯資源(如MaxII中的UFM),從而提高了芯片的資源利用率。
- 關鍵字: 片內(nèi)振蕩器 SoC CPLD
基于IP的智能傳感器SOC設計
- 利用SOC/IP芯片能組成完整的智能傳感器系統(tǒng)。智能傳感器傳感參數(shù)可能是多種多樣的。但從功能模塊組成來講,它主要包括數(shù)據(jù)采集模塊、補償與校正模塊、數(shù)據(jù)處理模塊、數(shù)據(jù)網(wǎng)絡通信模塊、人機界面和任務管理與調度模塊等功能單元。從而基于IP的智能傳感器SOC設計過程為:首先正確建立智能傳感器的通用模塊模型;然后合理劃分各摸塊功能規(guī)范,制定各模塊之間的接口協(xié)議與標準;再設計出一系列通用的IP核;最后把所需的通用IP核搭建整合在一起構成完整的智能傳感器系統(tǒng)。
- 關鍵字: 智能傳感器系統(tǒng) SoC IP核
低功耗制造性測試的設計-第二部分
- 假設設計的某個時鐘驅動了大量觸發(fā)器,以至它們的峰值開關動作超過設計的總體功率預算。我們不希望測試邏輯去改變?nèi)魏螘r鐘,相反我們將設計分割成N個模塊,各模塊具有自己的掃描啟動引腳,并且包含自己的掃描壓縮邏輯和掃描鏈。(如圖2所示)模塊的數(shù)量和組成需要仔細選取,以便任何單個模塊(包括具有大部分觸發(fā)器的模塊)的觸發(fā)器開關速率不超過總功率預算。從這方面講,可以認為分割將功率預算硬連(hardwire)進了設計。
- 關鍵字: ATPG 數(shù)字電路設計 SoC DFT
SOC設計流程及其集成開發(fā)環(huán)境
- SOC技術是當前大規(guī)模集成電路(VLSI)的發(fā)展趨勢,也是世紀集成電路技術的主流,其為集成電路產(chǎn)業(yè)和集成電路應用技術提供了前所未有的廣闊市場和難得的發(fā)展機遇。SOC為微電子應用產(chǎn)品研究、開發(fā)和生產(chǎn)提供了新型的優(yōu)秀的技術方法和工具,也是解決電子產(chǎn)品開發(fā)中的及時上市(TTM——Time to Market)的主要技術與方法。
- 關鍵字: SoC 集成開發(fā)環(huán)境 VLSI 嵌入式系統(tǒng) 處理器
Layerscape架構:深入理解下一代QorIQ LS系列SoC
- Layerscape架構是下一代QorIQ LS系列片上系統(tǒng)(SoC)的底層系統(tǒng)架構。從一開始便旨在充分利用新的開發(fā)、提取和效率現(xiàn)實條件(從字面的雙重含義理解),Layerscape架構的創(chuàng)建是為了讓程序員找到極為輕松的方式“釋放”每一塊芯片的性能。
- 關鍵字: Layerscape QorIQLS SoC 數(shù)據(jù)路徑加速 DPAA
soc 2 type ii介紹
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