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異步DSP核心設(shè)計方略:更低功耗,更高性能
- 目前,處理器性能的主要衡量指標(biāo)是時鐘頻率。絕大多數(shù)的集成電路 (IC) 設(shè)計都基于同步架構(gòu),而同步架構(gòu)都采用全球一致的時鐘。這種架構(gòu)非常普及,許多人認(rèn)為它也是數(shù)字電路設(shè)計的唯一途徑。然而,有一種截然不同的設(shè)計技術(shù)即將走上前臺:異步設(shè)計。 這一新技術(shù)的主要推動力來自硅技術(shù)的發(fā)展?fàn)顩r。隨著硅產(chǎn)品的結(jié)構(gòu)縮小到 90 納米以內(nèi),降低功耗就已成為首要事務(wù)。異步設(shè)計具有功耗低、電路更可靠等優(yōu)點,被看作是滿足這一需要的途徑。
- 關(guān)鍵字: 異步; DSP
用DSP和FPGA構(gòu)建多普勒測量系統(tǒng)
- 隨著FPGA性能和容量的改進(jìn),使用FPGA執(zhí)行DSP功能的做法變得越來越普遍。
- 關(guān)鍵字: 多普勒 DSP 測量系統(tǒng) FPGA
基于DSP控制的全數(shù)字UPS逆變器設(shè)計(一)
- 隨著信息處理技術(shù)的不斷發(fā)展,尤其是計算機的廣泛應(yīng)用和Internet的迅猛發(fā)展,供電系統(tǒng)的可靠性要求越來越高,因此對不間斷電源(UPS)技術(shù)指標(biāo)的要求也越來越高。UPS的核心部分是一個恒頻恒壓逆變器,由于傳統(tǒng)模擬控制需要使用大量的分立元器件,老化和溫漂嚴(yán)重影響了系統(tǒng)的長期穩(wěn)定性?;贒SP的數(shù)字控制技術(shù)能大大改善產(chǎn)品的一致性,同時增加了控制的柔性,提高了整個系統(tǒng)的穩(wěn)定性和可靠性[1]。本文主要提出了一種數(shù)字控制的UPS逆變器結(jié)構(gòu),詳細(xì)論述了控制系統(tǒng)的參數(shù)設(shè)計。
- 關(guān)鍵字: UPS逆變器 DSP 數(shù)字雙環(huán)控制器
基于DSP的加速度計的家用監(jiān)測設(shè)備設(shè)計
- 先進(jìn)的半導(dǎo)體技術(shù)正為體積越來越小、功能愈加強大的家用醫(yī)療設(shè)備的發(fā)展鋪平道路。對于病人來說,更小的便攜式設(shè)備帶來的好處是更容易進(jìn)行保健、更少去醫(yī)院以及進(jìn)一步降低醫(yī)療費用。
- 關(guān)鍵字: DSP 家用監(jiān)測 加速度計
目標(biāo)設(shè)計平臺使基于FPGA的系統(tǒng)開發(fā)易如反
- 賽靈思公司在正式發(fā)布新一代旗艦產(chǎn)品高性能Virtex-6和低成本Spartan-6 FPGA時,首次提出了“目標(biāo)設(shè)計平臺”的新概念。賽靈思目標(biāo)設(shè)計平臺包含五個關(guān)鍵部分:Virtex-6和Spartan-6 FPGA器件、支持和集成業(yè)界成熟設(shè)計方法的設(shè)計環(huán)境、采用業(yè)界標(biāo)準(zhǔn)FPGA多層連接器的可擴展板和套件、提供接口的IP內(nèi)核和強大的參考設(shè)計。
- 關(guān)鍵字: 目標(biāo)設(shè)計平臺 系統(tǒng)開發(fā) FPGA Virtex-6 Spartan-6
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