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集成工具可提高嵌入式DSP系統(tǒng)的設(shè)計(jì)與驗(yàn)證自動(dòng)化程度
- 集成工具可提高嵌入式DSP系統(tǒng)的設(shè)計(jì)與驗(yàn)證自動(dòng)化程度,嵌入式DSP系統(tǒng)傳統(tǒng)設(shè)計(jì)流程通常由概念到算法及算法到產(chǎn)品兩個(gè)階段構(gòu)成,通常這兩個(gè)階段互相獨(dú)立且由不同設(shè)計(jì)小組完成。傳統(tǒng)的設(shè)計(jì)流程里要用手工在兩個(gè)階段之間進(jìn)行轉(zhuǎn)換與銜接,這樣容易出現(xiàn)錯(cuò)誤而推遲產(chǎn)品的上市時(shí)間
- 關(guān)鍵字: 設(shè)計(jì) 驗(yàn)證 自動(dòng)化 程度 系統(tǒng) DSP 工具 提高 嵌入式 集成
非規(guī)則LDPC碼譯碼改進(jìn)算法及其DSP實(shí)現(xiàn)
- 非規(guī)則LDPC碼譯碼改進(jìn)算法及其DSP實(shí)現(xiàn),為了降低非規(guī)則低密度奇偶校驗(yàn)(low-densityparity-check,LDPC)碼譯碼算法的復(fù)雜度,提出一種適合數(shù)字信號(hào)處理囂(digital signal processor,DSP)實(shí)現(xiàn)的低運(yùn)算復(fù)雜度、低誤碼平臺(tái)譯碼的改進(jìn)算法。該算法校驗(yàn)節(jié)點(diǎn)的運(yùn)算
- 關(guān)鍵字: DSP 實(shí)現(xiàn) 及其 算法 LDPC 改進(jìn) 規(guī)則
線性預(yù)測(cè)及其Matlab實(shí)現(xiàn)
- 線性預(yù)測(cè)分析是現(xiàn)代語(yǔ)音信號(hào)處理中最核心的技術(shù)之一,為現(xiàn)代語(yǔ)音信號(hào)處理的飛速發(fā)展立下了赫赫功勞,在語(yǔ)音...
- 關(guān)鍵字: 線性預(yù)測(cè) DSP Matlab
Altera推出Quartus? II軟件12.1版
- Altera公司 (Nasdaq: ALTR) 日前宣布,推出Quartus? II軟件12.1版——在CPLD、FPGA、SoC FPGA和HardCopy? ASIC設(shè)計(jì)方面,性能和效能在業(yè)界首屈一指的設(shè)計(jì)套裝軟件。這一最新版軟件進(jìn)一步簡(jiǎn)化傳統(tǒng)的硬件開發(fā)任務(wù),增強(qiáng)了Quartus II軟件的高級(jí)設(shè)計(jì)環(huán)境,因此,用戶提高了效能,同時(shí)全面受益于Altera器件的各種前沿功能。
- 關(guān)鍵字: Altera Quartus FPGA DSP
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