virtex-5fpga 文章 進(jìn)入virtex-5fpga技術(shù)社區(qū)
基于Xilinx FPGA的千兆以太網(wǎng)控制器的開發(fā)
- 1.千兆以太網(wǎng)技術(shù)簡介以太網(wǎng)技術(shù)是當(dāng)今應(yīng)用廣泛的網(wǎng)絡(luò)技術(shù),千兆以太網(wǎng)技術(shù)繼承了以往以太網(wǎng)技術(shù)的...
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賽靈思發(fā)布提高了抗輻射性和性能的航天用FPGA
- 美國賽靈思(Xilinx)發(fā)布了抗輻射性和性能均高于其原產(chǎn)品的航天領(lǐng)域用FPGA“Virtex-5QV FPGA”。將耐輻射總劑量(TID)提高到了該公司原產(chǎn)品的2倍以上之外,其規(guī)模也達(dá)到了13萬個邏輯單元,作為航天領(lǐng)域用FPGA中屬業(yè)界最高水準(zhǔn)。此外,還集成了最高速度為3.125Gbit/秒的高速收發(fā)器,并強(qiáng)化了DSP功能。主要面向人造衛(wèi)星和宇宙飛船上的遙感處理、圖像處理以及導(dǎo)航儀等用途。目前正在樣品供貨,將從2011年1~3月開始65nm工藝的量產(chǎn)。賽靈思表示:&ldquo
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利用Virtex-5LXT應(yīng)對串行背板接口設(shè)計(jì)挑戰(zhàn)
- 采用串行技術(shù)進(jìn)行高端系統(tǒng)設(shè)計(jì)已占很大比例。在《EETimes》雜志最近開展的一次問卷調(diào)查中,有92%的受訪者...
- 關(guān)鍵字: FPGA Virtex-5LXT 嵌入式 串行背板接口
賽靈思基于業(yè)界首款統(tǒng)一可擴(kuò)展架構(gòu)的7系列FPGA全新登場
- 功耗銳減 50%,容量高達(dá) 200 萬個邏輯單元 Virtex-7、Kintex-7 和 Artix-7 系列實(shí)現(xiàn)了突破性的低功耗、高系統(tǒng)性能與設(shè)計(jì)效率,可充分滿足新型應(yīng)用和市場需求 2010 年 6 月 22 日,中國北京訊 — 全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX))今天宣布推出業(yè)界首款采用唯一統(tǒng)一架構(gòu)、將整體功耗降低一半且具有業(yè)界最高容量(多達(dá) 200 萬個邏輯單元)的 FPGA 系列產(chǎn)品,能滿足從低成本到超高端系列產(chǎn)品的擴(kuò)展需求。賽靈
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Xilinx Virtex-6與Spartan-6 FPGA連接目標(biāo)參考設(shè)計(jì)支持PCI Express 兼容性設(shè)計(jì)
- 全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX) )日前宣布其Spartan®-6與Virtex®-6 FPGA連接目標(biāo)參考設(shè)計(jì)通過PCI Express®認(rèn)證,為支持開發(fā)人員的下一代高速串行I/O設(shè)計(jì), 提供了一個完整且切實(shí)可行的參考實(shí)例。作為賽靈思連接目標(biāo)設(shè)計(jì)平臺的一部分,該參考設(shè)計(jì)將能夠?yàn)樵O(shè)計(jì)人員提供所需資源,讓他們可以把時間集中在差異化產(chǎn)品的設(shè)計(jì)上,從而加快其客戶終端產(chǎn)品系統(tǒng)的部署速度。 賽靈思平臺營銷總監(jiān)Brent Przy
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NEC Display Solutions 公司3D電影投影儀采用賽靈思 FPGA
- 全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX) )日前宣布NEC子公司NEC Display Solutions有限公司的三款DLP 數(shù)字影院投影儀產(chǎn)品, 均采用了賽靈思Virtex®-5 FPGA系列產(chǎn)品。 DLP 數(shù)字影院投影儀符合美國數(shù)字影院計(jì)劃 (DCI1) 標(biāo)準(zhǔn),擁有一系列優(yōu)異的高安全特性,能夠滿足各種不同輸入信號的要求。該系統(tǒng)能忠實(shí)再現(xiàn)輸入源,而且集成的德州儀器 (TI) 高分辨率 2K(2,048 × 1,080 點(diǎn))DL
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安富利電子元件推出Xilinx Virtex-6 FPGA DSP開發(fā)工具套件
- 安富利公司旗下運(yùn)營機(jī)構(gòu)安富利電子元件宣布推出Xilinx® Virtex®-6 FPGA DSP開發(fā)工具套件。這套件是為DSP設(shè)計(jì)而打造,是Xilinx目標(biāo)設(shè)計(jì)平臺(Xilinx Targeted Design Platform) 一部分。它包括可以下載的器件定制版ISE® Design Suite: System Edition 11.4,已開始接受訂購,價格為2995美元,開發(fā)人員可以通過它快速啟動其設(shè)計(jì)。 無線、航空航天和國防、儀器和醫(yī)療成像設(shè)備以及其它計(jì)算密集型設(shè)
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眾志和達(dá)借助賽靈思可編程方案打造數(shù)據(jù)存儲新典范
- 全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司( Xilinx, Inc. )今天宣布, 北京眾志和達(dá)信息技術(shù)有限公司采用賽靈思可編程解決方案,成功打造了行業(yè)首款基于先進(jìn)的Storage-on-Chip(芯片級存儲)架構(gòu)、全部利用賽靈思高速高集成FPGA(現(xiàn)場可編程門陣列)芯片實(shí)現(xiàn)全部功能的虛擬磁帶庫產(chǎn)品——SureSave VTL5000。該產(chǎn)品將作為眾志和達(dá)公司面向企業(yè)級數(shù)據(jù)保護(hù)的旗艦產(chǎn)品,以其卓越的性能、靈活的擴(kuò)展性、高度的可靠性等優(yōu)勢, 為大、中型數(shù)據(jù)中心提供優(yōu)秀的數(shù)據(jù)保護(hù)解
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Virtex-5FPGA設(shè)計(jì)Gbps無線通信技術(shù)設(shè)計(jì)計(jì)算
- 本文基于Virtex-5FPGA設(shè)計(jì)面向未來移動通信標(biāo)準(zhǔn)的Gbps無線通信基站系統(tǒng),具有完全的可重配置性,可以完成MIMO、OFDM及LDPC等復(fù)雜信號處理算法,實(shí)現(xiàn)1Gbps速率的無線通信。
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賽靈思40nm Virtex-6 FPGA系列通過全生產(chǎn)驗(yàn)證
- 全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc. )與全球領(lǐng)先的半導(dǎo)體代工廠商聯(lián)華電子( UMC (NYSE: UMC; TSE: 2303))今天共同宣布,采用聯(lián)華電子高性能40nm工藝的Virtex®-6 FPGA,已經(jīng)完全通過生產(chǎn)前的驗(yàn)證。這是雙方工程團(tuán)隊(duì)為進(jìn)一步提升良率、增強(qiáng)可靠性并縮短生產(chǎn)周期而努力合作的成果。Virtex-6系列通過生產(chǎn)驗(yàn)證, 意味著聯(lián)華電子繼2009年3月發(fā)布首批基于40nm工藝的器件后,正式將該工藝轉(zhuǎn)入量產(chǎn)。 “對于我們長
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Xilinx最新開發(fā)套件集成Northwest Logic DMA 引擎IP
- 全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc.)今天宣布隆重推出最新Virtex®-6 和 Spartan®-6 FPGA連接開發(fā)套件,該套件將為客戶提供一個綜合的、易用的、經(jīng)硬件驗(yàn)證的開發(fā)環(huán)境。 這個新的連接開發(fā)套件的一個重要元素是包含了Northwest Logic公司高性能、分散-聚集 DMA 引擎IP的連接目標(biāo)參考設(shè)計(jì)。這個DMA 引擎IP與套件中的其它元素相結(jié)合,可以為多種基于 PCI Express的應(yīng)用提供高帶寬的運(yùn)營支持,使得客戶可以針對廣泛的高速連
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賽靈思同時推出六大領(lǐng)域優(yōu)化開發(fā)套件
- 全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc.)日前宣布,作為公司目標(biāo)設(shè)計(jì)平臺最新一步的發(fā)展,賽靈思同時推出六大領(lǐng)域優(yōu)化開發(fā)套件。目標(biāo)設(shè)計(jì)平臺是賽靈思公司幫助開發(fā)人員在FPGA 設(shè)計(jì)時專注于產(chǎn)品創(chuàng)新與差異化的創(chuàng)新理念。這些面向Virtex-6 和 Spartan-6 系列的開發(fā)平臺可大幅縮短實(shí)現(xiàn)最佳系統(tǒng)性能所需的時間,同時還確保片上系統(tǒng) (SoC) 開發(fā)階段的低功耗水平。這些最新套件主要針對嵌入式處理、DSP,以及構(gòu)建要求高速串行連接功能的系統(tǒng),為設(shè)計(jì)團(tuán)隊(duì)提供了專門針對設(shè)計(jì)流程而精
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virtex-5fpga介紹
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- Virtex 7 PCIE Gen3 Integrated Block tag管理
- Virtex-7 FPGA Gen3 Integrated Block Completion timeout機(jī)制
- virtex-5 PLL_ADV警告
- 利用 2.1i 版軟件約束 Virtex 設(shè)計(jì)
- Virtex-5 FPGA與JESD204A ADC接口兼容問題
- 2.1i 版布局規(guī)劃器支持 Virtex FPGA
- 利用 Virtex-4 EasyPath FPGA 的“在系統(tǒng) ECO”功能
- 適用于 Virtex-4 RocketIO MGT 的開關(guān)電源
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