FPGA設(shè)計(jì)經(jīng)驗(yàn)談

　　從大學(xué)時(shí)代第一次接觸FPGA至今已有10多年的時(shí)間。至今記得當(dāng)初第一次在EDA實(shí)驗(yàn)平臺(tái)上完成數(shù)字秒表，搶答器，密碼鎖等實(shí)驗(yàn)時(shí)，那個(gè)興奮勁。當(dāng)時(shí)由于沒有接觸到HDL硬件描述語(yǔ)言，設(shè)計(jì)都是在MAX+plus II原理圖環(huán)境下用74系列邏輯器件搭建起來(lái)的。后來(lái)讀研究生，工作陸陸續(xù)續(xù)也用過Quartus II，F(xiàn)oundation，ISE，Libero，并且學(xué)習(xí)了verilogHDL語(yǔ)言，學(xué)習(xí)的過程中也慢慢體會(huì)到verilog的妙用，原來(lái)一小段語(yǔ)言就能完成復(fù)雜的原理圖設(shè)計(jì)，而且語(yǔ)言的移植性可操作性比原理圖設(shè)計(jì)強(qiáng)很多。

　　在學(xué)習(xí)一門技術(shù)之前我們往往從它的編程語(yǔ)言入手，比如學(xué)習(xí)單片機(jī)時(shí)，我們往往從匯編或者C語(yǔ)言入門。所以不少開始接觸FPGA的開發(fā)人員，往往是從VHDL或者Verilog開始入手學(xué)習(xí)的。但我個(gè)人認(rèn)為，若能先結(jié)合《數(shù)字電路基礎(chǔ)》系統(tǒng)學(xué)習(xí)各種74系列邏輯電路，深刻理解邏輯功能，對(duì)于學(xué)習(xí)HDL語(yǔ)言大有裨益，往往會(huì)起到事半功倍的效果。

　　當(dāng)然，任何編程語(yǔ)言的學(xué)習(xí)都不是一朝一夕的事，經(jīng)驗(yàn)技巧的積累都是在點(diǎn)滴中完成，FPGA設(shè)計(jì)也無(wú)例外。下面就以我的切身體會(huì)，談?wù)凢PGA設(shè)計(jì)的經(jīng)驗(yàn)技巧。

　　1)看代碼，建模型

　　只有在腦海中建立了一個(gè)個(gè)邏輯模型，理解FPGA內(nèi)部邏輯結(jié)構(gòu)實(shí)現(xiàn)的基礎(chǔ)，才能明白為什么寫Verilog和寫C整體思路是不一樣的，才能理解順序執(zhí)行語(yǔ)言和并行執(zhí)行語(yǔ)言的設(shè)計(jì)方法上的差異。在看到一段簡(jiǎn)單程序的時(shí)候應(yīng)該想到是什么樣的功能電路。

　　例如：

　　上面這段代碼實(shí)現(xiàn)的功能就是一個(gè)帶使能端的2選1數(shù)據(jù)選擇器，如下圖所示。

　　再例如：