基于CPLD的異步ASI/SDI信號(hào)電復(fù)接光傳輸設(shè)備的設(shè)計(jì)
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圖4 時(shí)鐘恢復(fù)部分電路處理過(guò)程
解碼部分電路處理過(guò)程由圖5所示。通過(guò)圖5可以看到，由時(shí)鐘恢復(fù)芯片恢復(fù)出來(lái)的串行時(shí)鐘和串行數(shù)據(jù)輸入到解碼芯片，通過(guò)串/并轉(zhuǎn)換后輸出10位并行數(shù)據(jù)和27M的并行時(shí)鐘，以備下面FIFO電路的時(shí)鐘調(diào)整使用。具體各個(gè)工作模式下信號(hào)的時(shí)序圖見(jiàn)圖6。
圖5 解碼部分電路處理過(guò)程
圖6 各模式信號(hào)時(shí)序圖
FIFO部分電路處理過(guò)程如圖7所示。其中讀時(shí)鐘使用編碼電路恢復(fù)出來(lái)的27M并行時(shí)鐘，寫(xiě)時(shí)鐘使用本地的27M時(shí)鐘，通過(guò)調(diào)整實(shí)現(xiàn)經(jīng)過(guò)FIFO的10位并行信號(hào)與本地時(shí)鐘同步，為接下來(lái)輸入到CPLD進(jìn)行電復(fù)接做好準(zhǔn)備。CPLD的電復(fù)接部分程序如下，其中2BP-S為復(fù)接程序，2BS-P為解復(fù)接程序。
圖7 FIFO部分電路處理過(guò)程
評(píng)論