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          基于FPGA的室內(nèi)智能吸塵平臺(tái)設(shè)計(jì)

          作者: 時(shí)間:2013-04-24 來(lái)源:網(wǎng)絡(luò) 收藏

          智能環(huán)境清潔器由于可代替人進(jìn)行環(huán)境清潔工作,已日漸成為人們研究的焦點(diǎn)。雖然它們實(shí)現(xiàn)了智能,但大多結(jié)構(gòu)復(fù)雜、集成度高,不利于開(kāi)發(fā)者拓展其功能。在研究并總結(jié)市場(chǎng)上相對(duì)成熟產(chǎn)品的基礎(chǔ)上,本文基于可編程性強(qiáng)的設(shè)計(jì)并實(shí)現(xiàn)了應(yīng)用于室內(nèi)的智能吸塵平臺(tái)。平臺(tái)具備自我導(dǎo)航、能清潔大部分空間,同時(shí)外形緊湊、運(yùn)行穩(wěn)定、噪音小。更重要的是其結(jié)構(gòu)簡(jiǎn)單,具有人性化接口,便于操作和功能的進(jìn)一步開(kāi)發(fā)。

          本文引用地址:http://www.ex-cimer.com/article/189625.htm

          1 平臺(tái)總構(gòu)成

          本文提出的平臺(tái)整體框架設(shè)計(jì)如圖1所示,用裝有四個(gè)輪子的小車(chē)作為整個(gè)平臺(tái)的載體。以控制器作為整個(gè)平臺(tái)的主控器,通過(guò)I/O與光電傳感器jk1、jk2、jk3、jk4及碰撞開(kāi)關(guān)jk5相連,實(shí)現(xiàn)平臺(tái)障礙的檢測(cè);通過(guò)I/O輸出PWM波形,驅(qū)動(dòng)揚(yáng)聲器和高低電平的變化以驅(qū)動(dòng)LED的亮滅,組成聲光電路;通過(guò)控制電機(jī)驅(qū)動(dòng)器的信號(hào)控制線(xiàn)來(lái)驅(qū)動(dòng)步進(jìn)電機(jī)dj1、dj2和直流吸塵電機(jī)dj3,實(shí)現(xiàn)平臺(tái)的移動(dòng)和吸塵。

          基于FPGA的室內(nèi)智能吸塵平臺(tái)設(shè)計(jì)

          2 硬件主體設(shè)計(jì)

          系統(tǒng)主要由主控芯片、光電傳感器、碰撞開(kāi)關(guān)、由2個(gè)STC89C52單片機(jī)控制的無(wú)線(xiàn)遙控發(fā)射模塊、兩種模式選擇芯片、聲光電路、驅(qū)動(dòng)電機(jī)、吸塵器電機(jī)和整個(gè)系統(tǒng)的供電電路組成,如圖2所示。

          基于FPGA的室內(nèi)智能吸塵平臺(tái)設(shè)計(jì)

          2.1 FPGA芯片的選擇

          根據(jù)平臺(tái)的總體設(shè)計(jì),可以得出對(duì)芯片的基本要求:(1)需要最少6路PWM波形輸出。(2)需要一路串行通信接口。(3)需要較高的12 V轉(zhuǎn)化為3.3 V的實(shí)時(shí)芯片。(4)較高的處理速度。(5)I/O接口要多。

          綜合考慮這些條件,采用Altera公司生產(chǎn)的CycloneII系列FPGA中的EP2C35F672C6型號(hào)基本可滿(mǎn)足要求。它具有出色的運(yùn)算速度,成本低且?guī)в蠨SP模塊,具有超大的內(nèi)部存儲(chǔ)器、多通道PWM輸出以及靈活的設(shè)計(jì)和多種語(yǔ)言的綜合運(yùn)用,性?xún)r(jià)比較高[1,2]。

          2.2 配置電路設(shè)計(jì)要點(diǎn)[3-6]

          (1)電源電路:供電系統(tǒng)采用12 V電源作為輸入電源,利用L7805CV將其降壓為5 V,再由TPS37HD301將5 V轉(zhuǎn)化為3.3 V和1.2 V,F(xiàn)PGA的I/O端口供電點(diǎn)壓為3.3 V,內(nèi)核供電電壓為1.2 V。因?yàn)殡姍C(jī)驅(qū)動(dòng)系統(tǒng)是用控制器的5 V信號(hào),而FPGA的端口電壓是3.3 V,必須將I/O電壓升壓到5 V,在這里利用的是74HCT245升壓芯片。

          (2)時(shí)鐘和復(fù)位電路:時(shí)鐘電路中用ZPB-26-16 M作為有源晶振,頻率為16 MHz,使得串口波特率更加精確。同時(shí)可支持芯片內(nèi)部的PPL功能及ISP下載功能。復(fù)位電路采取硬件復(fù)位和軟件復(fù)位。

          (3)調(diào)試JTAG和下載電路:因?yàn)镕PGA內(nèi)部可以直接搭建軟核ISP和JTAG,硬件電路接一個(gè)IDC-10的JTAG接口。

          (4)配置存儲(chǔ)電路:選用EPCS16作為FPGA的ROM,可以由下載電纜或其他設(shè)備進(jìn)行重復(fù)編程,也可以通過(guò)AS接口進(jìn)行在線(xiàn)系統(tǒng)編程。用FPGA芯片內(nèi)部自帶的4 MHz的On-Chip memory作為FPGA的RAM。

          (5)傳感器和碰撞開(kāi)關(guān):光電傳感器(光電開(kāi)關(guān))選用滬工集團(tuán)的E3F-DS5C4.P1R型號(hào)的光電開(kāi)關(guān),用于檢測(cè)障礙和樓梯,此型號(hào)是圓柱型擴(kuò)散式最遠(yuǎn)距離5 cm、可調(diào)NPN型常開(kāi)光電開(kāi)關(guān)。碰撞開(kāi)關(guān)主要與前傳感器配合完成對(duì)平臺(tái)前的保護(hù)。當(dāng)平臺(tái)碰到前方障礙時(shí),觸發(fā)開(kāi)關(guān),使平臺(tái)躲開(kāi)障礙物。

          (6)無(wú)線(xiàn)發(fā)送與接收模塊:選用匯睿微通XL02-232AP1型號(hào)無(wú)線(xiàn)模塊,XL02-232AP1是UART接口半雙工無(wú)線(xiàn)傳輸模塊,可以工作在433 MHz公用頻段,滿(mǎn)足無(wú)線(xiàn)管制要求。

          (7)驅(qū)動(dòng)和吸塵電機(jī):平臺(tái)采用前輪雙驅(qū)動(dòng),電機(jī)選擇深圳步科公司生產(chǎn)的兩相混合式步進(jìn)電機(jī),吸塵器電機(jī)采用直流電機(jī)。步進(jìn)電機(jī)的主要電器參數(shù)為:①步距角:1.8°;②相電流:0.87 A;③保持扭矩:0.24 nm;④相電阻:3.3 Ω;⑤相電感:5.0 mH;⑥重量:0.2 kg。

          (8)聲光電路和自動(dòng)清掃時(shí)間輸入顯示電路:聲光電路主要由發(fā)光二極管和蜂鳴器組成,直接連FPGA,提醒平臺(tái)工作狀態(tài)。利用4個(gè)按鍵(確定、初始、上調(diào)、下調(diào))輸入清掃時(shí)間,再由三個(gè)數(shù)碼管顯示設(shè)定時(shí)間。清掃時(shí)間由FPGA內(nèi)部的定時(shí)器計(jì)時(shí),當(dāng)計(jì)時(shí)完成時(shí),平臺(tái)即停止工作。

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