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          LatticeECP4高速配置SERDES

          作者: 時間:2012-06-21 來源:網絡 收藏

          ? FPGA系列結合了高性能FPGA結構、高性能I/O和多達16個通道的嵌入式,帶有相關的物理編碼子層(PCS)邏輯。每個PCS邏輯通道包含專用的發(fā)送和接收電路,用于高速、全雙工的串行數據傳輸,傳輸速率高達6 Gbps。每個通道的PCS邏輯可以配置為支持一系列常用的數據協議,包括千兆以太網、XAUI、PCI Express PIPE、SRIO、CPRI、OBSAI、SD-SDI和HD-SDI。此外,基于協議的邏輯可以全部或部分繞過大量配置,使用戶可以靈活地設計自己的高速數據接口。

          本文引用地址:http://www.ex-cimer.com/article/190226.htm

          每個通道在6 Gbps下的功耗低于175mW,以最低功耗實現了高速串行協議。內置的預加重和均衡電路確保了低BER和高質量的眼圖,如下圖所示。

          12.jpg

          特性和優(yōu)點

          多達16個通道的高速SERDES

          每通道150 Mbps至6 Gbps數據速率

          低功耗:每通道175mW@ 6 Gbps

          內置預加重和均衡用于高級BER

          清晰的SERDES眼圖,低抖動

          基于Quad的架構,可以在一個quad中混合匹配不同的協議

          全功能嵌入式物理編碼子層(PCS)邏輯支持業(yè)界標準協議

          每個器件多達16個通道的全雙工數據支持

          一個芯片支持多種協議

          支持常用的基于8b10b的數據包協議

          SERDES Only模式允許直接8位或10位接口到FPGA邏輯

          兼容CEI-6G

          在低成本封裝中實現6G SERDES的業(yè)界先鋒


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          關鍵詞: LatticeECP4 SERDES

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