基于DSP+CPLD的低壓斷路器群組控制器研究
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時(shí)間：2012-03-13
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2．2 脫扣電路模塊設(shè)計(jì)
脫扣電路分為數(shù)字脫扣與模擬脫扣數(shù)字脫扣電路較為簡(jiǎn)單，DSP通過(guò)I／O口輸出脫扣信號(hào)，經(jīng)過(guò)光耦隔離放大驅(qū)動(dòng)磁通線(xiàn)圈。模擬脫扣電路采用比較器電平鑒幅電路實(shí)現(xiàn)，每一相電流采用兩個(gè)比較器來(lái)完成，當(dāng)微處理器沒(méi)有發(fā)出脫扣信號(hào)且電流信號(hào)的幅值在參考基準(zhǔn)電壓范圍內(nèi)，則比較器并聯(lián)輸出一高電平，否則為低電平。低電平信號(hào)通過(guò)脈寬檢測(cè)電路，進(jìn)行抗干擾處理。如果低脈沖維持一定的寬度則單穩(wěn)態(tài)觸發(fā)器被觸發(fā)，同時(shí)輸出一定寬度的脈沖通過(guò)驅(qū)動(dòng)電路使磁通變換器打開(kāi)，從而分?jǐn)鄶嗦菲?。模擬脫扣電路如圖3所示。本文引用地址：http://www.ex-cimer.com/article/190655.htm
比較器電平鑒幅電路在實(shí)際應(yīng)用中，由于干擾的存在，比較器的輸出會(huì)出現(xiàn)一些不必要的窄脈沖，因此設(shè)計(jì)了脈寬檢測(cè)電路用于濾除干擾尖峰引起誤觸發(fā)脫扣動(dòng)作。在設(shè)計(jì)時(shí)，當(dāng)輸入脈沖寬度大于1ms時(shí)，輸出32．9ms的脫扣信號(hào)；當(dāng)小于1ms時(shí)，不輸出脫扣信號(hào)。
模擬脫扣電路在實(shí)際應(yīng)用中，上電初期的短路電流只在100 ms內(nèi)起作用，其后即在DSP初始化完畢開(kāi)始正常運(yùn)行，模擬脫扣電路則進(jìn)行特大短路電流的判斷，兩種不同情況，其電流定值不同。因此設(shè)計(jì)了可切換參考基準(zhǔn)電壓，即MCR分?jǐn)嘟油娐?。MCR分?jǐn)嘟油娐吩谏想姵跗?，C408兩端電壓較低，通過(guò)比較器輸出高電平，使得T401飽和導(dǎo)通，因此參考基準(zhǔn)電壓降低，即模擬脫扣動(dòng)作值較低，出現(xiàn)短路故障時(shí)，實(shí)現(xiàn)MCR脫扣。上電穩(wěn)定后，C408兩端電壓升高，通過(guò)比較器輸出低電平，使得T401截止，此時(shí)參考基準(zhǔn)電壓較高，在出現(xiàn)特大短路電流時(shí)，實(shí)現(xiàn)模擬脫扣，MCR脫扣電路如圖4所示。
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