Xilinx FPGA 配置電路分類

FPGA配置電路可以看成用戶設(shè)計(jì)和硬件電路之間的連接紐帶，最終目的是在一定外部條件下，準(zhǔn)確快速地實(shí)現(xiàn)FPGA系統(tǒng)配置。

在FPGA的配置系統(tǒng)中，軟件編程由FPGA提供商提供，設(shè)計(jì)人員要掌握其操作方法，

將配置數(shù)據(jù)從PC加載到XilinxFPGA芯片的整個(gè)配置過(guò)程，可分為以下步驟：初始化；清空配置存儲(chǔ)器；加載配置數(shù)據(jù)；CRC錯(cuò)誤檢查，START-UP

FPGA配置方式靈活多樣，根據(jù)芯片是否能夠自己主動(dòng)加載配置數(shù)據(jù)分為主模式、從模式以及JTAG模式。典型的主模式都是加載片外非易失( 斷電不丟數(shù)據(jù)) 性存儲(chǔ)器中的配置比特流，配置所需的時(shí)鐘信號(hào)( 稱為CCLK) 由FPGA內(nèi)部產(chǎn)生，且FPGA控制整個(gè)配置過(guò)程。從模式需要外部的主智能終端( 如處理器、微控制器或者DSP等) 將數(shù)據(jù)下載到FPGA中，其最大的優(yōu)點(diǎn)就是FPGA 的配置數(shù)據(jù)可以放在系統(tǒng)的任何存儲(chǔ)部位，包括：Flash、硬盤、網(wǎng)絡(luò)，甚至在其余處理器的運(yùn)行代碼中。JTAG 模式為調(diào)試模式，可將PC 中的比特文件流下載到FPGA中，斷電即丟失。此外，目前賽靈思還有基于Internet 的、成熟的可重構(gòu)邏輯技術(shù)System ACE解決方案。

(1) 主模式

在主模式下，F(xiàn)PGA上電后，自動(dòng)將配置數(shù)據(jù)從相應(yīng)的外存儲(chǔ)器讀入到SRAM中，實(shí)現(xiàn)內(nèi)部結(jié)構(gòu)映射；主模式根據(jù)比特流的位寬又可以分為：串行模式( 單比特流) 和并行模式( 字節(jié)寬度比特流) 兩大類。如：主串行模式、主SPI Flash 串行模式、內(nèi)部主SPI Flash串行模式、主BPI 并行模式以及主并行模式，如圖5-19所示。

(2) 從模式

在從模式下，F(xiàn)PGA 作為從屬器件，由相應(yīng)的控制電路或微處理器提供配置所需的時(shí)序，實(shí)現(xiàn)配置數(shù)據(jù)的下載。從模式也根據(jù)比特流的位寬不同分為串、并模式兩類，具體包括：從串行模式、JTAG模式和從并行模式三大類，其概要說(shuō)明如圖5-20所示。

(3)JTAG模式

在JTAG模式中，PC和FPGA通信的時(shí)鐘為JTAG接口的TCLK，數(shù)據(jù)直接從TDI進(jìn)入FPGA，完成相應(yīng)功能的配置。

目前，主流的FPGA芯片都支持各類常用的主、從配置模式以及JTAG，以減少配置電路失配性對(duì)整體系統(tǒng)的影響。在主配置模式中，F(xiàn)PGA自己產(chǎn)生時(shí)鐘，并從外部存儲(chǔ)器中加載配置數(shù)據(jù)，其位寬可以為單比特或者字節(jié)；在從模式中，外部的處理器通過(guò)同步串行接口，按照比特或字節(jié)寬度將配置數(shù)據(jù)送入FPGA芯片。此外，多片F(xiàn)PGA可以通過(guò)JTAG菊花鏈的形式共享同一塊外部存儲(chǔ)器，同樣一片/ 多片F(xiàn)PGA也可以從多片外部存儲(chǔ)器中讀取配置數(shù)據(jù)以及用戶自定義數(shù)據(jù)。