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基于FPGA的視頻采集與顯示模塊設(shè)計

作者：時間：2011-03-09 來源：網(wǎng)絡(luò)

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　　3 參數(shù)設(shè)置

　　本系統(tǒng)采用640×480 像素顯示，刷新率為60Hz模式，像素時鐘為25MHz。在VGA水平時序中，每行包括800像素點，其中640為有效顯示脈沖， 160為行消隱區(qū)；而在VGA垂直時序中，每場525行，其中480有效， 45行為場消隱。其具體參數(shù)如下：

　　4 結(jié)束語

　　本文介紹的圖像采集和顯示模塊設(shè)計簡單，成本較低。由于其用高效硬件描述語言構(gòu)成，故其處理效率高，具有很好的實用特性。

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關(guān)鍵詞： FPGA 視頻采集 顯示模塊

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