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          基于DDS和FPGA技術的高動態(tài)擴頻信號源的研究

          作者: 時間:2010-10-06 來源:網(wǎng)絡 收藏

          擴展頻譜通信(Spread Spectrum Communication)作為一種新型的通信體系,具有抗干擾能力強、截獲率低、碼分多址、信號隱蔽、保密、易于測距等優(yōu)點,是通信領域的一個重要發(fā)展方向。正是由于這些優(yōu)點,通信在軍事上受到了極大的重視。為配合高接收機的研究,迫切需要一臺能夠精確模擬高機動目標環(huán)境條件下的信號的信號源。本文提出的基于(Direct Digital Synthesis)和技術的高擴頻仿真信號源不但能夠模擬擴頻信號,而且由于采用了使用技術的頻率合成器AD9854,能夠實現(xiàn)高速的頻率跳變,因此該信號源就能夠比較精確地模擬多普勒效應,實現(xiàn)高仿真。

          本文引用地址:http://www.ex-cimer.com/article/191542.htm

          可編程邏輯器件(Programmable Logic Device,PLD)及其應用是20世紀70年代誕生的一門新興技術,PLD具有集成度高、可靠性強、可重復編程等特點。PLD器件包括PROM、GAL、EPLD、ispLSI和,其中編程靈活,它的I/O引腳多達幾百條,一片F(xiàn)PGA就可以實現(xiàn)邏輯功能十分復雜的邏輯部件或者一個小型數(shù)字系統(tǒng)。本文介紹的系統(tǒng)選用ALTERA公司的FLEX10K系列器件,主要完成提取數(shù)據(jù)和擴頻調制。

          1 高動態(tài)擴頻仿真信號源的原理簡介

          原理如圖1所示,該信號源從原理上主要分為擴頻調制和載波調制兩部分,而單片機則起到核心控制的作用。單片機AT89C52一共連接了四個外設:可編程I/O接口芯片8155、液晶顯示模塊MGLS-19264、時鐘發(fā)生器AD9850和頻率合成器AD9854。

          (1)擴頻調制。擴頻調制主要由可編程邏輯器件FPGA來完成。五組PCM碼和八組PN碼分別存在兩塊EPROM中,液晶顯示屏提供給用戶一個友好的界面,提示用戶輸入各種參數(shù)。單片機依照用戶從鍵盤輸入的組別產(chǎn)生地址;FPGA根據(jù)單片機提供的地址,按照AD9850產(chǎn)生的時鐘,從EPROM中提取數(shù)據(jù),并在FPGA內部完成擴頻調制,然后送出數(shù)據(jù),進行載波調制。

          擴頻調制采用直接序列擴頻調制(DS),輸出的信號波形為:

          AD9850使用了先進的直接數(shù)字頻率合成技術(),是高速度、高性能的完全數(shù)字化的可編程頻率合成器和時鐘發(fā)生器。此處AD9850產(chǎn)生了一個5.23264MHz的時鐘信號。

          (2)載波調制。載波調制采用二進制相移鍵控(BPSK)。一般的BPSK信號的表達式為:

          載波調制選用可編程頻率合成器AD9854。AD9854是采用DDS技術、高度集成化的器件。配合內部兩個高速、高性能的正交數(shù)模轉換器和一個比較器來完成數(shù)字可編程的I、Q兩路頻率合成功能。AD9854可以完成SINGIE-TONE、FSK、RANPED FSK、CHIRP、BPSK等調制功能。AD9854創(chuàng)新的高速DDS內核提供了48比特的頻率分辨率。AD9854的電路結構允許同時產(chǎn)生兩路正交的高達150MHz的輸出,并且輸出的頻率可以在數(shù)字的調整下以每秒100兆個新頻率點的速度跳變。兩個12比特的乘法器可以實現(xiàn)可編程的幅度調制,輸出整形鍵控和精確的正交輸出幅度控制。AD9854的可編程4~20倍參考時鐘倍頻器電路可以用較低頻率的外部參考時鐘而在內部產(chǎn)生一個高達300MHz的時鐘。AD9854工作在并行工作方式下時,有8根數(shù)據(jù)線、6根地址線與單片機相連。AD9854的頻率控制字FTW=Fout×248/CLKIN。

          通過單片機不斷地改變AD9854的頻率轉換字(FTW)來完成對多普勒效應的模擬。對輸出幅度的控制也是通過單片機寫AD9854內部寄存器來完成。

          2 高動態(tài)仿真的原理和實現(xiàn)方案

          多普勒效應是由于信號發(fā)射端與接收端之間的相對運動引起的。本文介紹的高動態(tài)擴頻仿真信號源模擬的多普勒現(xiàn)象,屬于動點對靜止點之間的情況。

          假設動點以速度V面向靜止點運動,電磁波傳播速度為C,發(fā)出的信號初始頻率為F,則靜止點接收的頻率為:F’= F×C/(C-V);若動點以速度V背向靜止點方向運動,則有:F’=F×C/(C+V)。設F’=F+Fd,則Fd=F’-F。而對后一種情況

          設動點做勻變速運動,即V=at,則有Fd1=t×(F×a/C),Fd2=-t×(F×a/C),設K=F×a/C,于是Fd1=K×t,Fd2=-K×t,K為常數(shù)。由F’=F+Fd可知接收到的頻率F’圍繞中心頻率F對時間t呈線性變化。

          因此本信號源模擬的多普勒效應頻率變化如圖2所示(圖中0、1、2、3表示一個周期的四種狀態(tài))。


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          關鍵詞: FPGA DDS 動態(tài) 擴頻

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