用FPGA技術實現(xiàn)模擬雷達信號

芯片的輸出和輸出信號定義如下：

輸入信號：連續(xù)波雷達模擬信號輸入；制導SA-2輸入；制導SA-3輸入；時鐘脈沖輸入等。

輸出信號：輸出1；輸出2。

2芯片結構

該芯片分為10個子模塊，如圖2所示。各子模塊的作用如下：

二分頻電路

時鐘脈沖輸入CLK頻率為1MHz，一方面為203分頻及脈寬整形電路、143分頻及脈寬整形電路提供1μs的方波，使二個脈寬整形電路產(chǎn)生0.5μs脈寬信號；另一方面CLK經(jīng)二分頻電路產(chǎn)生500kHz信號，提供給203分頻及脈寬整形電路、143分頻及脈寬整形電路、166分頻及脈寬整形電路作為分頻電路的輸入信號，同時提供給消抖動電路及編碼器、166分頻及脈寬整形電路、18.5分頻及脈寬整形電路用來產(chǎn)生1μs脈寬信號。

消抖動電路及編碼器

消抖動電路能消除開關的（文內未見有提及機械開關，如電路開關應是上升、下降邊沿抖動對輸出的影響，它分別將開關的輸入信號轉變?yōu)?μs脈寬的輸出信號。CW開關、SA-2開關、SA-3開關信號經(jīng)編碼后產(chǎn)生對應的碼元00、01、10信號，控制選擇器工作。

各分頻及脈寬整形電路

5個分頻電路按功能的要求產(chǎn)生各自的重頻頻率，再經(jīng)脈寬整形電路產(chǎn)生出符號各信號脈沖寬度（1μs或0.5μs）的脈沖。如：203分頻及脈寬整形電路產(chǎn)生2463Hz、0.5μs脈寬的信號；166分頻及脈寬整形電路產(chǎn)生3012Hz、1μs脈寬的信號；143分頻及脈寬整形電路產(chǎn)生3097Hz、 0.5μs脈寬的信號；18.5分頻及脈寬整形電路產(chǎn)生132Hz、1μs脈寬的信號；3分頻電路產(chǎn)生44Hz方波信號。

SA-2指令組形成電路

將2463Hz、132Hz與44Hz信號一起加到SA-2指令組成電路，產(chǎn)生一組脈沖序列，構成每秒132個單指令、44個指令組。在560μs內只有一個脈沖，稱為單指令，有2個或更多脈沖，稱為指令組。

選擇器

依據(jù)編碼器輸送來的碼元，選擇器輸出對應的工作狀態(tài)。當碼元為“00”時，“OUT2”輸出連續(xù)波雷達模擬信號；碼元為“01”時，“OUT2”輸出SA -2的重頻脈沖，“OUT1”輸出SA-2的指令信號組；當碼元為“10”時，“OUT2”輸出SA-3的重頻脈沖，“OUT1”輸出SA-3的指令信號。